三階單環(huán)Delta-sigma調(diào)制器在ADC中的應(yīng)用

作者：時間：2012-07-15 來源：網(wǎng)絡(luò)

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　　模數(shù)轉(zhuǎn)換器(ADC)在信號處理中起了一個非常重要的作用。在數(shù)字音頻、數(shù)字電視、圖像編碼及頻率合成等領(lǐng)域需要大量的數(shù)據(jù)轉(zhuǎn)換器。由于超大規(guī)模集成電路的尺寸和偏壓不斷減小，模擬器件的精度和動態(tài)范圍也不斷降低，對于實現(xiàn)高分辨率的ADC是一種挑戰(zhàn)。高階多位Delta-sigma ADC由于不需要采樣保持電路，電路規(guī)模小，可以實現(xiàn)較高的分辨率，因此在實際中得到廣泛的應(yīng)用。Delta-sigmaADC采用過采樣技術(shù)和噪聲整形技術(shù)相結(jié)合，對量化噪聲雙重抑制，從而實現(xiàn)高精度模數(shù)轉(zhuǎn)換。在實際的設(shè)計中需要根據(jù)設(shè)計指標(biāo)穩(wěn)定性和動態(tài)范圍等進(jìn)行折衷。要實現(xiàn)大的動態(tài)范圍，就需要較高的過采樣率和多位量化器。為了保持高階DSM的穩(wěn)定性就需要使用多位量化器，而多位量化器會增加后續(xù)內(nèi)部ADC的設(shè)計難度。因此，必須仔細(xì)選擇過采樣率和量化器的位數(shù)，以實現(xiàn)預(yù)期的性能指標(biāo)。本文提出一種三階 單環(huán)局部反饋的Delta-sigma調(diào)制器結(jié)構(gòu)，利用Richard Schreier的Matlab Delta-sigma調(diào)制器設(shè)計工具包，推導(dǎo)調(diào)制器傳輸函數(shù)，并對系數(shù)進(jìn)行優(yōu)化，使用Verilog硬件語言對調(diào)制器進(jìn)行行為級建模。調(diào)制器的信號帶寬為32.8kHz，過采樣率為128，工作時鐘8.4MHZ，精度16位，可以達(dá)到145dB以上的SNR。

　　1 Delta-sigma調(diào)制器的原理和結(jié)構(gòu)

　　△-∑調(diào)制技術(shù)來自高分辨率的A/D、D/A變換器中的過取樣△-∑轉(zhuǎn)換技術(shù)，利用經(jīng)典自動控制理論中負(fù)反饋概念，通過反饋環(huán)來提高量化器的有效分辨率并整形其量化噪聲。在對信號進(jìn)行過取樣后，噪聲功率譜幅度降低，并通過一個對輸入呈低通而對量化噪聲呈現(xiàn)高通的噪聲整形器，將量化噪聲功率的絕大部分移到信號頻帶之外，從而可通過濾波有效地抑制噪聲。

　　Delta-sigma調(diào)制器的仿真模型可以用圖1來表示。該系統(tǒng)是一個雙端輸入、單端輸出的線性系統(tǒng)，系統(tǒng)的一個輸入為外部輸入信號U，另一個輸入為量化器的反饋V，輸出則是量化器的輸入Y。