一種基于CPLD的單片機(jī)與PCI接口設(shè)計(jì)方案

0 引言

8位單片機(jī)在嵌入式系統(tǒng)中應(yīng)用廣泛，然而讓它直接與PCI總線設(shè)備打交道卻有其固有缺陷。8位單片機(jī)只有16位地址線，8位數(shù)據(jù)端口，而PCI總線2.0規(guī)范中，除了有32位地址數(shù)據(jù)復(fù)用AD[3～0]外，還有FRAME、IRDY、TRDY等重要的信號(hào)線。讓單片機(jī)有限的I/O端口來(lái)直接控制如此眾多的信號(hào)線是不可能的。一種可行的方案就是利用CPLD作為溝通單片機(jī)與PCI設(shè)備間的橋梁，充分利用CPLD中I/O資源豐富、用戶可自定制邏輯的優(yōu)勢(shì)，來(lái)幫助單片機(jī)完成與PCI設(shè)備間的通信任務(wù)。

1 PCI接口設(shè)計(jì)原理

1.1 PCI總線協(xié)議簡(jiǎn)介

這里只討論P(yáng)CI總線2.0協(xié)議，其它協(xié)議僅僅是在2.0的基礎(chǔ)上作了一些擴(kuò)展，僅就單片機(jī)與PCI設(shè)備間的通信來(lái)說，意義不大。PCI總線是高性能局部

PCI總線上信號(hào)線雖然多，但并不是每個(gè)信號(hào)都要用到。實(shí)際上PCI設(shè)備也并不會(huì)支持所有的信號(hào)線，比如錯(cuò)誤報(bào)告信號(hào)PERR與SERR在網(wǎng)卡中就不支持。我們可以針對(duì)具體的應(yīng)用選擇支持其中部分信號(hào)線，還有一些信號(hào)線可以直接連電源或接地。下面簡(jiǎn)單介紹一下常用信號(hào)線的功能。

AD[31～0]：地址數(shù)據(jù)多路復(fù)用信號(hào)。在FRAME有效的第一個(gè)周期為地址，在IRDY與TRDY同時(shí)有效的時(shí)候?yàn)閿?shù)據(jù)。

C/BE[3～0]：總線命令與字節(jié)使能控制信號(hào)。在地址中傳輸?shù)氖强偩€命令；在數(shù)據(jù)期內(nèi)是字節(jié)使能控制信號(hào)，表示AD[31～0]中哪些字節(jié)是有效數(shù)據(jù)。以下是總線命令編碼的說明：

C/BE[30]# 命令類型說明C/BE[30]# 命令類型說明

0 0 0 0 中斷應(yīng)答 1 0 0 0 保留

0 0 0 1 特殊周期 1 0 0 1 保留

0 0 1 0 I/O讀 1 0 1 0 配置讀

0 0 1 1 I/O寫 1 0 1 1 配置寫

0 1 0 0 保留 1 1 0 0 存儲(chǔ)器多行讀

0 1 0 1 保留 1 1 0 1 雙地址周期

0 1 1 0 存儲(chǔ)器讀 1 1

0 1 1 1 存儲(chǔ)器寫 1 1 1 1 存儲(chǔ)器寫并無(wú)效

PCI總線上所有的數(shù)據(jù)傳輸基本上都由以下三條信號(hào)線控制。

FRAME：幀周期信號(hào)。由主設(shè)備驅(qū)動(dòng)，表示一次訪問的開始和持續(xù)時(shí)間，F(xiàn)RAME有效時(shí)（0為有效，下同），表示數(shù)據(jù)傳輸進(jìn)行中，失效后，為數(shù)據(jù)傳輸最后一個(gè)周期。

IRD：主設(shè)備準(zhǔn)備好信號(hào)。由主設(shè)備驅(qū)動(dòng)，表示主設(shè)備已經(jīng)準(zhǔn)備好進(jìn)行數(shù)據(jù)傳輸。

TRDY：從設(shè)備準(zhǔn)備好信號(hào)。由從設(shè)備驅(qū)動(dòng)，表示從設(shè)備已經(jīng)準(zhǔn)備好進(jìn)行數(shù)據(jù)傳輸。當(dāng)IRDY與TRDY同時(shí)有效時(shí)，數(shù)據(jù)傳輸才會(huì)真正發(fā)生。

另外，還有IDSEL信號(hào)用來(lái)在配置空間讀寫期間作為片選信號(hào)。對(duì)于只有一個(gè)PCI從設(shè)備的情況，它總可以接高電平。IDSEL信號(hào)由從設(shè)備驅(qū)動(dòng)，表示該設(shè)備已成為當(dāng)前訪問的從設(shè)備，可以不理會(huì)。

在PCI總線上進(jìn)行讀寫操作時(shí)，PCI總線上的各種信號(hào)除了RST、IRQ、IRQC、IRQ之外，只有時(shí)鐘的下降沿信號(hào)會(huì)發(fā)生變化，而在時(shí)鐘上升沿信號(hào)必須保持穩(wěn)定。

1.2 CPLD設(shè)計(jì)規(guī)劃

出于對(duì)單片機(jī)和CPLD處理能力和系統(tǒng)成本的考慮，下面的規(guī)劃不支持PCI總線的線性突傳輸?shù)刃枰B續(xù)幾個(gè)數(shù)據(jù)周期的讀寫方式，而僅支持一個(gè)址周期加一個(gè)數(shù)據(jù)周期的讀寫方式。對(duì)于大部分應(yīng)用而言，這種方式已經(jīng)足夠了。圖1是經(jīng)過簡(jiǎn)化后的PCI總線讀寫操作時(shí)序。