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一種多路輸出開關(guān)電源的設(shè)計(jì)以及實(shí)際應(yīng)用原則

作者: 時(shí)間:2014-01-22 來源:網(wǎng)絡(luò) 收藏
t: 24px; color: rgb(62, 62, 62); font-family: Tahoma, Arial, sans-serif; font-size: 14px; text-align: justify; ">3)調(diào)節(jié)第j路以外的各路輸出負(fù)載電流為最小值,測量第j路的輸出電壓ULj。

本文引用地址:http://m.butianyuan.cn/article/226716.htm


4)按式(1)計(jì)算第j路的交叉負(fù)載調(diào)整率SIL。


SIL一種多路輸出開關(guān)電源的設(shè)計(jì)以及實(shí)際應(yīng)用原則=×100%(1)


式中:ΔUj為當(dāng)其它各路負(fù)載電流為最小值時(shí),Uj與該路輸出電壓ULj之差的絕對值;


Uj為各路輸出電流為額定值時(shí),第j路的輸出電壓。


根據(jù)上面的測試及計(jì)算方法可以將交叉負(fù)載調(diào)整率理解為:所有其它輸出電路負(fù)載跨步變(100%-0%時(shí))對該路輸出電壓精度影響的百分比。多路輸出


由圖1原理所構(gòu)成的實(shí)際,主控電路僅反饋主輸出電壓,其它輔助電路完全放開。此時(shí)假設(shè)主、輔電路的功率比為1:1。從實(shí)際測量得主電路交叉負(fù)載調(diào)整率優(yōu)于0.2%,而輔電路的交叉負(fù)載調(diào)整率大于50%。無論設(shè)計(jì)者還是應(yīng)用者對大于50%的交叉負(fù)載調(diào)整率都將是不能接受的。如何降低輔電路交叉負(fù)載調(diào)整率,最直接的想法就是給輔助電路加一個(gè)線性穩(wěn)壓調(diào)節(jié)器(包括三端穩(wěn)壓器,低壓差三端穩(wěn)壓器)如圖3所示。


從圖3可知,由于引入了線性穩(wěn)壓調(diào)節(jié)器V,所以在輔路上附加了一部分功率損耗,功率損耗為P=(Vaux′-Vaux1)Iaux,而要使輔電路的交叉負(fù)載調(diào)整率小,就必須有意識(shí)地增大線性調(diào)整器的電壓差(Vaux′-Vaux1),即就是要有意識(shí)增大Vaux′,其帶來的缺點(diǎn)就是增加了電源的功率損耗,降低了電源的效率。


以圖1及圖3原理為基礎(chǔ)設(shè)計(jì)和應(yīng)用電源時(shí),應(yīng)注意的原則為:


1)主電路實(shí)際使用的電流最小應(yīng)為最大滿輸出電流的30%;


2)主電路電壓精度應(yīng)優(yōu)于0.5%;


3)輔電路功率最好小于主電路功率的50%;


4)輔電路交叉負(fù)載調(diào)整率不大于10%。


改進(jìn)型多路輸出開關(guān)電源


在很多應(yīng)用場合中,要求2路輸出的功率基本相當(dāng),比如±12V/0.5A,±15V/1A。我們通過多年的實(shí)踐,設(shè)計(jì)了如圖4所示的電路,能較好地達(dá)到提高交叉負(fù)載調(diào)整率的目的。


圖4電路設(shè)計(jì)思想的核心有以下2點(diǎn)。


1)將正負(fù)2路輸出濾波電感L1、L2繞制在同一磁芯上,采用雙線并繞的方法,從而保證L1、L2電感量完全相同。并注意實(shí)際接入線路時(shí)的相位(差模方法)關(guān)系,這種濾波電感的連接方法使2路輸出電流的變化量相互感應(yīng),在一定程度上較大地改善了2路輸出的交叉負(fù)載調(diào)整率。


2)從圖4可以看到,采樣比較器Rs1、Rs2不像圖1那樣接到主電路Vp上,而是直接跨接到正負(fù)電源的輸出端上,并且邏輯“地”不是電源的輸出地,而是以負(fù)



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