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C-RAN帶來(lái)無(wú)線移動(dòng)通信的新機(jī)遇和挑戰(zhàn)

作者: 時(shí)間:2012-06-04 來(lái)源:網(wǎng)絡(luò) 收藏

業(yè)界對(duì)于發(fā)展主要疑慮包括兩個(gè)方面:

(1)基帶數(shù)字信號(hào)傳輸?shù)膸捄统杀締?wèn)題

與傳統(tǒng)的RAN架構(gòu)相比,CPRI/Ir/OBRI接口上傳送的基帶數(shù)據(jù)信號(hào)速率是普通Abis/Iub接口傳送的解調(diào)后的業(yè)務(wù)數(shù)據(jù)信號(hào)速率的100倍以上。四載波三扇區(qū)的TD-SCDMA基站的基帶數(shù)字信號(hào)傳輸帶寬需求達(dá)到4Gbit/s,而20MHz單載波三扇區(qū)TD-LTE基站的基帶數(shù)字信號(hào)傳輸帶寬需求接近30Gbit/s。如果為節(jié)約光纖傳輸資源,RRU采用串聯(lián)方式接入到BBU池,總的傳輸帶寬可能達(dá)到100 ~1000Gbit/s,無(wú)疑給光傳輸網(wǎng)造成很大的壓力。

為降低光傳輸網(wǎng)的數(shù)據(jù)傳輸負(fù)載,一些廠商提出了CPRI/Ir/OBRI接口的數(shù)據(jù)壓縮方案,包括降采樣率、非線性量化、IQ數(shù)據(jù)壓縮、子載波壓縮等技術(shù)方案,但以上這些技術(shù)方案,或增加設(shè)備實(shí)現(xiàn)的復(fù)雜度,或嚴(yán)重惡化系統(tǒng)性能,或產(chǎn)生較高的設(shè)備成本,幾方面因素?zé)o法兼顧。

是否能找到一種方法實(shí)現(xiàn)基帶數(shù)字信號(hào)的完美壓縮將可能影響技術(shù)的推廣應(yīng)用。

(2)通用處理器何時(shí)真正完美支持實(shí)時(shí)信號(hào)處理

通用處理器是去電信化的集中表現(xiàn),從計(jì)算能力和成本角度考慮,通用處理器作為軟件化程度最高的處理方式應(yīng)該成為發(fā)展趨勢(shì)。與現(xiàn)有DSP處理器相比,通用處理器的操作系統(tǒng)和虛擬化能力也是其優(yōu)勢(shì)所在。

通用處理器在結(jié)構(gòu)和指令上與信號(hào)處理器有很大的區(qū)別。數(shù)字信號(hào)處理中存在大量數(shù)字累加計(jì)算(MACs),傳統(tǒng)信號(hào)處理器為適應(yīng)這種工作模式專門添加了進(jìn)行單周期乘法操作的專門硬件和MAC指令。通用處理器高速緩存中的數(shù)據(jù)和指令無(wú)法被程序開發(fā)者直接控制,而對(duì)于信號(hào)處理器這些數(shù)據(jù)和指令對(duì)程序開發(fā)者是透明的。另外,通用處理器還不具備類似數(shù)字信號(hào)處理器的零循環(huán)控制機(jī)制和適用于數(shù)字信號(hào)處理的特殊尋址機(jī)制,程序執(zhí)行時(shí)間也無(wú)法準(zhǔn)確預(yù)測(cè)。

如果要將通用處理器應(yīng)用于實(shí)時(shí)信號(hào)處理,就必須針對(duì)處理器的結(jié)構(gòu)和指令作必要的改變。

6 結(jié)束語(yǔ)

針對(duì)建網(wǎng)和運(yùn)維成本的上升、多標(biāo)準(zhǔn)同時(shí)運(yùn)營(yíng)、移動(dòng)互聯(lián)網(wǎng)網(wǎng)絡(luò)負(fù)荷沖擊等現(xiàn)階段網(wǎng)絡(luò)運(yùn)營(yíng)面對(duì)的實(shí)際問(wèn)題,從網(wǎng)絡(luò)結(jié)構(gòu)入手提出了創(chuàng)新的C-RAN網(wǎng)絡(luò)架構(gòu),“顛覆性”地改變了網(wǎng)原有的建設(shè)和運(yùn)營(yíng)模式,極可能為將來(lái)市場(chǎng)開辟新的發(fā)展空間。

我們也需要看到,目前C-RAN技術(shù)框架內(nèi)還有一些技術(shù)細(xì)節(jié)仍待商榷,一些關(guān)鍵技術(shù)問(wèn)題仍待攻克。C-RAN在其后繼演進(jìn)中應(yīng)積極消化吸收來(lái)自設(shè)備廠商解決方案的已有技術(shù)成果,以期達(dá)到最終完善的目的。


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