基于FPGA的信道化接收機(jī)
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4 測(cè)試結(jié)果
系統(tǒng)輸入測(cè)試信號(hào)為單頻正弦信號(hào)，VPP為1 V，信號(hào)經(jīng)過(guò)AD采樣，DDC，信道化后，數(shù)據(jù)結(jié)果經(jīng)過(guò)PCI上傳給PC機(jī)作分析和顯示。
用Microsoft Visual C++6．0制作的界面中：橫坐標(biāo)是信道號(hào)，縱坐標(biāo)是歸一化功率值(dB)，以數(shù)據(jù)形式顯示的內(nèi)容有：信號(hào)功率最大值對(duì)應(yīng)的信道號(hào)、子信道輸出相對(duì)于輸入幅度的dB值以及相鄰的兩個(gè)信道的dB值。如圖4和圖5所示，輸入信號(hào)頻率分別為70 MHz，70．025 MHz，經(jīng)過(guò)信道化后，在對(duì)應(yīng)的信道號(hào)上都能輸出譜線，頻率分辨率達(dá)到25 kHz。經(jīng)過(guò)多次重復(fù)測(cè)試，系統(tǒng)對(duì)相鄰信道的帶外抑制都達(dá)到55 dB以上。本文引用地址：http://m.butianyuan.cn/article/191580.htm
5 結(jié)論
該系統(tǒng)主要器件包括AD6645、EP2S60，其中AD6654實(shí)現(xiàn)ADC，EP2S60負(fù)責(zé)系統(tǒng)控制、通信、算法實(shí)現(xiàn)，最終來(lái)實(shí)現(xiàn)了信道化接收功能。因此，該系統(tǒng)具有高度的靈活性和很強(qiáng)的通用性，可通過(guò)軟件的重載或升級(jí)完成不同指標(biāo)要求、不同模式的系統(tǒng)結(jié)構(gòu)。在多板連接時(shí)，可以構(gòu)成一個(gè)更大的陣列系統(tǒng)，可以用于DOA和DBF。
評(píng)論