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基于DSP和FPGA的汽車(chē)防撞高速數(shù)據(jù)采集系統(tǒng)

作者: 時(shí)間:2012-12-24 來(lái)源:網(wǎng)絡(luò) 收藏

在完成對(duì)EMIF的配置后,接下來(lái)就是實(shí)現(xiàn)EMIF接口的配置工作,保證中的數(shù)據(jù)正常的讀入到中。在中配置EMIF接口的連接圖如圖7所示。

本文引用地址:http://m.butianyuan.cn/article/192881.htm

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該模塊是與FPGA進(jìn)行通信的接口模塊。通過(guò)該模塊,DSP可以實(shí)現(xiàn)向FPGA傳輸控制信號(hào),F(xiàn)PGA也可以通過(guò)該模塊將FIFO中的數(shù)據(jù)傳給DSP。CE、WE、RE、OE為DSP輸入的使能信號(hào),CLK為FPGA提供內(nèi)部時(shí)鐘,CLKOUT2是EMIF的輸出時(shí)鐘,為DSP與FPGA通信提供時(shí)鐘頻率,DSP_Addr(19:0)為DSP的輸入地址,DSP_DataBus(31:0)為DSP的數(shù)據(jù)總線。FPGA根據(jù)讀使能信號(hào)OE與片選信號(hào)CE的輸入邏輯來(lái)判斷EMIF是進(jìn)行讀操作還是寫(xiě)操作。當(dāng)DSP通過(guò)EMIF讀取數(shù)據(jù)時(shí),F(xiàn)PGA中的數(shù)據(jù)從dpram_data(31:0)輸入,由DSP_DataBus(31:0)管腳傳送給DSP;若寫(xiě)數(shù)據(jù),將DSP_DataBus(31:0)傳來(lái)的數(shù)據(jù)從dout(31:0)送入FPGA。
2.4 人機(jī)交互模塊
人機(jī)交互模塊分為按健電路和LCD顯示電路。限于篇幅,本文僅介紹LCD電路。
LCD顯示部分我們采用真空熒光顯示點(diǎn)陣式VFD屏,其優(yōu)點(diǎn)是能高亮度發(fā)光。由于我們選擇的屏是5 V供電,所以由DSP過(guò)來(lái)的3.3 V的信號(hào)線需要經(jīng)過(guò)74LVCA245轉(zhuǎn)化為5 V,再與VFD屏的控制器接口相連,LCD控制器接口如圖8所示。

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3 軟件設(shè)計(jì)
本系統(tǒng)軟件主要由DSP和FPGA組成。其中DSP由系統(tǒng)初始化部分;系統(tǒng)功能模塊的EMIF模塊,F(xiàn)LASH模塊和SDRAM模塊組成以及人機(jī)交互模塊組成。而FPGA設(shè)計(jì)則由FIFO模塊以及DCM模塊組成,軟件總體模塊框圖如圖9所示。

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在整個(gè)系統(tǒng)中,DSP芯片負(fù)責(zé)DSP系統(tǒng)初始化部分和系統(tǒng)功能模塊兩個(gè)部分。其中DSP系統(tǒng)初始化部分包括DSP引導(dǎo)程序,DSP芯片中各硬件寄存器的設(shè)置,以及EDMA,定時(shí)中斷等寄存器的設(shè)置。而系統(tǒng)功能模塊中,包括FLASH模塊和SDRAM模塊,由于本系統(tǒng)中DSP需要處理的數(shù)據(jù)容量比較大,自身的存儲(chǔ)容量不夠,所以一些數(shù)據(jù)需要存儲(chǔ)于FLASH中,而在運(yùn)行過(guò)程中,很多數(shù)據(jù)的處理也要在SDRAM中進(jìn)行;而DSP EMIF模塊主要用來(lái)連接FPGA,F(xiàn)LASH和SDRAM。
FPGA邏輯設(shè)計(jì)部分包括了AD邏輯設(shè)計(jì),DCM邏輯設(shè)計(jì)以及FIFO模塊的邏輯設(shè)計(jì)。這塊功能設(shè)計(jì)的主要目的是利用FPGA的硬件邏輯模塊,同時(shí)進(jìn)行2路高速AD數(shù)據(jù)的采集,并將數(shù)據(jù)放至由ISE軟件的IPcore生成的FIFO中,最后由FIFO再通過(guò)由與EMIF相對(duì)應(yīng)的邏輯接口將數(shù)據(jù)傳輸?shù)紻SP中。而整個(gè)邏輯設(shè)計(jì)過(guò)程中,其時(shí)鐘均由DCM模塊來(lái)產(chǎn)生,DCM模塊可以由ISE軟件的IPcore來(lái)生成,可以通過(guò)IP core生成系統(tǒng)需要的時(shí)鐘頻率,有延時(shí)少,抖動(dòng)小等優(yōu)點(diǎn)。
最后人機(jī)交互程序主要是包括LCD模塊以及鍵盤(pán)模塊。其中LCD來(lái)對(duì)數(shù)據(jù)進(jìn)行顯示,而鍵盤(pán)模塊來(lái)對(duì)系統(tǒng)的各個(gè)參數(shù)進(jìn)行設(shè)定。

4 結(jié)束語(yǔ)
文中在對(duì)目前采集系統(tǒng)的發(fā)展?fàn)顩r、FPGA可編程控制器件和DSP數(shù)字信號(hào)處理系統(tǒng)的深入研究的基礎(chǔ)上,采用了高速ADC+FPGA+ DSP的設(shè)計(jì)方案,設(shè)計(jì)了一款采集系統(tǒng),能夠用于高速行駛的報(bào)警設(shè)備中,實(shí)時(shí)檢測(cè)目標(biāo)汽車(chē)與障礙物之間的距離,及時(shí)提醒駕駛員要提高警惕,注意安全駕駛。


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