關(guān)于單片機(jī)IO口詳解

如圖所示，推挽放大器的輸出級(jí)有兩個(gè)“臂”（兩組放大元件），一個(gè)“臂”的電流增加時(shí)，另一個(gè)“臂”的電流則減小，二者的狀態(tài)輪流轉(zhuǎn)換。對(duì)負(fù)載而言，好像是一個(gè)“臂”在推，一個(gè)“臂”在拉，共同完成電流輸出任務(wù)。當(dāng)輸出高電平時(shí)，也就是下級(jí)負(fù)載門輸入高電平時(shí)，輸出端的電流將是下級(jí)門從本級(jí)電源經(jīng)VT3拉出。這樣一來(lái)，輸出高低電平時(shí)，VT3一路和VT5一路將交替工作，從而減低了功耗，提高了每個(gè)管的承受能力。又由于不論走哪一路，管子導(dǎo)通電阻都很小，使RC常數(shù)很小，轉(zhuǎn)變速度很快。因此，推拉式輸出級(jí)既提高電路的負(fù)載能力，又提高開(kāi)關(guān)速度。

開(kāi)漏輸出:輸出端相當(dāng)于三極管的集電極.要得到高電平狀態(tài)需要上拉電阻才行.適合于做電流型的驅(qū)動(dòng),其吸收電流的能力相對(duì)強(qiáng)(一般20ma以內(nèi)).

開(kāi)漏形式的電路有以下幾個(gè)特點(diǎn)：

1.利用外部電路的驅(qū)動(dòng)能力，減少IC內(nèi)部的驅(qū)動(dòng)。當(dāng)IC內(nèi)部MOSFET導(dǎo)通時(shí)，驅(qū)動(dòng)電流是從外部的VCC流經(jīng)R pull-up，MOSFET到GND。IC內(nèi)部?jī)H需很下的柵極驅(qū)動(dòng)電流。

2.一般來(lái)說(shuō)，開(kāi)漏是用來(lái)連接不同電平的器件，匹配電平用的，因?yàn)殚_(kāi)漏引腳不連接外部的上拉電阻時(shí)，只能輸出低電平，如果需要同時(shí)具備輸出高電平的功能，則需要接上拉電阻，很好的一個(gè)優(yōu)點(diǎn)是通過(guò)改變上拉電源的電壓，便可以改變傳輸電平。比如加上上拉電阻就可以提供TTL/CMOS電平輸出等。（上拉電阻的阻值決定了邏輯電平轉(zhuǎn)換的沿的速度。阻值越大，速度越低功耗越小，所以負(fù)載電阻的選擇要兼顧功耗和速度。）

3.OPEN-DRAIN提供了靈活的輸出方式，但是也有其弱點(diǎn)，就是帶來(lái)上升沿的延時(shí)。因?yàn)樯仙厥峭ㄟ^(guò)外接上拉無(wú)源電阻對(duì)負(fù)載充電，所以當(dāng)電阻選擇小時(shí)延時(shí)就小，但功耗大；反之延時(shí)大功耗小。所以如果對(duì)延時(shí)有要求，則建議用下降沿輸出。

4.可以將多個(gè)開(kāi)漏輸出的Pin，連接到一條線上。通過(guò)一只上拉電阻，在不增加任何器件的情況下，形成“與邏輯”關(guān)系。這也是I2C，SMBus等總線判斷總線占用狀態(tài)的原理。補(bǔ)充：什么是“線與”？：

在一個(gè)結(jié)點(diǎn)(線)上,連接一個(gè)上拉電阻到電源VCC或VDD和n個(gè)NPN或NMOS晶體管的集電極C或漏極D,這些晶體管的發(fā)射極E或源極S都接到地線上,只要有一個(gè)晶體管飽和,這個(gè)結(jié)點(diǎn)(線)就被拉到地線電平上.因?yàn)檫@些晶體管的基極注入電流(NPN)或柵極加上高電平(NMOS),晶體管就會(huì)飽和,所以這些基極或柵極對(duì)這個(gè)結(jié)點(diǎn)(線)的關(guān)系是或非NOR邏輯.如果這個(gè)結(jié)點(diǎn)后面加一個(gè)反相器,就是或OR邏輯.

其實(shí)可以簡(jiǎn)單的理解為：在所有引腳連在一起時(shí)，外接一上拉電阻，如果有一個(gè)引腳輸出為邏輯0，相當(dāng)于接地，與之并聯(lián)的回路“相當(dāng)于被一根導(dǎo)線短路”，所以外電路邏輯電平便為0，只有都為高電平時(shí)，與的結(jié)果才為邏輯1。

關(guān)于推挽輸出和開(kāi)漏輸出，最后用一幅最簡(jiǎn)單的圖形來(lái)概括：

該圖中左邊的便是推挽輸出模式，其中比較器輸出高電平時(shí)下面的PNP三極管截止，而上面NPN三極管導(dǎo)通，輸出電平VS+；當(dāng)比較器輸出低電平時(shí)則恰恰相反，PNP三極管導(dǎo)通，輸出和地相連，為低電平。右邊的則可以理解為開(kāi)漏輸出形式，需要接上拉。

STM32的非ADC I/O口都是5V容忍，當(dāng)然可以接5V器件

浮空輸入：對(duì)于浮空輸入，一直沒(méi)找到很權(quán)威的解釋，只好從以下圖中去理解了

由于浮空輸入一般多用于外部按鍵輸入，結(jié)合圖上的輸入部分電路，我理解為浮空輸入狀態(tài)下，IO的電平狀態(tài)是不確定的，完全由外部輸入決定，如果在該引腳懸空的情況下，讀取該端口的電平是不確定的。