復(fù)雜可編程邏輯器件在通信數(shù)據(jù)傳輸中的應(yīng)用

作者：時間：2010-01-16 來源：網(wǎng)絡(luò)

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　　3.4 LAN 控制信號產(chǎn)生

　　lan91c93是一款嵌入式以太網(wǎng)控制器，和OMAP一起構(gòu)成了嵌入式的以太網(wǎng)網(wǎng)絡(luò)接口卡。OMAP用異步的FLASH接口時序來訪問lan91c93，由于lan91c93沒有片選輸入端，所以把flash的片選和讀寫信號通過作一定處理后輸出給lan91c93。OMAP把CS1空間分配給了lan91c93，當(dāng)nFLASH_CS1為低時，把nFLASH_WE，nFLASH_OE輸出給nLAN_WE,nLAN_OE，否則nLAN_WE，nLAN_OE為高電平。同時把LAN_RDY信號通過CPLD透傳給OMAP，通知OMAP lan91c93準備好數(shù)據(jù)的交換。

　　4 仿真和實測

　　4.1 數(shù)據(jù)接收狀態(tài)仿真

　　置V_D_SEL 為高，TX_RX 也為低，表示現(xiàn)在處于數(shù)據(jù)接收狀態(tài)。依據(jù)時序關(guān)系產(chǎn)生所需的時鐘，復(fù)位信號；產(chǎn)生AD9861 數(shù)據(jù)線上的數(shù)據(jù)，模擬AD 的輸出；產(chǎn)生ADA 使能輸入控制信號AD_DA_ENABLE；SDRAM CAS 信號等等。如下圖所示，DINB為AD9861數(shù)據(jù)線上的數(shù)據(jù)，WRCLK為內(nèi)部產(chǎn)生的6.4M鎖存時鐘，用來把DA數(shù)據(jù)線上的數(shù)據(jù)寫入雙口RAM中，AD9861側(cè)的地址ADDRB是對寫時鐘WRCLK的下降沿計數(shù)得到的。當(dāng)ADDRB為8或0時，產(chǎn)生一DMA中斷，觸發(fā)OMAP通過EMIFF接口把數(shù)據(jù)讀到DSP的MEMORY進行處理，每個DMA請求讀8個數(shù)據(jù)，產(chǎn)生8個低脈沖的CAS信號，對CAS的脈沖個數(shù)進行計數(shù)，得到OMAP側(cè)地址的低3位，最高位由ADDRB的MSB取反得到，這樣能避免讀寫沖突?？梢钥闯鯝D的輸出數(shù)據(jù)能夠被正確地復(fù)現(xiàn)在OMAP的EMIFF接口數(shù)據(jù)線上，并被OMAP正確地讀進去。

數(shù)據(jù)接收狀態(tài)信號時序

圖7 數(shù)據(jù)接收狀態(tài)信號時序

　　4.2 數(shù)據(jù)發(fā)射狀態(tài)仿真

　　置V_D_SEL 為高，TX_RX 為高，表示現(xiàn)在處于數(shù)據(jù)發(fā)射狀態(tài)。依據(jù)時序關(guān)系產(chǎn)生所需的時鐘，復(fù)位信號；產(chǎn)生EMIFF 接口數(shù)據(jù)線上的數(shù)據(jù)，模擬OMAP 輸出的發(fā)射數(shù)據(jù)；模擬產(chǎn)生ADA 使能輸入控制信號AD_DA_ENABLE；SDRAM CAS 信號等等。如下圖所示，ADA_CLK為內(nèi)部產(chǎn)生的6.4M時鐘，輸出作為ad9861的DA轉(zhuǎn)換的主時鐘。對ADA_CLK的上升沿計數(shù)得到AD9861側(cè)的地址ADDRB，當(dāng)ADDRB為8或0時，產(chǎn)生一DMA中斷，觸發(fā)OMAP通過EMIFF接口把發(fā)射數(shù)據(jù)輸出到EMIFF接口數(shù)據(jù)總線上，每個DMA請求寫8個數(shù)據(jù)，產(chǎn)生8個低脈沖的CAS信號，對CAS的脈沖個數(shù)進行計數(shù)，得到OMAP側(cè)地址的低3位，最高位由ADDRB的MSB取反得到，這樣能避免讀寫沖突。DINA為EMIFF接口數(shù)據(jù)線上的數(shù)據(jù)，用CAS延遲信號的下降沿來鎖存DINA，滿足EMIFF的SDRAM寫時序，可以正確地把數(shù)據(jù)寫入到雙口RAM中。DOUTB為輸出給DA的數(shù)據(jù)，同時按照時序要求產(chǎn)生一發(fā)射同步信號TX_SYNC,用來指示發(fā)射的I和Q，用ADA_CLK的上升沿采樣，正好能采樣到DOUTB和TX_SYNC的中間，確保數(shù)據(jù)的穩(wěn)定性。

數(shù)據(jù)發(fā)射狀態(tài)信號時序