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基于Xilinx FPGA的千兆以太網(wǎng)及E1信號的光纖傳輸

  • 本文設(shè)計的基于Xilinx FPGA的千兆位以太網(wǎng)及E1信號的光纖傳輸系統(tǒng)采用Xilinx XC5VLX30T芯片，通過以太網(wǎng)測試儀和數(shù)據(jù)誤碼儀對本系統(tǒng)分別進(jìn)行性能測試，測試結(jié)果滿足設(shè)計要求，系統(tǒng)工作穩(wěn)定。從而實現(xiàn)了千兆位以太網(wǎng)信號和E1信號的接入功能，為用戶搭建了一個大容量、多業(yè)務(wù)的傳輸平臺。
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FPGA低功耗設(shè)計須權(quán)衡多項指標(biāo)

  • 　FPGA的功耗高度依賴于用戶的設(shè)計，沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，如同其它多數(shù)事物一樣，降低功耗的設(shè)計就是一種協(xié)調(diào)和平衡藝術(shù)，在進(jìn)行低功耗器件的設(shè)計時，人們必須仔細(xì)權(quán)衡性能、易用性、成本、密
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在Virtex-5 FPGA芯片中使用CRC硬模塊

  • 數(shù)據(jù)損壞是與數(shù)據(jù)傳輸和存儲有關(guān)的首要問題。只要是在通道上傳輸數(shù)據(jù)，就總會有出現(xiàn)某些錯誤的有限概率。...
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FPGA電源的旁路電容值計算

  • 隨著速度更快密度更高的FPGA器件的出現(xiàn),保持信號完整性就成為高可靠,可重復(fù)性設(shè)計的關(guān)鍵.合適的電源旁路和退偶設(shè)計能夠改善整個設(shè)計的信號完整性.
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基于FPGA的PROFIBUS-DP集線器設(shè)計

  • 摘要：給出了用PROFIBUS―DP HUB來改變現(xiàn)場總線拓?fù)浣Y(jié)構(gòu)的設(shè)計方案，并對數(shù)據(jù)轉(zhuǎn)發(fā)方法進(jìn)行比較。描述了DP協(xié)議傳輸?shù)母袷?，重點介紹并分析了兩種幀結(jié)束檢測方法及其優(yōu)劣，最后通過八通道DP HUB的實例來說明了整個設(shè)計
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基于FPGA的Viterbi譯碼器設(shè)計

  • 摘要：卷積碼及其Viterbi譯碼是現(xiàn)代通信系統(tǒng)中常用的一種信道編碼方法。文中介紹了Viterbi譯碼算法的原理，分析了Viterbi譯碼器的結(jié)構(gòu)，然后用Verilog語言設(shè)計了一種基于Altera公司的EP3C120F780C8芯片的(2，l，7)Vi
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基于FPGA的LDPC編碼設(shè)計

  • 針對低密度奇偶校驗碼(簡稱LDPC碼)的直接編碼運算量較大、復(fù)雜度高，根據(jù)RicIlarclson和Urbanke(RU)建議的編碼方案，介紹一種適于在FPGA上實現(xiàn)，利用有效校驗矩陣來降低編碼復(fù)雜度的LDPC編碼方案，給出了編碼器設(shè)計實現(xiàn)的原理和編碼器的結(jié)構(gòu)和基本組成。在QuartusⅡ7．2軟件平臺上采用基于FPGA的VHDL語言實現(xiàn)了有效的編碼過程。結(jié)果表明：此方案在保證高效可靠傳輸?shù)耐瑫r降低了實現(xiàn)的復(fù)雜度。這種編碼方案可靈活應(yīng)用于不同的校驗矩陣H，碼長和碼率的系統(tǒng)中。
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使用Xilinx FPGA適應(yīng)不斷變化的廣播視頻潮流

  • 使用Xilinx FPGA適應(yīng)不斷變化的廣播視頻潮流,　電視臺的演播室需要在不替換龐大的以同軸電纜構(gòu)建的基礎(chǔ)架構(gòu)的情況下，將模擬音頻和視頻轉(zhuǎn)換為數(shù)字音頻和視頻，這樣就逐漸形成了傳輸非壓縮標(biāo)清視頻的串行數(shù)字接口(SDI)協(xié)議。如今，出于重新利用同軸電纜的同樣目的
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基于DSP與FPGA的全姿態(tài)指引儀圖形顯示系統(tǒng)設(shè)計

  • 基于DSP與FPGA的全姿態(tài)指引儀圖形顯示系統(tǒng)設(shè)計,摘要：針對機載電子全姿態(tài)指引儀顯示圖形信息的特征及其變化特點，在系統(tǒng)初始化時將圖形內(nèi)容分為背景層、填充層和動態(tài)字符層三層，運算過程中只改變根據(jù)參數(shù)變化的填充層和字符層；將圖形運算過程分為圖形輪廓生成和
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基于FPGA的DDR內(nèi)存條的控制

  • 摘要：隨著數(shù)據(jù)存儲量的日益加大以及存儲速度的加快，大容量的高速存儲變得越來越重要。內(nèi)存條既能滿足大容量的存儲又能滿足讀寫速度快的要求，這樣使得對內(nèi)存條控制的應(yīng)用越來越廣泛。首先介紹了內(nèi)存條的工作原
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基于FPGA的多路視頻通道控制

  • 根據(jù)織布機告警系統(tǒng)的需求，提出一種開關(guān)設(shè)計思想，闡述開關(guān)設(shè)計過程中遇到的問題以及解決方法。首先在FPGA中設(shè)計一個開關(guān)控制信號，利用這個信號結(jié)合雙口RAM中的編碼數(shù)據(jù)識別兩個撥動開關(guān)狀態(tài)，從而達(dá)到控制多路視頻通道的目的，使本告警系統(tǒng)更方便的應(yīng)用于實際工業(yè)中。介紹整個控制系統(tǒng)的工作原理，給出硬件結(jié)構(gòu)圖和軟件設(shè)計過程，然后利用QuartusⅡ中的SignalTapⅡLogic Analyzer工具對控制信號進(jìn)行實時采樣分析，最后在織布機告警系統(tǒng)中成功實現(xiàn)視頻通道控制功能。
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高成本效益的AC感應(yīng)電機轉(zhuǎn)差控制優(yōu)化方案

  • 隨著AC感應(yīng)電機成為工業(yè)電機的首選，全方位降低設(shè)計功耗的需求不斷涌現(xiàn)，因此提高這些電機的效率變得非常重...
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FPGA的并行多通道激勵信號產(chǎn)生模塊

  • 本文以并行多通道信號產(chǎn)生模型為依據(jù)，設(shè)計并實現(xiàn)了以FPGA為核心器件的并行多通道信號產(chǎn)生模塊，主要包括FPGA系統(tǒng)設(shè)計和多通道波形產(chǎn)生模塊設(shè)計。通過模塊測試后發(fā)現(xiàn)，該模塊具備產(chǎn)生高質(zhì)量并行多通道激勵信號的能力。
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整合ARM、FPGA與可編程模擬電路設(shè)計的單芯片技術(shù)

  • 整合ARM、FPGA與可編程模擬電路設(shè)計的單芯片技術(shù),如果世上真的有典型或者通用的嵌入式系統(tǒng)應(yīng)用，主流半導(dǎo)體公司的產(chǎn)品目錄一定會薄很多?，F(xiàn)在設(shè)計人員不僅要從多種處理器架構(gòu)中進(jìn)行選擇(大多數(shù)嵌入式系統(tǒng)設(shè)計都以處理器內(nèi)核為中心)，而且外設(shè)、通信端口和模擬功能組
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在FPGA設(shè)計中使用Precision RTL 綜合實例

  • 在FPGA設(shè)計中使用Precision RTL 綜合實例,數(shù)字濾波器通常分成有限脈沖響應(yīng)（finite impulse response，也就是FIR）和
    無限脈沖響應(yīng)（infinite impulse response，也就是IIR）兩大類。FIR 濾波器相對
    于IIR濾波器而言，優(yōu)點是相位線性和性能穩(wěn)定，應(yīng)用范圍廣
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