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EEPW首頁(yè) >> 主題列表 >> 串?dāng)_

電路信號(hào)線間串?dāng)_機(jī)理及措施研究

  • 電子電路中，信號(hào)電流在線路間流動(dòng)會(huì)發(fā)生串?dāng)_，從而使波形畸變導(dǎo)致電路偶發(fā)故障。本文通過(guò)分解電路中的各項(xiàng)寄生參數(shù)、將其做等效處理，對(duì)電路間串?dāng)_成因進(jìn)行理論分析，研究不同頻段內(nèi)，寄生參量隨頻率而產(chǎn)生的頻率響應(yīng)傳輸特性，提出設(shè)計(jì)改善方案。并通過(guò)仿真實(shí)驗(yàn)加以佐證，找到解決串?dāng)_問(wèn)題的方法。
  • 關(guān)鍵字： 趨膚效應(yīng)  高頻特性  串?dāng)_  分布電容  走線電感  接地  202101  

最大限度地減少線纜設(shè)計(jì)中的串?dāng)_方法解析

  • 最大限度地減少線纜設(shè)計(jì)中的串?dāng)_方法解析-最近在做一個(gè)項(xiàng)目時(shí)，我不得不對(duì)幾組電子電線進(jìn)行重新布線，讓它們遠(yuǎn)離越野車的發(fā)電機(jī)，因?yàn)殡娙蓠詈袭a(chǎn)生的噪聲可從發(fā)電機(jī)進(jìn)入電線。這個(gè)項(xiàng)目讓我想起了在通過(guò)電線、帶狀線纜或板對(duì)板連接器布線相互之間相鄰信號(hào)時(shí)所遇到的類似情況。
  • 關(guān)鍵字： 串?dāng)_  TI公司  

在電路設(shè)計(jì)中如何減少電路板上串?dāng)_的設(shè)計(jì)原則

  • 在電路設(shè)計(jì)中如何減少電路板上串?dāng)_的設(shè)計(jì)原則-隨著電路板上走線密度越來(lái)越高，信號(hào)串?dāng)_總是一個(gè)難以忽略的問(wèn)題。因?yàn)椴粌H僅會(huì)影響電路的正常工作，還會(huì)增加電路板上的電磁干擾。
  • 關(guān)鍵字： 電路設(shè)計(jì)  串?dāng)_  

光收發(fā)一體模塊設(shè)計(jì)中的串?dāng)_分析

  • 在小型化光收發(fā)一體模塊如SFP，SFF電路中，由于布線密度的增大而使互連線之間串?dāng)_作用變得十分明顯，特別在2.5G以上高頻電信號(hào)的作用下，這種分布性質(zhì)的耦合作用更是不容忽略。 本文就串?dāng)_的分析計(jì)算做了簡(jiǎn)要的闡述。
  • 關(guān)鍵字： 光收發(fā)  串?dāng)_  

基于高速嵌入式系統(tǒng)的信號(hào)完整性分析

  • 提高信號(hào)完整性、減小串?dāng)_和反射是高速電路系統(tǒng)設(shè)計(jì)能否成功的關(guān)鍵。本文基于以ARM1176JZF-S S3C6410為核處理器的嵌入式開(kāi)發(fā)系統(tǒng)，對(duì)高速電路進(jìn)行了研究。通過(guò)信號(hào)完整性仿真分析，解決了DDR SDRAM差分時(shí)鐘信號(hào)的反射問(wèn)題和視頻輸出信號(hào)的串?dāng)_問(wèn)題。
  • 關(guān)鍵字： 信號(hào)完整性  串?dāng)_  反射  

穩(wěn)健的串?dāng)_設(shè)計(jì)準(zhǔn)則

  • 隨便問(wèn)一位硬件設(shè)計(jì)人員：松散耦合的帶狀線對(duì)跟緊密耦合的帶狀線對(duì)，哪一種會(huì)帶來(lái)更少的通道間差分串?dāng)_。99%的人會(huì)選擇后者。但他們錯(cuò)了。目標(biāo)阻抗和橫切面在超過(guò)10Gbps的高速串行連接中，損耗是影響互聯(lián)設(shè)計(jì)的主要
  • 關(guān)鍵字： 串?dāng)_  

利用S參數(shù)來(lái)描述串?dāng)_

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： S參數(shù)  串?dāng)_  傳輸線  耦合  

消除串?dāng)_自激的工程應(yīng)用實(shí)例

  • 摘要：在實(shí)際工程中，系統(tǒng)在設(shè)計(jì)加工出來(lái)以后，電路結(jié)構(gòu)都已經(jīng)確定，但是在調(diào)試過(guò)程中會(huì)出現(xiàn)各種問(wèn)題，要求有大量調(diào)試的經(jīng)驗(yàn)。文章以C波段的接收機(jī)的調(diào)試為例，給出了幾種消除串?dāng)_自激的實(shí)例應(yīng)用，從而很好的解決了射
  • 關(guān)鍵字： 串?dāng)_  自激  射頻放大器  

利用VNA分析高速線上的串?dāng)_

  • 差分電路可以有效地去除高頻、高速設(shè)計(jì)中的共模噪聲。差分器件和傳輸線不僅常被用于高速數(shù)字總線設(shè)計(jì)，而且也被用于包括手機(jī)在內(nèi)的許多射頻和微波產(chǎn)品中。與測(cè)試傳統(tǒng)的單端器件相比，測(cè)試差分器件和傳輸線需要更多的
  • 關(guān)鍵字： VNA  分析  串?dāng)_    

指狀電源和地線的串?dāng)_

  • 圖5.11示意了電源和地線的指狀布局，與電源和地的柵格類似，容許一些互感的耦合，但是節(jié)省了更多的線路板面積。在FCC分貝輻射指南之前制造的早期計(jì)算機(jī)設(shè)備中，這種老式布局出現(xiàn)過(guò)。電源和地的指狀布局同樣也用廉價(jià)的
  • 關(guān)鍵字： 電源  地線  串?dāng)_    

端接電路的串?dāng)_詳細(xì)介紹

  • 圖6.16中，相鄰的端接電路會(huì)在電路走線之間交叉耦合信號(hào)能量。這種交叉耦合比通常發(fā)生在相鄰傳輸線之間的串?dāng)_更嚴(yán)重。本文將提供接交叉耦合的實(shí)際測(cè)量結(jié)果，同時(shí)給出了一些預(yù)測(cè)端接電路串?dāng)_的提示。端接中的串?dāng)_同時(shí)
  • 關(guān)鍵字： 端接電路  串?dāng)_  詳細(xì)介紹    

存在串?dāng)_時(shí)的抖動(dòng)和定時(shí)分析

  • 串行數(shù)據(jù)標(biāo)準(zhǔn)持續(xù)迅猛發(fā)展，大幅度改善了PC和服務(wù)器系統(tǒng)的性能。測(cè)試這些更高速的標(biāo)準(zhǔn)、找到抖動(dòng)證據(jù)，對(duì)長(zhǎng)期穩(wěn)定性及在設(shè)計(jì)中實(shí)現(xiàn)優(yōu)異的誤碼率(BER)目標(biāo)至關(guān)重要。為高效進(jìn)行分析，首先要選擇適當(dāng)?shù)膬x器，很好地了解
  • 關(guān)鍵字： 串?dāng)_  抖動(dòng)  定時(shí)分析    

平行交叉地平面的串?dāng)_

  • 圖5.10中所示的電源和地的柵格方式，節(jié)約了印刷電路板的面積，但其代價(jià)卻是增加了互感。這種方法不需要單獨(dú)的電源的地層，你可以在同一層像連接電源和地一樣的連接普通信號(hào)。該方法適合于小規(guī)模的低速CMOS和普通TTL電
  • 關(guān)鍵字： 地平面  串?dāng)_    

開(kāi)槽地平面的串?dāng)_

  • 圖5.8中描述的串?dāng)_情況是一個(gè)典型的布局設(shè)計(jì)中錯(cuò)誤，稱為地槽。當(dāng)一個(gè)布線設(shè)計(jì)工程師把正常的布線層的究竟用盡，想在地層面上塞進(jìn)一根走線時(shí)，會(huì)出現(xiàn)地槽。通常采用的方法是地層面上分割出一個(gè)長(zhǎng)條，然后在里面布線。
  • 關(guān)鍵字： 地平面  串?dāng)_    

完整地平面的串?dāng)_

  • 兩個(gè)導(dǎo)體之間的串?dāng)_取決于它們之間的互感和互容。通常在數(shù)字設(shè)計(jì)中，感性串?dāng)_相當(dāng)于或大于容性串?dāng)_，因此在這里開(kāi)始我們主要討論感性耦合的機(jī)制。關(guān)于集總電路中互感耦合的理論大家可以參考相關(guān)文獻(xiàn)。假定返回信號(hào)電
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串?dāng)_介紹

串?dāng)_是兩條信號(hào)線之間的耦合，信號(hào)線之間的互感和互容引起線上的噪聲。容性耦合引發(fā)耦合電流，而感性耦合引發(fā)耦合電壓。PCB板層的參數(shù)、信號(hào)線間距、驅(qū)動(dòng)端和接收端的電氣特性及線端接方式對(duì)串?dāng)_都有一定的影響。 [ 查看詳細(xì) ]

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