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EEPW首頁(yè) >> 主題列表 >> 卷積運(yùn)算

基于FPGA的固定倍率圖像縮放的實(shí)現(xiàn)

  • 基于FPGA硬件實(shí)現(xiàn)固定倍率的圖像縮放,將2維卷積運(yùn)算分解成2次1維卷積運(yùn)算,對(duì)輸入原始圖像像素先進(jìn)行行方向的卷積,再進(jìn)行列方向的卷積,從而得到輸出圖像像素。把圖像縮放過程設(shè)計(jì)為一個(gè)單元體的循環(huán)過程,在單元體內(nèi)部,事先計(jì)算出卷積系數(shù)。降低了FPGA設(shè)計(jì)的復(fù)雜性,提高了圖像縮放算法的運(yùn)算速度,增強(qiáng)了系統(tǒng)的實(shí)時(shí)性,已經(jīng)應(yīng)用于某款航空電子產(chǎn)品中,應(yīng)用效果良好。
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卷積運(yùn)算介紹

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