可編程邏輯器件（ＰＬＤ）文章進(jìn)入可編程邏輯器件（ＰＬＤ）技術(shù)社區(qū)

開(kāi)啟可編程邏輯器件的無(wú)限可能

我們常說(shuō)邏輯器件是每個(gè)電子產(chǎn)品設(shè)計(jì)的“粘合劑”，但在為系統(tǒng)選擇元件時(shí)，它們通常是您最后考慮的部分。確實(shí)有很多經(jīng)過(guò)驗(yàn)證的標(biāo)準(zhǔn)邏輯器件可供選擇。但是，隨著設(shè)計(jì)變得越來(lái)越復(fù)雜，我們需要在電路板上集成邏輯元件，以便為更多功能留出空間。越來(lái)越多的工程師選擇可編程邏輯器件 (PLD)、復(fù)雜 PLD (CPLD) 或現(xiàn)場(chǎng)可編程門(mén)陣列 (FPGA)，從而幫助減小解決方案尺寸、降低設(shè)計(jì)和制造成本、管理其供應(yīng)鏈，并縮短產(chǎn)品上市時(shí)間。在使用 CPLD 或 FPGA 進(jìn)行設(shè)計(jì)時(shí)，需要考慮許多權(quán)衡因素，這些器件支持?jǐn)?shù)千個(gè)邏輯元件，
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無(wú)需編程！德州儀器推出全新可編程邏輯產(chǎn)品

PLD（Programmable Logic Device，可編程邏輯器件）是一種可通過(guò)軟件編程來(lái)改變其邏輯功能的數(shù)字集成電路，自20世紀(jì)70年代初誕生以來(lái)，經(jīng)歷了從簡(jiǎn)單的PROM、PAL、GAL到復(fù)雜的FPGA、CPLD的演變，如今已發(fā)展成為集高速、高集成度、高靈活性于一體的系統(tǒng)級(jí)可編程芯片，廣泛應(yīng)用于產(chǎn)品原型設(shè)計(jì)、中小規(guī)模生產(chǎn)以及SOPC、SOC等先進(jìn)技術(shù)領(lǐng)域。德州儀器更是在1961年就開(kāi)始推出邏輯產(chǎn)品，近60年來(lái)不斷推陳出新。與包含大規(guī)模邏輯門(mén)的FPGA和CPLD不同，TPLD可以支持簡(jiǎn)單快捷的邏輯
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一種基于CPLD的DMA控制器IP核設(shè)計(jì)

但是由于8013硬件結(jié)構(gòu)和指令系統(tǒng)的限制，當(dāng)需要高速率大批量數(shù)據(jù)傳送時(shí)，數(shù)據(jù)吞吐速率往往不能滿足設(shè)計(jì)要求。即使采用提升振蕩器頻率的辦法，結(jié)果仍不
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新手福音：概述學(xué)習(xí)FPGA的一些常見(jiàn)誤區(qū)

新手福音：概述學(xué)習(xí)FPGA的一些常見(jiàn)誤區(qū)-很多剛開(kāi)始學(xué)習(xí)FPGA的朋友們經(jīng)常會(huì)遇上一些誤區(qū)而無(wú)從解決，F(xiàn)PGA為什么是可以編程的？通過(guò)HDL語(yǔ)言怎么看都看不出硬件結(jié)構(gòu)？...本文就這個(gè)方面進(jìn)行解析。
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可編程邏輯器件設(shè)計(jì)技巧

可編程邏輯器件設(shè)計(jì)技巧
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CPLD/FPGA技術(shù)及電子設(shè)計(jì)自動(dòng)化

電子設(shè)計(jì)自動(dòng)化（EDA）的實(shí)現(xiàn)是與CPLD/FPGA技術(shù)的迅速發(fā)展息息相關(guān)的。CPLD/FPGA是80年代中后期出現(xiàn)的，其特點(diǎn)是具有用戶可編程的特性。利用PLD/FPGA，電子系統(tǒng)設(shè)計(jì)工程師可以在實(shí)驗(yàn)室中設(shè)計(jì)出專用IC，實(shí)現(xiàn)系統(tǒng)的集成，從而大大縮短了產(chǎn)品開(kāi)發(fā)、上市的時(shí)間，降低了開(kāi)發(fā)成本。此外，CPLD/FPGA還具有靜態(tài)可重復(fù)編程或在線動(dòng)態(tài)重構(gòu)特性，使硬件的功能可象軟件一樣通過(guò)編程來(lái)修改，不僅使設(shè)計(jì)修改和產(chǎn)品升級(jí)變得十分方便，而且極大地提高了電子系統(tǒng)的靈活性和通用能力。
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FPGA管腳分配需要考慮的因素

在芯片的研發(fā)環(huán)節(jié)，F(xiàn)PGA 驗(yàn)證是其中的重要的組成部分，如何有效的利用 FPGA 的資源，管腳分配也是必須考慮的一個(gè)重要問(wèn)題。一般較好的方法是在綜合過(guò)程中通過(guò)時(shí)序的一些約束讓對(duì)應(yīng)的工具自動(dòng)分配，但是從研發(fā)的時(shí)間段上來(lái)考慮這種方法往往是不可取的，RTL驗(yàn)證與驗(yàn)證板設(shè)計(jì)必須是同步進(jìn)行的，在驗(yàn)證代碼出來(lái)時(shí)驗(yàn)證的單板也必須設(shè)計(jì)完畢，也就是管腳的分配也必須在設(shè)計(jì)代碼出來(lái)之前完成。
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mcu,DSP,PLD/EDA的介紹/比較/分析

當(dāng)今,數(shù)字時(shí)代的核心動(dòng)力便是單片機(jī),DSP ,PLD/ EDA ,以其各自的特點(diǎn)滿足了各種需要,推動(dòng)著信息技術(shù)的快速發(fā)展。這里將對(duì)這三類(lèi)電子產(chǎn)品分別加以介紹,并作比較和分析。
關(guān)鍵字：單片機(jī)(Single-chipMicrocomputer) 數(shù)字信號(hào)處理(DSP) 可編程邏輯器件(PLD)/電子設(shè)計(jì)自動(dòng)化(EDA)

選用FPGA和完整的IP解決方案優(yōu)化汽車(chē)電氣架構(gòu)設(shè)計(jì)

車(chē)載網(wǎng)絡(luò)協(xié)議的數(shù)量有所減少，但實(shí)際部署的網(wǎng)絡(luò)數(shù)量卻有顯著增加。這就提出了網(wǎng)絡(luò)架構(gòu)的可縮放性問(wèn)題，并且要求為滿足各種應(yīng)用和網(wǎng)絡(luò)的實(shí)際需要而優(yōu)化半導(dǎo)體器件。
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可編程邏輯器件與單片機(jī)在雙控制器中的設(shè)計(jì)

可編程邏輯器件的D觸發(fā)器資源非常有限，而且可編程邏輯器件在控制時(shí)序方面不如單片機(jī)那樣方便，很多不熟悉的應(yīng)用者往往感到應(yīng)用起來(lái)非常的困難。利用可編程邏輯器件和單片機(jī)構(gòu)成的雙向通信控制器克服了兩者的缺點(diǎn)，且把二者的長(zhǎng)處最大限度地發(fā)揮出來(lái)。
關(guān)鍵字：可編程邏輯器件雙控制器 AT89C51 CPLD 單片機(jī)

醫(yī)療設(shè)備對(duì)可編程邏輯器件的要求

　　我們可以看到醫(yī)療設(shè)備行業(yè)中在幫助加強(qiáng)醫(yī)療設(shè)施和改善病人護(hù)理方面的一些趨勢(shì)。包括：　　· 小型化 - 小型化旨在實(shí)現(xiàn)低功耗、移動(dòng)化、便攜式、創(chuàng)傷性更小以及集成度更高的醫(yī)療和健康監(jiān)測(cè)設(shè)備;　　· 便攜式 - 電池供電，使用可穿戴設(shè)備進(jìn)行檢測(cè)(例如血糖監(jiān)測(cè));　　· 無(wú)線互連 - 使用電池和無(wú)線視頻傳輸功能取代系繩和電纜，提高移動(dòng)性、可擴(kuò)展性和放置的靈活性;　　· 高性價(jià)比的解決方案 -
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三柵極技術(shù)給FPGA帶來(lái)突破性優(yōu)勢(shì)

本文考察了半導(dǎo)體制造業(yè)中晶體管設(shè)計(jì)從傳統(tǒng)平面向3D結(jié)構(gòu)轉(zhuǎn)化的影響，以及其對(duì)可編程邏輯器件性能的顯著提升。引言2013年2月，Altera公司與Intel公司共同宣布了Altera下一代最高性能FPGA產(chǎn)品的生產(chǎn)將獨(dú)家采用Intel的
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基于可編程邏輯器件的數(shù)字電路設(shè)計(jì)

　　0 引言　　可編程邏輯器件PLD(Programmable Logic De-vice)是一種數(shù)字電路，它可以由用戶來(lái)進(jìn)行編程和進(jìn)行配置，利用它可以解決不同的邏輯設(shè)計(jì)問(wèn)題。PLD由基本邏輯門(mén)電路、觸發(fā)器以及內(nèi)部連接電路構(gòu)成，利用軟件和硬件(編程器)可以對(duì)其進(jìn)行編程，從而實(shí)現(xiàn)特定的邏輯功能?？删幊踢壿嬈骷?0世紀(jì)70年代初期以來(lái)經(jīng)歷了從 PROM，PLA，PAL，GAL到CPLD和FPGA的發(fā)展過(guò)程，在結(jié)構(gòu)、工藝、集成度、功能、速度和靈活性方面都有很大的改進(jìn)和提高。　　隨著數(shù)字集成電路的不斷
關(guān)鍵字：可編程邏輯器件 PLD 數(shù)字電路

一種基于CPLD的可編程FV變換電路

摘要：文章介紹了一種可編程的頻率電壓變換電路(F／V)，將頻率信號(hào)通過(guò)復(fù)雜可編程邏輯器件(CPLD)變換為與頻率成正比的脈寬信號(hào)，脈寬信號(hào)控制模擬開(kāi)關(guān)對(duì)基準(zhǔn)電壓信號(hào)進(jìn)行斬波，斬波信號(hào)經(jīng)低通濾波后輸出直流電壓信號(hào)
關(guān)鍵字：可編程邏輯器件頻率電壓變換脈沖寬度調(diào)制

一種新型的交流電源信號(hào)發(fā)生器的設(shè)計(jì)

摘要：介紹了交流電源信號(hào)發(fā)生器的基本原理，闡述了國(guó)內(nèi)外有關(guān)交流電源信號(hào)發(fā)生器設(shè)計(jì)的基本方法，基于可編程邏輯器件(CPLD)設(shè)計(jì)實(shí)現(xiàn)了交流電源信號(hào)發(fā)生器，并給出了仿真及實(shí)驗(yàn)波形。
關(guān)鍵詞：可編程邏輯器件；交流
關(guān)鍵字：可編程邏輯器件交流電源信號(hào)發(fā)生器

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可編程邏輯器件（ＰＬＤ）介紹

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