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EEPW首頁 >> 主題列表 >> 多端口

基于FPGA的DDR3多端口讀寫存儲管理設(shè)計

  • 引言本文以Xilinx公司的Kintex-7系列XC7K410T FPGA芯片和兩片Micron公司的MT41J128M16 DDR3 SDRAM芯片為硬件平臺，設(shè)計并實(shí)現(xiàn)了基于FPGA的視頻圖形顯示系統(tǒng)的DDR3多端口存儲管理。1 總體架構(gòu)設(shè)計機(jī)載視頻圖形顯示系
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多端口SDRAM控制器的設(shè)計與實(shí)現(xiàn)

  • 　0 引 言　　目前，在很多視頻數(shù)據(jù)采集以及實(shí)時顯示的應(yīng)用開發(fā)中，常需要用到存儲容量大、讀寫速度快的存儲器。在各種存儲器件中，同步動態(tài)隨機(jī)存儲器SDRAM 以其速度快、容量大、價格低的特點(diǎn)而備受關(guān)注。SDRAM 的工
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多端口寄存器堆的低功耗設(shè)計方法

  • 隨著半導(dǎo)體工藝的飛速發(fā)展和芯片工作頻率的提高，芯片的功耗迅速增加，導(dǎo)致芯片發(fā)熱量的增大和可靠性的下降。因此，功耗成為集成電路設(shè)計中的一個重要考慮因素。寄存器堆作為微處理器的關(guān)鍵部件。為了滿足其運(yùn)算速度和指令級并行的流水線結(jié)構(gòu)，高速和多端口讀寫成為發(fā)展的必然趨勢，其低功耗設(shè)計對降低整個處理器的功耗具有重要的意義。讀寫位線、負(fù)載電容、靈敏放大器、時鐘翻轉(zhuǎn)等是影響寄存器堆總功耗的重要因素。針對各因素進(jìn)行低功耗設(shè)計成為寄存器堆設(shè)計的關(guān)鍵。
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多端口1Gbps和10GbpsTCP/iSCSI協(xié)議處理任務(wù)卸載解決方案

  • 　　隨著數(shù)據(jù)中心網(wǎng)絡(luò)基礎(chǔ)設(shè)施逐步升級到10Gbps，讓基于以太網(wǎng)的解決方案承載數(shù)據(jù)業(yè)務(wù)成為一種經(jīng)濟(jì)可行的方法，并且不會降低性能，延長時延?；谟布闹鳈C(jī)接口(如 PCI Express 和千兆級以太網(wǎng) (GbE))，為設(shè)計面向計算機(jī)和數(shù)據(jù)處理市場的低成本、高性能產(chǎn)品創(chuàng)造了可能性。Xilinx  Virtex-5 現(xiàn)場可編程門陣列 (FPGA) 系列，為設(shè)計具備更強(qiáng)功能和更低功耗的片上系統(tǒng)(SoC)解決方案奠定了基礎(chǔ)。 　　Virtex-5 架構(gòu)具有一系列關(guān)鍵特性，能夠大大簡化 TCP 和 iS
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核心路由器中多端口線卡調(diào)度的設(shè)計與實(shí)現(xiàn)

  • 本文對ATM多端口線卡輸入和輸出兩個流向上的數(shù)據(jù)包調(diào)度進(jìn)行了研究，提出了一種具有一定通用性的多端口線卡調(diào)度策略的設(shè)計實(shí)現(xiàn)方案。
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多端口存儲器在多機(jī)系統(tǒng)中的應(yīng)用

  • 介紹雙口RAM和FIFO的結(jié)構(gòu)原理及仲裁邏輯控制；詳細(xì)說明二者在由數(shù)字信號處理器和MCS-51單片機(jī)構(gòu)成的多機(jī)系統(tǒng)中的應(yīng)用，并對二者進(jìn)行了比較。
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多端口介紹

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