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EEPW首頁 >> 主題列表 >> 并行流水線

10Gbps線速轉(zhuǎn)發(fā)引擎的并行流水線設(shè)計與實現(xiàn)

  • 設(shè)計了一種基于FPGA平臺的并行處理流水線結(jié)構(gòu)，配合高速查表，可支持10Gbps接口的報文轉(zhuǎn)發(fā)。該設(shè)計已應(yīng)用在國家863計劃重大課題“可擴展到T比特的高性能IPv4/v6路由器基礎(chǔ)平臺及實驗系統(tǒng)”中,并通過測試。
  • 關(guān)鍵字： 并行流水線  高速查表  FPGA  

基于并行流水線結(jié)構(gòu)的可重配FIR濾波器的FPGA實現(xiàn)

  • 1 并行流水結(jié)構(gòu)FIR的原理 在用FPGA或?qū)Ｓ眉呻娐穼崿F(xiàn)數(shù)字信號處理算法時，計算速度和芯片面積是兩個相互制約的主要問題。實際應(yīng)用FIR濾波器時，要獲得良好的濾波效果，濾波器的階數(shù)可能會顯著增加，有時可能會多達幾百階。因此，有必要在性能和實現(xiàn)復(fù)雜性之間做出選擇，也就是選擇不同的濾波器實現(xiàn)結(jié)構(gòu)。這里運用并行流水線結(jié)構(gòu)來實現(xiàn)速度和硬件面積之間的互換和折衷。 在關(guān)鍵路徑插入寄存器的流水線結(jié)構(gòu)是提高系統(tǒng)吞吐率的一項強大的實現(xiàn)技術(shù)，并且不需要大量重復(fù)設(shè)置硬件。流水線的類型主要分為兩種：算術(shù)流水線和指令流水線
  • 關(guān)鍵字： FIR濾波器  FPGA  并行流水線  單片機  可重配  嵌入式系統(tǒng)  
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并行流水線介紹

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