首頁  資訊  商機   下載  拆解   高校  招聘   雜志  會展  EETV  百科   問答  電路圖  工程師手冊   Datasheet  100例   活動中心  E周刊閱讀   樣片申請
EEPW首頁 >> 主題列表 >> 抗靜電放電

設計PCB時的抗靜電放電方法

  • 設計PCB時的抗靜電放電方法-在PCB板的設計當中,可以通過分層、恰當?shù)牟季植季€和安裝實現(xiàn)PCB的抗ESD設計。通過調整PCB布局布線,能夠很好地防范ESD.盡可能使用多層PCB,相對于雙面PCB而言,地平面和電源平面,以及排列緊密的信號線-地線間距能夠減小共模阻抗和感性耦合,使之達到雙面PCB的1/10到1/100.對于頂層和底層表面都有元器件、具有很短連接線。
  • 關鍵字: PCB  抗靜電放電  ESD  
共1條 1/1 1

抗靜電放電介紹

您好,目前還沒有人創(chuàng)建詞條抗靜電放電!
歡迎您創(chuàng)建該詞條,闡述對抗靜電放電的理解,并與今后在此搜索抗靜電放電的朋友們分享。    創(chuàng)建詞條

熱門主題

樹莓派    linux   
關于我們 - 廣告服務 - 企業(yè)會員服務 - 網(wǎng)站地圖 - 聯(lián)系我們 - 征稿 - 友情鏈接 - 手機EEPW
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產品世界》雜志社 版權所有 北京東曉國際技術信息咨詢有限公司
備案 京ICP備12027778號-2 北京市公安局備案:1101082052    京公網(wǎng)安備11010802012473