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EEPW首頁(yè) >> 主題列表 >> 數(shù)字鐘設(shè)計(jì)

基于FPGA的多功能數(shù)字鐘設(shè)計(jì)

  • 文中簡(jiǎn)要介紹了一種基于FPGA的多功能數(shù)字鐘設(shè)計(jì)方案。在實(shí)現(xiàn)數(shù)字鐘計(jì)時(shí)、校時(shí)和整點(diǎn)報(bào)時(shí)等基本功能的基礎(chǔ)上增加世界時(shí)鐘功能，能夠?qū)⒈本r(shí)間快速轉(zhuǎn)換為格林威治標(biāo)準(zhǔn)時(shí)。該方案采用VHDL和原理圖相結(jié)合的設(shè)計(jì)輸入方式，在QuartusⅡ開發(fā)環(huán)境下完成設(shè)計(jì)、編譯和仿真，并在FPGA硬件開發(fā)板上進(jìn)行測(cè)試，實(shí)驗(yàn)證明該設(shè)計(jì)方案切實(shí)可行，對(duì)FPGA的應(yīng)用和數(shù)字鐘的設(shè)計(jì)具有一定參考價(jià)值。
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基于stc89c52rc單片機(jī)的數(shù)字鐘設(shè)計(jì)（數(shù)碼管顯示）

基于EDA技術(shù)的數(shù)字鐘設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：為使數(shù)字鐘從電路設(shè)計(jì)、性能分析到設(shè)計(jì)出PCB版(即印制電路版)圖的整個(gè)過(guò)程能夠在計(jì)算機(jī)上自動(dòng)處理完成，從而縮短設(shè)計(jì)周期、提高設(shè)計(jì)效率、戰(zhàn)小設(shè)計(jì)風(fēng)險(xiǎn)。本系統(tǒng)基于EDA技術(shù)的設(shè)計(jì)方法，提出一種采用P-MOS大規(guī)模
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數(shù)字鐘設(shè)計(jì)介紹

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