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EEPW首頁 >> 主題列表 >> 電網(wǎng)實(shí)時

基于FPGA的電網(wǎng)實(shí)時數(shù)據(jù)采集與控制

  • 為了消除FFT頻譜泄漏和柵欄效應(yīng)，提高諧波分析精度，文中給出了用高速A／D采集IPcore來實(shí)現(xiàn)電網(wǎng)數(shù)據(jù)實(shí)時采集的設(shè)計方法，同時采用數(shù)字鎖相倍頻同步方法進(jìn)行了誤差修正。其中全數(shù)字鎖相倍頻電路和A／D采集控制電路均采用VHDL語言和可編程邏輯器件設(shè)計實(shí)現(xiàn)，并用quartusII軟件進(jìn)行了仿真。
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電網(wǎng)實(shí)時介紹

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