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EEPW首頁(yè) >> 主題列表 >> 窗函數(shù)

基于FPGA的FIR濾波器的實(shí)現(xiàn)

  • 提出了一種采用現(xiàn)場(chǎng)可編程門陣列器件FPGA并利用窗函數(shù)法實(shí)現(xiàn)線性FIR數(shù)字濾波器硬件電路的方案，并以一個(gè)十六階低通FIR數(shù)字濾波器電路的實(shí)現(xiàn)為例說(shuō)明了利用Xilinx公司XC4000系列芯片的設(shè)計(jì)過(guò)程。設(shè)計(jì)的電路通過(guò)軟件程序進(jìn)行了驗(yàn)證和硬件仿真，結(jié)果表明電路工作正確可靠，能滿足設(shè)計(jì)要求。
  • 關(guān)鍵字： FIR濾波器  窗函數(shù)  FPGA  

基于FPGA流水線分布式算法的FIR濾波器的實(shí)現(xiàn)

  • 提出了一種采用現(xiàn)場(chǎng)可編程門陣列器件(FPGA)并利用窗函數(shù)法實(shí)現(xiàn)線性FIR數(shù)字濾波器的設(shè)計(jì)方案，并以一個(gè)十六階低通FIR數(shù)字濾波器電路的實(shí)現(xiàn)為例說(shuō)明了利用Xilinx公司的Virtex-E系列芯片的設(shè)計(jì)過(guò)程。
  • 關(guān)鍵字： FIR濾波器  窗函數(shù)  FPGA  

窗函數(shù)的選擇

  • 　　摘要：在信號(hào)分析時(shí)，我們一般會(huì)截取有限的波形數(shù)據(jù)做傅里葉變換，這個(gè)截?cái)噙^(guò)程會(huì)產(chǎn)生泄漏，導(dǎo)致功率擴(kuò)散到整個(gè)頻譜范圍，產(chǎn)生大量“霧霾數(shù)據(jù)”，無(wú)法得到正確的頻譜結(jié)果。雖然知道加窗可以抑制泄漏，但復(fù)雜的窗函數(shù)表達(dá)式及抽象的主瓣旁瓣描述方法，另人更加迷惑，下面我們拋棄公式用通俗易懂的方式介紹窗函數(shù)的選擇。　　1.加窗與窗函數(shù)　　在數(shù)字信號(hào)處理中，常見(jiàn)的有矩形窗、漢寧窗、海明窗和平頂窗，這里不再贅述窗函數(shù)的表達(dá)式，只討論窗函數(shù)的使用，下圖直觀地描述了信號(hào)加窗的過(guò)程及窗函數(shù)基本特征?！　?nbsp; 
  • 關(guān)鍵字： 窗函數(shù)  傅里葉變換  
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窗函數(shù)介紹

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