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EEPW首頁(yè) >> 主題列表 >> 設(shè)計(jì)與仿真

基于VHDL的QPSK調(diào)制解調(diào)系統(tǒng)設(shè)計(jì)與仿真

  • 文中詳細(xì)介紹了QPSK技術(shù)的工作原理和QPSK調(diào)制、解調(diào)的系統(tǒng)設(shè)計(jì)方案，并通過(guò)VHDL語(yǔ)言編寫(xiě)調(diào)制解調(diào)程序和QuaitusII軟件建模對(duì)程序進(jìn)行仿真，通過(guò)引腳鎖定，下載程序到FPGA芯片EP1K30TC144-3中驗(yàn)證。軟件仿真和硬件驗(yàn)證結(jié)果表明了該設(shè)計(jì)的正確性和可行性，由于采用FPGA芯片，減小了硬件設(shè)計(jì)的復(fù)雜性，該設(shè)計(jì)具有便于移植維護(hù)和升級(jí)的特點(diǎn)。
  • 關(guān)鍵字： VHDL  QPSK  調(diào)制解調(diào)系統(tǒng)  設(shè)計(jì)與仿真  

基于Verilog的順序狀態(tài)邏輯FSM設(shè)計(jì)與仿真

反饋線性化直接方法的理論分析與改進(jìn)

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設(shè)計(jì)與仿真介紹

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