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EEPW首頁 >> 主題列表 >> 誤碼率測試儀

集成式比特誤碼率測試儀在FPGA中的應用

  • 隨著高速數(shù)字系統(tǒng)的發(fā)展，高速串行數(shù)據(jù)被廣泛使用，內(nèi)嵌高速串行接口的FPGA也得到大量應用，相應的高速串行信號質(zhì)量的測試也越來越頻繁和重要。通常用示波器觀察信號波形、眼圖、抖動來衡量信號的質(zhì)量，Xilinx提供的
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基于SOPC的簡易誤碼率測試儀設計技術(shù)

  • 介紹一種利用Altera公司Cyclone II系列FPGA和第2代軟核處理器Nios II的誤碼率測試儀的設計方法。該測試儀能夠滿足通信速率在40～175 Mbps的通信線路的誤碼率測量及通信質(zhì)量評估的要求，具有體積小、功耗低、成本低、測量靈活和易于軟硬件升級、硬件可重構(gòu)等優(yōu)勢，有著很高的實用價值和參考價值。
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誤碼率測試儀介紹

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