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EEPW首頁(yè) >> 主題列表 >> 進(jìn)階

風(fēng)擋上的進(jìn)階革命：讓增強(qiáng)現(xiàn)實(shí)與HUD歡樂(lè)玩耍

  • HUD作為一個(gè)從戰(zhàn)斗機(jī)中移植過(guò)來(lái)的高大上的技術(shù)，現(xiàn)在還基本上只能在高端車型上看到。但是，看看前幾天車云菌介紹的路虎Vision概念車上將會(huì)搭載的HUD技
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VHDL設(shè)計(jì)進(jìn)階:邏輯綜合的原則以及可綜合的代碼設(shè)計(jì)風(fēng)格

  • 4.5.1 always塊語(yǔ)言指導(dǎo)原則使用always塊進(jìn)行可綜合的代碼設(shè)計(jì)時(shí)需要注意以下幾個(gè)問(wèn)題。(1)每個(gè)always塊只能有一個(gè)事件控制“@(event-expression)”，而且要緊跟在always關(guān)鍵字后面。(2)always塊可以表示
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Verilog HDL設(shè)計(jì)進(jìn)階：有限狀態(tài)機(jī)的設(shè)計(jì)原理及其代碼風(fēng)格

  • 由于Verilog HDL和 VHDL 行為描述用于綜合的歷史還只有短短的幾年，可綜合風(fēng)格的Verilog HDL 和VHDL的語(yǔ)法只是它們各自語(yǔ)言的一個(gè)子集。又由于HDL的可綜合性研究近年來(lái)非?；钴S，可綜合子集的國(guó)際標(biāo)準(zhǔn)目前尚未最后形
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可控硅電路進(jìn)階設(shè)計(jì)圓“五”曲

  • 　　今天咱們討論一個(gè)很神奇也很常用的元件--可控硅，首先自然是先普及下基礎(chǔ)知識(shí)，熟悉的童鞋請(qǐng)略過(guò)，直奔下面電路的盛宴。先行預(yù)告一下，五個(gè)電路設(shè)計(jì)，驚喜不斷，請(qǐng)大家HOLD住。 　　可控硅，是可控硅整流元件(Silicon Controlled Rectifier，SCR)的簡(jiǎn)稱，是一種具有三個(gè)PN結(jié)的四層結(jié)構(gòu)的大功率半導(dǎo)體器件，亦稱為晶閘管。具有體積小、結(jié)構(gòu)相對(duì)簡(jiǎn)單、功能強(qiáng)等特點(diǎn)，被廣泛用來(lái)作可控整流、逆變、變頻、調(diào)壓、無(wú)觸點(diǎn)開(kāi)關(guān)等。以上來(lái)自百度百科，良苦用心是讓大家知道這東西太重要了，搞電子的得會(huì)用。
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VHDL設(shè)計(jì)進(jìn)階:邏輯綜合的原則以及可綜合的代碼設(shè)計(jì)

  • 4.5.1 always塊語(yǔ)言指導(dǎo)原則使用always塊進(jìn)行可綜合的代碼設(shè)計(jì)時(shí)需要注意以下幾個(gè)問(wèn)題。(1)每個(gè)always塊只能有一個(gè)事件控制“@(event-expression)”，而且要緊跟在always關(guān)鍵字后面。(2)always塊可以表示
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Verilog HDL設(shè)計(jì)進(jìn)階：有限狀態(tài)機(jī)的設(shè)計(jì)原理及其代

  • 由于Verilog HDL和 VHDL 行為描述用于綜合的歷史還只有短短的幾年，可綜合風(fēng)格的Verilog HDL 和VHDL的語(yǔ)法只是它們各自語(yǔ)言的一個(gè)子集。又由于HDL的可綜合性研究近年來(lái)非常活躍，可綜合子集的國(guó)際標(biāo)準(zhǔn)目前尚未最后形
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架構(gòu)在虛擬層上的進(jìn)階應(yīng)用

  • 存儲(chǔ)虛擬化可看作一種打通存儲(chǔ)底層的基礎(chǔ)建設(shè)，通過(guò)虛擬化產(chǎn)品提供的邏輯層統(tǒng)合整個(gè)存儲(chǔ)環(huán)境，為前端服務(wù)器的存儲(chǔ)需求提供單一化服務(wù)。因此存儲(chǔ)虛擬化產(chǎn)品通常具備這幾個(gè)特性：異構(gòu)存儲(chǔ)設(shè)備整合不同廠牌、不同等級(jí)的
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IC設(shè)計(jì)工程師的高手進(jìn)階之路

  • 如何成為IC設(shè)計(jì)高手?如何提高自己的設(shè)計(jì)能力?自己的感受是，IC設(shè)計(jì)不同于一般的板級(jí)電子設(shè)計(jì)，由于流片的投資更 ...
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共8條 1/1 1

進(jìn)階介紹

您好，目前還沒(méi)有人創(chuàng)建詞條進(jìn)階!
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