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一種改進(jìn)Turbo碼譯碼器的FPGA設(shè)計(jì)與實(shí)現(xiàn)

  • 提出了一種基于MAX-Log-MAP算法的更有效減小譯碼延時(shí)的方法，通過并行計(jì)算前向狀態(tài)度量和后向狀態(tài)度量，將半次迭代譯碼延時(shí)縮短一半，而譯碼性能沒有損失，同時(shí)也減小了硬件實(shí)現(xiàn)中的時(shí)序控制復(fù)雜度。
  • 關(guān)鍵字： Turbo碼  迭代譯碼  FPGA  
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迭代譯碼介紹

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