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EEPW首頁 >> 主題列表 >> 邏輯分析儀

如何用內(nèi)部邏輯分析儀調(diào)試FPGA？

  • 1 推動FPGA調(diào)試技術(shù)改變的原因　　進行硬件設(shè)計的功能調(diào)試時，F(xiàn)PGA的再編程能力是關(guān)鍵的優(yōu)點。CPLD和FPGA早期使用時，如果發(fā)現(xiàn)設(shè)計不能正常工作，工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號引到引腳，然后用外部的邏輯分析儀捕獲數(shù)據(jù)。然而當(dāng)設(shè)計的復(fù)雜程度增加時，這個方法就不再適合了，其中有幾個原因。第一是由于FPGA的功能增加了，而器件的引腳數(shù)目卻緩慢地增長。因此，可用邏輯對I/O的比率減小了，參見圖1。此外，設(shè)計很復(fù)雜時，通常完成設(shè)計后只有幾個空余的引腳，或者根本就沒有空余的引腳能用
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探頭在邏輯分析儀中的作用

  • 市場上邏輯分析儀廠家眾多，大家在選擇邏輯分析儀時會關(guān)注存儲深度、采樣率、協(xié)議解碼等的對比，但往往容易忽略探頭的選擇，在這里跟大家好好分享下探
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如何巧用邏輯分析儀分析數(shù)字信號？

  • 　　時序和協(xié)議是數(shù)字系統(tǒng)調(diào)試的兩大關(guān)鍵點，也是邏輯分析儀最能發(fā)揮價值的地方。如何使用邏輯分析儀快速地完成接線配置并采集到數(shù)據(jù)呢?這里以IIC協(xié)議為例為大家實測演示。　　數(shù)字系統(tǒng)邏輯關(guān)系是通訊研發(fā)過程中的關(guān)鍵，它直接影響到整個設(shè)備系統(tǒng)能否正常工作。雖然示波器也能做部分數(shù)字信號分析，但受限于通道數(shù)(一般只有4個通道)和存儲深度(較小)。邏輯分析儀可以達到34通道，記錄深度最長可達2G，再配合數(shù)據(jù)壓縮算法，大大提高了工程師測試時序分析的效率?！　∠旅嬉訧IC為例，分享邏輯分析儀測試步驟。　　一、準備工作　　測試
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詳析數(shù)字I/O和邏輯分析儀常用術(shù)語

  • 詳析數(shù)字I/O和邏輯分析儀常用術(shù)語-本文介紹了數(shù)字I/O和邏輯分析儀的常用術(shù)語和定義。
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通過FPGA智能調(diào)試工具縮短驗證時間

  • 通過FPGA智能調(diào)試工具縮短驗證時間-設(shè)計人員選擇具有優(yōu)秀調(diào)試能力的FPGA器件，可以縮短開發(fā)周期并降低成本，同時顯著加快上市速度。
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什么是邏輯分析儀？邏輯分析儀的使用方法是什么？邏輯分析儀和示波器有什么區(qū)別

  • 什么是邏輯分析儀？邏輯分析儀的使用方法是什么？邏輯分析儀和示波器有什么區(qū)別-業(yè)邏輯分析儀，通常具有數(shù)量眾多的采樣通道，超快的采樣速度和大容量的存儲深度，但昂貴的價格也不是個人所能承受的。作為工程師手頭常備的開發(fā)工具，目前有許多入門級的邏輯分析儀設(shè)計，整體功能雖然不能和專業(yè)高檔儀器相比，但是用較低的成本來實現(xiàn)特定的功能，也是非常成功的設(shè)計。本文以下討論的邏輯分析儀，主要是指這類入門級設(shè)計。
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VGA的驅(qū)動顯示以及邏輯分析儀的使用

  • VGA的驅(qū)動顯示以及邏輯分析儀的使用-Zedboard的接口框圖如下： 掛在PL側(cè)的模塊有HDMI、VGA、OLED等，下面將詳細介紹在Zedboard上驅(qū)動VGA的過程，開發(fā)環(huán)境為Vivado 2016.2。
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802.11b中卷積碼和Viterbi譯碼的FPGA設(shè)計實現(xiàn)

  • 卷積碼是一種重要的信道糾錯編碼方式,其糾錯性能通常優(yōu)于分組碼,目前（2,1,6）卷積碼已廣泛應(yīng)用于無線通信系統(tǒng)中,Viterbi譯碼算法能最大限度地發(fā)揮卷積碼的糾錯性能。闡述了802.11b中卷積碼的編碼及其Viterbi譯碼方法,給出了編譯碼器的設(shè)計方法,并利用Verilog HDL硬件描述語言完成編譯碼器的FPGA實現(xiàn)。使用邏輯分析儀,在EP2C5T144C8芯片上完成了編譯碼器的硬件調(diào)試。
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FPGA系統(tǒng)調(diào)試問題及提高調(diào)試效率的方法

  • 本文就調(diào)試FPGA系統(tǒng)時遇到的問題及有助于提高調(diào)試效率的方法，針對Altera和Xilinx的FPGA調(diào)試提供了最新的方法和工具。
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利用FPGA的M4K作為移位寄存器的邏輯分析儀設(shè)計

  • 采用Altera公司的Cyclone系列EPlC3T144C8作為控制芯片，QuartusⅡ為軟件平臺，用硬件描速語言設(shè)計了一個具有變頻采樣時鐘和16路采樣通道，基于VGA顯示的邏輯分析僅．該設(shè)計方案利用FPGA內(nèi)部的M4K決作為移位寄存器不斷地進行讀進數(shù)據(jù)的方式，提高了工作速度、性能穩(wěn)定性以及分析的范圍和質(zhì)量。該邏輯分析儀實現(xiàn)簡單，價格低，具有較高的使用價值。
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基于FPGA的虛擬邏輯分析儀設(shè)計與實現(xiàn)

  • 闡述了一種基于FPGA的虛擬邏輯分析儀的設(shè)計，采用高性能的FPGA器件，再利用PC機的強大處理功能，配合LabVIEW圖形化語言開發(fā)實現(xiàn)。由于虛擬邏輯分析儀的部分硬件功能軟件化，使硬件電路大為簡化，提高了可靠性，同時降低了成本，具有一定的教學(xué)和科研價值。
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三態(tài)門總線傳輸電路的Multisim仿真方案

  • 基于探索仿真三態(tài)門總線傳輸電路的目的，采用Multisim10仿真軟件對總線連接的三態(tài)門分時輪流工作時的波形進行了仿真實驗測試，給出了仿真實驗方案，即用Multisim仿真軟件構(gòu)成環(huán)形計數(shù)器產(chǎn)生各個三態(tài)門的控制信號、用脈沖信號源產(chǎn)生各個三態(tài)門不同輸入數(shù)據(jù)信號，用Multisim仿真軟件中的邏輯分析儀多蹤同步顯示各個三態(tài)門的控制信號、數(shù)據(jù)輸入信號及總線輸出信號波形，結(jié)論是仿真實驗可直觀形象地描述三態(tài)門總線傳輸電路的工作特性，所述方法的創(chuàng)新點是解決了三態(tài)門的工作波形無法用電子實驗儀器進行分析驗證的問題。
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便攜式邏輯分析儀的設(shè)計與實現(xiàn)

  • 摘要 介紹一種16通道便攜式邏輯分析儀，通過FPGA將高速數(shù)據(jù)采樣并緩存，采用USB控制芯片和FPCA協(xié)同控制將數(shù)據(jù)通過USB接口發(fā)送到電腦的上位機上顯示，簡化了以往邏輯分析儀硬件電路部分，降低了邏輯分析儀的成本且便
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容易被忽略的邏輯分析儀探頭

  • 　　市場上邏輯分析儀廠家眾多，大家在選擇邏輯分析儀時會關(guān)注存儲深度、采樣率、協(xié)議解碼等的對比，但往往容易忽略探頭的選擇，在這里跟大家好好分享下探頭在邏輯分析儀中起著什么重要作用?！　∵壿嫹治鰞x一般由四部分組成，探頭，信號處理，數(shù)據(jù)采集，數(shù)據(jù)顯示。如圖 1所示:　　    　　圖 1 便攜式邏輯分析儀的硬件結(jié)構(gòu)　　探頭的選擇是測量信號的第一個環(huán)節(jié)。使用一個不合適的或者不良的探頭則會影響測量結(jié)果。因此要確保探頭對被測回路的影響最小?！　∮脩粼谶x擇以
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邏輯分析儀介紹

邏輯分析儀目錄 邏輯分析儀的定義 邏輯分析儀的主要特點 邏輯分析儀分類 邏輯分析儀的工作原理 邏輯分析儀的顯示形式 邏輯分析儀的功能 邏輯分析儀的主要技術(shù)指標 邏輯分析儀的定義 　　邏輯分析儀是利用時鐘從測試設(shè)備上采集和顯示數(shù)字信號的儀器，最主要作用在于時序判定。由于邏輯分析儀不像示波器那樣有許多電壓等級，通常只顯示兩個電壓（邏輯1和0），因此設(shè)定了參考電壓后，邏 [ 查看詳細 ]

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