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EEPW首頁 >> 主題列表 >> 高速實時數

基于FPGA的高速實時數據采集系統(tǒng)設計

  • 摘要：設計的基于FPGA的高速實時數據采集系統(tǒng)，可控制6路模擬信號的采集和處理，F(xiàn)PGA中的6個FIFO對數據進行緩存，數據總線傳給DSP進行實時處理和上傳給上位機顯示。程序部分是用Verilog HDL語言，并利用QuartusⅡ等E
  • 關鍵字： FPGA  高速實時數  采集系統(tǒng)    

基于TLV1562的四通道高速實時數據采集系統(tǒng)的設計

  • 本文提出了一種基于TLV1562的四通道實時數據采集處理系統(tǒng)的設計與實現(xiàn)方案，該設計以TLV1562、EP1K100和AD7533(四片)為核心器件，具有四個獨立的A／D，D／A通道，能實現(xiàn)10位數據采集與回放；該系統(tǒng)應用到雷達實時自適應噪聲對消器中，結果表明，該系統(tǒng)能夠滿足實時雷達信號對消處理要求，效果較好。

  • 關鍵字： 1562  TLV  四通道  高速實時數    

一種高速實時數字波束形成器的設計

  • 在數字波束形成系統(tǒng)(DBF)中，高速數據傳輸和數字波束形成均需保證其實時性，因而它一直以來都是DBF系統(tǒng)的關鍵技術。在此詳細闡述采用低壓差分信號(LVDS)技術解決DBF、系統(tǒng)高速數據傳輸問題，LVDS與普通的并行數據總線相比，既能確保數據傳輸速率，又降低了總線的互連復雜度；同時選擇高性能FPGA芯片，既完成多通道高速數據的復加權求和運算，又實現(xiàn)了全陣的實時數字波束形成運算。
  • 關鍵字： 高速實時數  波束形成器    
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高速實時數介紹

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