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FPGA板級(jí)測(cè)試若干方法小結(jié)

  • 1）有關(guān)時(shí)序問(wèn)題學(xué)習(xí)過(guò)FPGA的都知道，F(xiàn)PGA可以接受的時(shí)鐘和所允許的時(shí)序遠(yuǎn)遠(yuǎn)低于ASIC。這是由于ASIC時(shí)鐘樹(shù)與布線相對(duì)自由，故對(duì)于高速率設(shè)
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fpga板級(jí)測(cè)介紹

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