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基于FPGA的通用位同步器設(shè)計(jì)方案

  • 基于FPGA的通用位同步器設(shè)計(jì)方案-摘要本文提出了一種基于FPGA的通用位同步器設(shè)計(jì)方案。方案中的同步器是采用改進(jìn)后的Gardner算法結(jié)構(gòu)，其中，內(nèi)插濾波器采用系數(shù)實(shí)時(shí)計(jì)算的Farrow結(jié)構(gòu)，定時(shí)誤差檢測(cè)采用獨(dú)立于載波相位偏差的GA-TED算法，內(nèi)部控制器和環(huán)路濾波器的參數(shù)可由外部控制器設(shè)置，因而可以適應(yīng)較寬速率范圍內(nèi)的基帶碼元。
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gardner算法介紹

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