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EEPW首頁 >> 主題列表 >> arm+fpga

底層內(nèi)嵌功能單元與軟核、硬核以及固核

  • 底層內(nèi)嵌功能單元與軟核、硬核以及固核-內(nèi)嵌功能模塊主要指DLL(Delay Locked Loop)、PLL(Phase Locked Loop)、DSP 等軟處理核(Soft Core)?，F(xiàn)在越來越豐富的內(nèi)嵌功能單元，使得單片F(xiàn)PGA 成為了系統(tǒng)級的設(shè)計工具，使其具備了軟硬件聯(lián)合設(shè)計的能力，逐步向SOC 平臺過渡。
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數(shù)字時鐘管理模塊與嵌入式塊RAM

  • 數(shù)字時鐘管理模塊與嵌入式塊RAM-業(yè)內(nèi)大多數(shù)FPGA 均提供數(shù)字時鐘管理( 賽靈思公司的全部FPGA 均具有這種特性)。賽靈思公司推出最先進(jìn)的FPGA 提供數(shù)字時鐘管理和相位環(huán)路鎖定。相位環(huán)路鎖定能夠提供精確的時鐘綜合，且能夠降低抖動，并實現(xiàn)過濾功能。
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FPGA主要功能模塊介紹(1)

  • FPGA主要功能模塊介紹(1)-可編程輸入/ 輸出單元簡稱I/O 單元，是芯片與外界電路的接口部分，完成不同電氣特性下對輸入/ 輸出信號的驅(qū)動與匹配要求，其示意結(jié)構(gòu)如圖2-4 所示。FPGA 內(nèi)的I/O 按組分類，每組都能夠獨(dú)立地支持不同的I/O標(biāo)準(zhǔn)。
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Verilog HDL簡明教程(part1)

  • Verilog HDL簡明教程(part1)-Verilog HDL是一種硬件描述語言，用于從算法級、門級到開關(guān)級的多種抽象設(shè)計層次的數(shù)字系統(tǒng)建模。被建模的數(shù)字系統(tǒng)對象的復(fù)雜性可以介于簡單的門和完整的電子數(shù)字系統(tǒng)之間。數(shù)字系統(tǒng)能夠按層次描述，并可在相同描述中顯式地進(jìn)行時序建模。
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FPGA基本知識與發(fā)展趨勢（part2）

  • FPGA基本知識與發(fā)展趨勢（part2）-由于基于LUT 的FPGA 具有很高的集成度，其器件密度從數(shù)萬門到數(shù)千萬門不等，可以完成極其復(fù)雜的時序與邏輯組合邏輯電路功能，所以適用于高速、高密度的高端數(shù)字邏輯電路設(shè)計領(lǐng)域。
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FPGA實戰(zhàn)開發(fā)技巧（10）

  • FPGA實戰(zhàn)開發(fā)技巧（10）-串行Flash的特點是占用管腳比較少，作為系統(tǒng)的數(shù)據(jù)存貯非常合適，一般都是采用串行外設(shè)接口(SPI 總線接口)。Flash 存貯器與EEPROM根本不同的特征就是EEPROM可以按字節(jié)進(jìn)行數(shù)據(jù)的改寫，而Flash只能先擦除一個區(qū)間，然后改寫其內(nèi)容。
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FPGA實戰(zhàn)開發(fā)技巧（9）

  • FPGA實戰(zhàn)開發(fā)技巧（9）-FPGA配置方式靈活多樣，根據(jù)芯片是否能夠自己主動加載配置數(shù)據(jù)分為主模式、從模式以及JTAG模式。典型的主模式都是加載片外非易失( 斷電不丟數(shù)據(jù)) 性存儲器中的配置比特流，配置所需的時鐘信號( 稱為CCLK) 由FPGA內(nèi)部產(chǎn)生，且FPGA控制整個配置過程
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FPGA實戰(zhàn)開發(fā)技巧（8）

  • FPGA實戰(zhàn)開發(fā)技巧（8）-FPGA 設(shè)計的時序性能是由物理器件、用戶代碼設(shè)計以及EDA 軟件共同決定的，忽略了任何一方面的因素，都會對時序性能有很大的影響。本節(jié)主要給出大規(guī)模設(shè)計中，賽靈思物理器件和EDA 軟件的最優(yōu)使用方案。
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什么是FPGA，ASIC，如何設(shè)計一個適用于它們的供電系統(tǒng)

  • 什么是FPGA，ASIC，如何設(shè)計一個適用于它們的供電系統(tǒng)-目前，在集成電路界ASIC被認(rèn)為是一種為專門目的而設(shè)計的集成電路。是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計、制造的集成電路。ASIC的特點是面向特定用戶的需求，ASIC在批量生產(chǎn)時與通用集成電路相比具有體積更小、功耗更低、可靠性提高、性能提高、保密性增強(qiáng)、成本降低等優(yōu)點
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PCB電路板設(shè)計必看常識！單層FPC/雙面FPC/多層FPC有何區(qū)別，自學(xué)材料

  • PCB電路板設(shè)計必看常識！單層FPC/雙面FPC/多層FPC有何區(qū)別，自學(xué)材料-雖然電路板廠的工程師不參與設(shè)計電路板，而是由客戶出原始設(shè)計資料再制成公司內(nèi)部的PCB電路板制作資料，但通過多年的實踐經(jīng)驗，工程師們對PCB電路板的設(shè)計早已有所積累，總結(jié)如下僅供參考：
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基于ARM的智能測溫系統(tǒng)經(jīng)典案例

  • 基于ARM的智能測溫系統(tǒng)經(jīng)典案例-本文智能測溫系統(tǒng)基于物聯(lián)網(wǎng)技術(shù)與嵌入式技術(shù)實現(xiàn) 遠(yuǎn)程無線可移動的視頻監(jiān)控系統(tǒng)，依托于FS_S5PC100開發(fā) 平臺用三星公司先進(jìn)的基于Cortex-A8 內(nèi)核的 S5PC100處理 器和無線網(wǎng)卡WI-FI作為硬件載體，綜合應(yīng)用WLAN、嵌入 式Linux和JSP技術(shù)等技術(shù)，以程序軟件的通用性和易用性為 方向，實現(xiàn)無線視頻和智能測溫系統(tǒng)控制以及環(huán)境信息采集。
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嵌入式系統(tǒng)的遠(yuǎn)程更新該如何進(jìn)行？常見的嵌入式操作系統(tǒng)有哪些？

  • 嵌入式系統(tǒng)的遠(yuǎn)程更新該如何進(jìn)行？常見的嵌入式操作系統(tǒng)有哪些？-Linux 一開始是基于Intel 386 機(jī)器而設(shè)計，但是隨著網(wǎng)絡(luò)的散布，各式各樣的需求涌現(xiàn)，因此就有許多工程師致力于各式平臺的移植，造成了 Linux 可以在 x86、MIPS、ARM/StrongARM、PowerPC、Motorola 68k、Hitachi SH3/SH4、 Transmeta.。等等平臺上運(yùn)作的盛況。這些平臺幾乎涵蓋了所有嵌入式系統(tǒng)所需的 CPU，因此選擇 Linux 就可以把更多的硬件平臺納入考量的范圍。
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C語言編程程序優(yōu)化方案，如何選擇一個ARM品牌核心處理器操作系統(tǒng)

  • C語言編程程序優(yōu)化方案，如何選擇一個ARM品牌核心處理器操作系統(tǒng)-當(dāng)對一個變量頻繁被讀寫時，需要反復(fù)訪問內(nèi)存，從而花費(fèi)大量的存取時間。為此，C語言提供了一種變量，即寄存器變量。這種變量存放在CPU的寄存器中，使用時，不需要訪問內(nèi)存，而直接從寄存器中讀寫，從而提高效率。寄存器變量的說明符是register。對于循環(huán)次數(shù)較多的循環(huán)控制變量及循環(huán)體內(nèi)反復(fù)使用的變量均可定義為寄存器變量，而循環(huán)計數(shù)是應(yīng)用寄存器變量的最好候選者。
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嵌入式技術(shù)優(yōu)缺點分析，嵌入式入門學(xué)習(xí)方法

  • 嵌入式技術(shù)優(yōu)缺點分析，嵌入式入門學(xué)習(xí)方法-搞企業(yè)應(yīng)用軟件的IT企業(yè)，這個用戶的系統(tǒng)搞完了，又得去搞下一個用戶的，而且每個用戶的需求和完成時間都得按客戶要求改變，往往疲于奔命，重復(fù)勞動。相比而言，搞嵌入式系統(tǒng)的公司，都有自己的產(chǎn)品計劃，按自己的節(jié)奏行事。所開發(fā)的產(chǎn)品通常是通用的，不會因客戶的不同而修改。一個產(chǎn)品型號開發(fā)完了，往往有較長一段空閑時間（或只是對軟件進(jìn)行一些小修補(bǔ)），有時間進(jìn)行充電和休整。
  • 關(guān)鍵字： 單片機(jī)  arm  win  

FPGA技術(shù)協(xié)助嵌入式系統(tǒng)競逐于機(jī)器學(xué)習(xí)之路

  • FPGA技術(shù)協(xié)助嵌入式系統(tǒng)競逐于機(jī)器學(xué)習(xí)之路-機(jī)器學(xué)習(xí)技術(shù)是人工智能的一個重要科學(xué)發(fā)展，透過在經(jīng)驗學(xué)習(xí)中改善具體算法的效能，而且用來訓(xùn)練的數(shù)據(jù)越多，所學(xué)習(xí)出來的結(jié)果越好，為了處理分析大量圖像或是語音等辨識的機(jī)器學(xué)習(xí)算法數(shù)據(jù)，需要采用GPU芯片所打造的高速平行運(yùn)算處理的類神經(jīng)網(wǎng)絡(luò)超級計算機(jī)，利用諸如Tensorflow、Caffe等深度學(xué)習(xí)框架(Framework)等工具，來發(fā)展有效的算法。
  • 關(guān)鍵字： FPGA  嵌入式  人工智能  
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