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CoolRunner-II CPLD實(shí)現(xiàn)GPS系統(tǒng)

  • CoolRunner-II CPLD實(shí)現(xiàn)GPS系統(tǒng),GPS已在汽車、移動(dòng)電話、PDA甚至手表等越來(lái)越多的產(chǎn)品中出現(xiàn)。　　產(chǎn)品的成功取決于差異化和專業(yè)化。Xilinx公司的CoolRunner-II CPLD是增加產(chǎn)品功能或與其它器件連接的理想芯片，能使GPS產(chǎn)品在不超出功耗預(yù)算的情況下
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基于FPGA的LED體三維顯示設(shè)計(jì)方案

  • 引　言　　眾所周知， 視覺(jué)是人類感知世界的最重要的方式， 而現(xiàn)實(shí)生活中的所有物質(zhì)形態(tài)都是以三維空間而客觀存在。三維顯示能真正地再現(xiàn)客觀世界的立體空間， 提供更符合人們觀察習(xí)慣的交流方式， 有助于人們?cè)诰C合
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基于CPLD的DDS正弦信號(hào)發(fā)生器的設(shè)計(jì)簡(jiǎn)介

  • 這幾天終于實(shí)現(xiàn)了DDS正弦信號(hào)的發(fā)生，限于CPLD的128宏單元不夠用也不知道怎么優(yōu)化，后來(lái)就干脆把按鍵、頻率顯示、頻率控制字交給單片機(jī)控制產(chǎn)生，再由單片機(jī)講頻率控制字傳送給CPLD，這樣就實(shí)現(xiàn)了頻率的控制。最終產(chǎn)
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基于FPGA的WALLACE TREE乘法器設(shè)計(jì)

  • 摘要：為了使基于FPGA設(shè)計(jì)的信號(hào)處理系統(tǒng)具有更高運(yùn)行速度和具有更優(yōu)化的電路版圖布局布線，提出了一種適用于FPGA結(jié)構(gòu)的改進(jìn)型WALLACE TREE架構(gòu)乘法器。首先討論了基于標(biāo)準(zhǔn)單元3：2壓縮器的改進(jìn)型6：4壓縮器，根據(jù)FP
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一種新的基于FPGA的數(shù)據(jù)格式轉(zhuǎn)換方法

  • 摘要：針對(duì)目前多數(shù)的FPGA都支持浮點(diǎn)IP核，卻較少關(guān)注數(shù)據(jù)源獲取的問(wèn)題，提出了一種數(shù)據(jù)格式轉(zhuǎn)換方法。使用VHDL語(yǔ)言，采用流水線處理方式將ASCII碼所表示的一定范圍內(nèi)的實(shí)數(shù)轉(zhuǎn)換為單精度浮點(diǎn)數(shù)。經(jīng)過(guò)ModelSim功能仿真
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基于51單片機(jī)和FPGA的人機(jī)交互系統(tǒng)的設(shè)計(jì)

  • 摘要：在儀器儀表電路中，人機(jī)交互界面是必不可少的環(huán)節(jié)。為了解決單純采用單片機(jī)制作的系統(tǒng)功耗高、速度慢、電 ...
  • 關(guān)鍵字： 人機(jī)交互  C805lF  T6963C  FPGA  鍵盤掃描  

基于51單片機(jī)和CPLD的數(shù)字頻率計(jì)的設(shè)計(jì)

  • 引言在傳統(tǒng)的控制系統(tǒng)中，通常將單片機(jī)作為控制核心并輔以相應(yīng)的元器件構(gòu)成一個(gè)整體。但這種方法硬件連線復(fù)雜 ...
  • 關(guān)鍵字： 51單片機(jī)  CPLD  數(shù)字頻率計(jì)  

LATTICE和Valens半導(dǎo)體公司發(fā)布適用于監(jiān)控?cái)z像機(jī)市場(chǎng)的新的參考設(shè)計(jì)

  • 萊迪思半導(dǎo)體公司（NASDAQ:LSCC）和Valens半導(dǎo)體今日發(fā)布一款新的全面的HDBaseT?攝像機(jī)參考設(shè)計(jì)解決方案。HDB...
  • 關(guān)鍵字： 監(jiān)控  HDBaseT  FPGA  攝像機(jī)  

基于FPGA與ARM的遙測(cè)數(shù)據(jù)網(wǎng)絡(luò)化采集

  • 摘要：現(xiàn)有的遙測(cè)接收機(jī)為PCI接口，需安裝在工控機(jī)上使用，為實(shí)現(xiàn)設(shè)備小型化、便攜化，設(shè)計(jì)實(shí)現(xiàn)了小型網(wǎng)絡(luò)接口遙測(cè)解調(diào)模塊，可配合帶有網(wǎng)口的計(jì)算機(jī)使用。采用FPGA進(jìn)行遙測(cè)數(shù)據(jù)的幀同步與IRIG—B時(shí)碼解調(diào)，將接
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Xilinx FPGA的Fast Startup

  • 在眾多當(dāng)代應(yīng)用中，嵌入式系統(tǒng)必須滿足極其苛刻的時(shí)序要求。其中之一就是啟動(dòng)時(shí)間——即上電后電子系統(tǒng)進(jìn)入可操作狀態(tài)所需要的時(shí)間。PCI Express產(chǎn)品或汽車應(yīng)用中基于CAN的電子控制單元(ECU)就是具有嚴(yán)格時(shí)序要求的電子系統(tǒng)的應(yīng)用實(shí)例。
  • 關(guān)鍵字： 賽靈思  Xilinx  FPGA  

基于FPGA的卷積碼編譯碼器

  • 摘要：基于卷積碼的編譯碼原理，使用VHDL語(yǔ)言和FPGA芯片設(shè)計(jì)并實(shí)現(xiàn)了(2，1，3)卷積碼編譯碼器。其中譯碼器設(shè)計(jì)采用“截尾”的Vite-rbi譯碼算法，在支路量度計(jì)算、路徑量度和譯碼路徑的更新與存儲(chǔ)以及判決與
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基于FPGA的可鍵盤控制計(jì)數(shù)電路的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：介紹一種基于FPGA(Field Programmable Gate Array)現(xiàn)場(chǎng)可編程門陣列的可鍵盤控制的計(jì)數(shù)，顯示電路的實(shí)現(xiàn)方法。應(yīng)用VHDL語(yǔ)言(高速集成電路硬件描述語(yǔ)言)完成了3x4矩陣開關(guān)的掃描電路，可預(yù)置數(shù)的BCD碼計(jì)數(shù)電路及
  • 關(guān)鍵字： FPGA  鍵盤控制  計(jì)數(shù)電路    

使用賽靈思FPGA實(shí)現(xiàn)位與周期準(zhǔn)確的浮點(diǎn)DSP算法

關(guān)于FPGA的跳頻通信頻率合成器設(shè)計(jì)

  • 0引言隨著國(guó)民經(jīng)濟(jì)的快速發(fā)展和人們生活水平的不斷提高，人們對(duì)居住房子的舒適性及安全性要求也提升到了更高...
  • 關(guān)鍵字： 跳頻通信  頻率合成器  FPGA  

65nm Virtex-5 FPGA工藝

  • 半導(dǎo)體工業(yè)的最主要特征是工藝不斷進(jìn)步，平均每隔幾年就要升級(jí)一次，帶動(dòng)功耗和成本不斷下降，性能不斷提升。從18 ...
  • 關(guān)鍵字： Virtex-5  FPGA  
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