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一種基于CPLD的數(shù)據(jù)采集控制板的設(shè)計(jì)

  • 針對(duì)多種采集信號(hào)類型,設(shè)計(jì)了一種采用CPLD實(shí)現(xiàn)信號(hào)采集控制、信號(hào)處理、通訊及輸出控制等功能的復(fù)合數(shù)據(jù)采集控制板,并分析了其相關(guān)應(yīng)用性能。
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基于CPLD的異步串行收發(fā)器設(shè)計(jì)

  • 介紹了基于CPLD的異步串行收發(fā)器的設(shè)計(jì)方案,著重?cái)⑹隽擞没旌陷斎耄òㄔ韴D和VHDL)實(shí)現(xiàn)該設(shè)計(jì)的思想,闡述了在系統(tǒng)可編程(ISP)開發(fā)軟件的應(yīng)用方法與設(shè)計(jì)流程,并給出了VHDL源文件和仿真波形。
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基于DDS的多功能中頻信號(hào)源的設(shè)計(jì)及其在雷達(dá)系統(tǒng)中的應(yīng)用

  • 摘    要:本文介紹了一種基于DDS 技術(shù)的中頻信號(hào)源通用板的設(shè)計(jì),詳細(xì)論述了該中頻信號(hào)板在某雷達(dá)系統(tǒng)中的應(yīng)用,它可以應(yīng)用于雷達(dá)模擬器和雷達(dá)干擾機(jī)模擬器中,信號(hào)的各項(xiàng)指標(biāo)均能滿足系統(tǒng)的要求。關(guān)鍵詞:DDS;CPLD;正交調(diào)制;正交檢波;衰減 引言DDS在相對(duì)帶寬、頻率轉(zhuǎn)換時(shí)間、相位連續(xù)性、正交輸出、高分辨力以及集成化等方面都遠(yuǎn)遠(yuǎn)超過了傳統(tǒng)頻率合成技術(shù)所能達(dá)到的水平,為系統(tǒng)提供了優(yōu)于模擬信號(hào)源的性能。利用DDS技術(shù)可以很方便地實(shí)現(xiàn)多種信號(hào)。本設(shè)計(jì)的核心部分正是基于DDS技術(shù)
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CPLD在合成孔徑雷達(dá)目標(biāo)模擬視頻板設(shè)計(jì)中的應(yīng)用

  • 摘  要:本文介紹了一種合成孔徑雷達(dá)目標(biāo)模擬視頻板卡的設(shè)計(jì)實(shí)例,它采用Altera公司的EMP7128S及MAX+PLUS-II 開發(fā)系統(tǒng)實(shí)現(xiàn)。由于采用該器件,簡(jiǎn)化了電路設(shè)計(jì),減小了設(shè)備體積,同時(shí)也使設(shè)備的可靠性和設(shè)計(jì)的靈活性大大提高。關(guān)鍵詞:合成孔徑雷達(dá);FPGA/CPLD;PCI接口;乒乓結(jié)構(gòu)引言合成孔徑雷達(dá)(Synthetic Aperture Radar,簡(jiǎn)稱SAR)是以合成孔徑原理和脈沖壓縮技術(shù)為理論基礎(chǔ),以高速數(shù)字處理和精確運(yùn)動(dòng)補(bǔ)償為前提條件的高分辨率成像雷達(dá)。對(duì)于合成孔徑雷達(dá)成像處
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基于PCI/CPCI總線的嵌入式實(shí)時(shí)智能通信系統(tǒng)

  • 摘    要:本文描述了一種基于PCI/CPCI總線的嵌入式實(shí)時(shí)智能通訊設(shè)備的設(shè)計(jì)及實(shí)現(xiàn),充分利用了PCI總線的高效能和嵌入式通訊控制器的強(qiáng)大功能,設(shè)計(jì)出了一種高速的智能通信設(shè)備。關(guān)鍵詞:嵌入式微控制器;CPLD;智能通信模塊;PCI目標(biāo)設(shè)備接口芯片;PCI/CPCI總線 引言在計(jì)算機(jī)通信領(lǐng)域,串口被廣泛運(yùn)用。在某些特殊的應(yīng)用領(lǐng)域,將會(huì)用到特殊的串口通信進(jìn)行數(shù)據(jù)通信和報(bào)文交換。本設(shè)計(jì)就是針對(duì)一些特殊用途的應(yīng)用,即一些高速系統(tǒng)串口傳輸方式的設(shè)計(jì)。 嵌入式智能通信系統(tǒng)的實(shí)時(shí)性
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ADSP-21062與工控機(jī)數(shù)據(jù)交換電路設(shè)計(jì)

  • 摘    要:本文根據(jù)系統(tǒng)需要,在信號(hào)處理機(jī)和工控機(jī)之間使用雙口SRAM,利用ADSP-21062的可編程FLAG引腳控制雙口SRAM的左右端口高位地址,設(shè)計(jì)了高速數(shù)據(jù)交換電路。關(guān)鍵詞:PC104;雙口SRAM;數(shù)據(jù)交換;CPLD ADSP-21062是ADI公司的通用DSP芯片,它具有強(qiáng)大的浮點(diǎn)/定點(diǎn)數(shù)據(jù)運(yùn)算能力和很高的處理速度。多片ADSP-21062可以以多種形式方便地聯(lián)結(jié)成并行處理器系統(tǒng),適合進(jìn)行實(shí)時(shí)數(shù)據(jù)采集和處理。本文利用多片ADSP-21062設(shè)計(jì)了連續(xù)波雷達(dá)信
  • 關(guān)鍵字: CPLD  PC104  數(shù)據(jù)交換  雙口SRAM  存儲(chǔ)器  

基于PCI總線的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)

  • 摘    要:本文介紹了一種基于PCI總線的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)方法,主要討論了高速數(shù)據(jù)采集的存儲(chǔ)與傳輸?shù)挠布鉀Q方案,以及該系統(tǒng)的控制邏輯的實(shí)現(xiàn),最后給出了控制邏輯仿真波形。關(guān)鍵詞:PCI總線;CPCI總線;高速實(shí)時(shí)數(shù)據(jù)采集;FIFO;CPLD 引言目前的大多數(shù)雷達(dá)信號(hào)處理機(jī)都是采用自定義總線,不具有通用性,每進(jìn)行一些系統(tǒng)功能的改變就需要大量的硬件改動(dòng)。而CPCI總線作為一種新興的工業(yè)總線,其采用了PCI總線的電氣特性以及VME總線的物理特性,兼具了二者的優(yōu)點(diǎn)
  • 關(guān)鍵字: CPCI總線  CPLD  FIFO  PCI總線  高速實(shí)時(shí)數(shù)據(jù)采集  

基于CPLD的高速超聲車距報(bào)警器設(shè)計(jì)

  • 摘要:本文給出了一個(gè)基于CPLD高速超聲車距報(bào)警器系統(tǒng)設(shè)計(jì)。關(guān)鍵詞:車距報(bào)警器;CPLD;雙口RAM 引言    為減少汽車碰撞事故的發(fā)生,汽車碰撞技術(shù)在近年發(fā)展很快。汽車避撞技術(shù)首先需要解決的問題是汽車之間的安全距離,當(dāng)汽車與汽車之間的距離小于安全距離時(shí),就應(yīng)該能夠自動(dòng)報(bào)警。本文給出了高速防撞器的核心部分:車距報(bào)警器的設(shè)計(jì)方法。筆者設(shè)計(jì)了一款安裝于車前/車尾的便攜式系統(tǒng),能在汽車停車、倒車以及行使過程中自動(dòng)監(jiān)控汽車與其它汽車、人和障礙物之間的距離,如果距離小于規(guī)定的安全距離
  • 關(guān)鍵字: CPLD  

基于雙DSP的磁軸承數(shù)字控制器容錯(cuò)設(shè)計(jì)

  • 摘    要:本文介紹了應(yīng)用于磁軸承的雙DSP熱備容錯(cuò)控制方案,該方案采用時(shí)鐘同步技術(shù),由總線表決模塊實(shí)現(xiàn)系統(tǒng)的容錯(cuò)處理,硬件判決模塊實(shí)現(xiàn)硬件故障判斷。由中心仲裁模塊根據(jù)兩判決模塊的結(jié)果進(jìn)行復(fù)雜的仲裁,并完成切換和完善的報(bào)警邏輯,從而提高了磁軸承控制系統(tǒng)的可靠性。關(guān)鍵詞:容錯(cuò);磁軸承; 控制器; CPLD; DSP引言電磁軸承(AMB)是利用可控電磁吸力將轉(zhuǎn)子懸浮起來的一種新型高性能軸承,具有無接觸、無摩擦、高速度、高精度、不需潤(rùn)滑和密封等一系列特點(diǎn),在交通、超高速超精密加工
  • 關(guān)鍵字: CPLD  DSP  磁軸承  控制器  容錯(cuò)  

基于PCI總線的實(shí)時(shí)DVB碼流接收系統(tǒng)的硬件設(shè)計(jì)

  • 摘    要:本文介紹了基于PCI專用芯片PCI9054和CPLD的DVB碼流接收系統(tǒng)的硬件設(shè)計(jì)。該設(shè)計(jì)采用了PCI9054+CPLD的數(shù)字處理方案,并采用一種新的方法更高效地利用雙端口RAM,保證了高速、大容量數(shù)據(jù)流的實(shí)時(shí)處理。關(guān)鍵詞:DVB;PCI;CPLD;雙端口RAM;WDM模式  前言通過PC接收DVB(數(shù)字視頻廣播)碼流已成為一項(xiàng)新的多媒體數(shù)據(jù)接收技術(shù)。因此,設(shè)計(jì)基于PC平臺(tái)的DVB碼流接收卡,是數(shù)字廣播電視發(fā)展的需要。由于DVB傳輸流的平均傳輸速率為6
  • 關(guān)鍵字: CPLD  DVB  PCI  WDM模式  雙端口RAM  存儲(chǔ)器  

用CPLD實(shí)現(xiàn)Gollmann密鑰流發(fā)生器

  • 摘    要:本文根據(jù)Gollmann密鑰流發(fā)生器的原理和偽隨機(jī)序列產(chǎn)生的程序,利用VHDL語言和CPLD,設(shè)計(jì)出Gollmann密鑰流發(fā)生器。該發(fā)生器滿足一般的加密要求,可以保護(hù)信息傳輸?shù)陌踩?。關(guān)鍵詞:Gollmann ;VHDL ;CPLD;偽隨機(jī)序列引言對(duì)通信數(shù)據(jù)進(jìn)行加密的方法可分為兩大類:軟加密和硬加密。其中硬加密具有加密強(qiáng)度大、可靠性高等特點(diǎn)。本文根據(jù)流密碼發(fā)生器原理,用CPLD設(shè)計(jì)出了Gollmann流密碼發(fā)生器。原理密碼安全的偽隨機(jī)序列發(fā)生器用于流密碼時(shí)十分理想
  • 關(guān)鍵字: CPLD  Gollmann  VHDL  偽隨機(jī)序列  

CPLD器件的在系統(tǒng)動(dòng)態(tài)配置

  • 介紹一種利用微控制器動(dòng)態(tài)配置CPLD器件的方法。將配置文件存放在存儲(chǔ)器中,配置文件中的控制代碼驅(qū)動(dòng)在微處理器中運(yùn)行的配置引擎;將配置文件中的配置信息通過JTAG口移入CPLD,實(shí)現(xiàn)器件的動(dòng)態(tài)配置
  • 關(guān)鍵字: CPLD  器件  動(dòng)態(tài)配置  系統(tǒng)    

低壓CPLD EPM7512A的混合電壓系統(tǒng)設(shè)計(jì)

  • 較詳細(xì)地闡述不同邏輯電平的接口原理。以低壓CPLD EPM7512A為例,給出在混合電壓系統(tǒng)中的具體設(shè)計(jì)方案。
  • 關(guān)鍵字: 7512A  CPLD  7512  EPM    

基于CPLD的三相多波形函數(shù)發(fā)生器設(shè)計(jì)

  • 介紹了基于可編程邏輯器件CPLD和直接數(shù)字頻率合成技術(shù)(DDS)的三相多波形函數(shù)發(fā)生器的基本原理,并在此基礎(chǔ)上給出了基于CPLD的各模塊設(shè)計(jì)方法及其VHDL源程序。
  • 關(guān)鍵字: CPLD  三相  多波形  函數(shù)發(fā)生器    

CPLD在遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

  • 采用VHDL語言和圖形輸入設(shè)計(jì)方法,給出了用CPLD在遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)中實(shí)現(xiàn)地址譯碼、串口擴(kuò)展、模塊測(cè)試、模數(shù)轉(zhuǎn)換以及高位數(shù)據(jù)處理等功能的具體方法,同時(shí)簡(jiǎn)要介紹了遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)的工作原理及軟、硬件框架。
  • 關(guān)鍵字: CPLD  遠(yuǎn)程  多路數(shù)據(jù)采集  系統(tǒng)    
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