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EEPW首頁 >> 主題列表 >> dds-11a型實(shí)驗(yàn)室電導(dǎo)率

dds-11a型實(shí)驗(yàn)室電導(dǎo)率 文章 進(jìn)入dds-11a型實(shí)驗(yàn)室電導(dǎo)率技術(shù)社區(qū)

先進(jìn)的DDS技術(shù)讓任意波形發(fā)生器實(shí)現(xiàn)“繪畫”功能

  • 1971年3月，美國學(xué)者J.Tierncy，C.M.Rader和B.Gold最先提出直接數(shù)字合成技術(shù)（DirectDigitalSynthesis），簡稱D...
  • 關(guān)鍵字： DDS  任意波形發(fā)生器  頻率合成  

簡述DDS原理及其基于FPGA的實(shí)現(xiàn)

  • DDS同 DSP（數(shù)字信號(hào)處理）一樣，是一項(xiàng)關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器（Direct Digital Synthesizer）的英文縮寫。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時(shí)間等優(yōu)點(diǎn)，廣
  • 關(guān)鍵字： FPGA  DDS  原理    

經(jīng)改造的DDS功能用作波特率發(fā)生器

  • 一般情況下，可以用一個(gè)現(xiàn)有的振蕩器，為一個(gè)UART產(chǎn)生一個(gè)波特率時(shí)鐘。振蕩器頻率必須作分頻，而分頻會(huì)帶來波...
  • 關(guān)鍵字： DDS  波特率發(fā)生器  示波器  

基于DDS的高速定時(shí)同步方法

  • 摘要：定時(shí)同步是高速數(shù)據(jù)傳輸?shù)年P(guān)鍵技術(shù)也是難點(diǎn)問題。在對(duì)鎖相環(huán)數(shù)字化設(shè)計(jì)、DDS原理結(jié)構(gòu)和參數(shù)設(shè)計(jì)進(jìn)行研究的基礎(chǔ)上，提出了一種基于DDS的高速定時(shí)同步方法，對(duì)該定時(shí)同步方法的原理結(jié)構(gòu)框圖進(jìn)行了詳細(xì)的論述，對(duì)
  • 關(guān)鍵字： 同步  方法  定時(shí)  高速  DDS  基于  

基于DDS+PLL的跳頻信號(hào)源的設(shè)計(jì)

  • 航空通信設(shè)備包括短波通信、超短波通信設(shè)備，短波、超短波通信設(shè)備又分為常規(guī)通信方式和跳頻通信方式，跳頻通信因具有抗干擾性強(qiáng)、抗偵測(cè)能力好、頻譜利用率高和易于實(shí)現(xiàn)碼分多址等優(yōu)點(diǎn)被稱為無線電通信的“殺手
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DDS相關(guān)任意波形發(fā)生器的實(shí)現(xiàn)方案

  • 任意波形發(fā)生器( Arbit rary Waveform Generato r,AWG) 是一種多波型的信號(hào)發(fā)生器，它不僅能產(chǎn)生正弦波、指數(shù)波等常規(guī)波形，也可以表現(xiàn)出載波調(diào)制的多樣化，如：產(chǎn)生調(diào)頻、調(diào)幅、調(diào)相和脈沖調(diào)制等。更可以通過計(jì)算機(jī)
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周立功國網(wǎng)單相表DDS-GW解決方案

  • 新的智能電表標(biāo)準(zhǔn)對(duì)于智能電表的設(shè)計(jì)和生產(chǎn)提出新的要求。國網(wǎng)單相表DDS-GW解決方案因滿足新國網(wǎng)標(biāo)準(zhǔn)的要求而產(chǎn)生。該方案采用NXP公司低功耗LPC1100系列Cortex-M0微控制器作為主控芯片，完全按照國家電網(wǎng)公司智能電表
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基于DSP、DDS和ARM雷達(dá)中頻信號(hào)模擬器研究

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于FPGA的DDS IP核設(shè)計(jì)

  • 摘要：以Altera公司的QuartusⅡ7．2作為開發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟
  • 關(guān)鍵字： FPGA  DDS  IP核    

基于DDS技術(shù)的正弦交流信號(hào)源的設(shè)計(jì)

  • 摘要：以設(shè)計(jì)和實(shí)現(xiàn)可以進(jìn)行功率輸出的正弦波信號(hào)源為目的，提出了一種基于DDS技術(shù)，以單片機(jī)為控制核心、AD9850芯片為頻率合成器的正弦交流電流信號(hào)源的設(shè)計(jì)方法。該正弦交流電流信號(hào)源可以產(chǎn)生頻率穩(wěn)定且頻率范圍為
  • 關(guān)鍵字： 信號(hào)源  設(shè)計(jì)  交流  技術(shù)  DDS  基于  

基于流水線結(jié)構(gòu)的DDS多功能信號(hào)發(fā)生器設(shè)計(jì)

  • 摘要：在應(yīng)用FPGA進(jìn)行DDS系統(tǒng)設(shè)計(jì)過程中，選擇芯片的運(yùn)行速度優(yōu)化和資源利用優(yōu)化常常是相互矛盾的，從發(fā)展趨勢(shì)和運(yùn)算要求看，系統(tǒng)速度指標(biāo)的意義比面積指標(biāo)更趨重要?；诖?，介紹了一種流水線結(jié)構(gòu)來優(yōu)化傳統(tǒng)的相位累
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基于FPGA和DDS的數(shù)控信號(hào)源的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要 以FPGA為核心，根據(jù)DDS原理設(shè)計(jì)數(shù)控信號(hào)源，采用VHDL語言實(shí)現(xiàn)各功能模塊。該信號(hào)源可輸出正弦渡、方波和三角波，輸出信號(hào)的頻率以數(shù)控方式調(diào)節(jié)，幅度連續(xù)可調(diào)。與傳統(tǒng)信號(hào)源相比，該信號(hào)源具有波形質(zhì)量好、精度
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DDS函數(shù)信號(hào)發(fā)生器的優(yōu)點(diǎn)

  • 在電子行業(yè)的基礎(chǔ)設(shè)施和制造等領(lǐng)域，函數(shù)發(fā)生器都是有效的通用儀器。它可以生成不同頻率和幅度的大量信號(hào)，用來評(píng)估新電路的運(yùn)行情況，代替時(shí)鐘信號(hào)，對(duì)新產(chǎn)品進(jìn)行制造測(cè)試，及用于許多其它用途。自第一部正弦波發(fā)生
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dds-11a型實(shí)驗(yàn)室電導(dǎo)率介紹

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