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EEPW首頁 >> 主題列表 >> dsp-mode

透過DSP系統(tǒng)模型建立和設(shè)定實現(xiàn)最佳模擬

  • 嵌入式軟件發(fā)展需要對目標架構(gòu)及其使用有著廣泛而透徹的認識和瞭解。把嵌入式系統(tǒng)從概念轉(zhuǎn)化成能夠有效地在硬件環(huán)境中部署的高效能解決方案，需要若干個步驟。整個過程包括：分析、架構(gòu)搭建、評估、硬件支援、設(shè)計、編碼、除錯、整合、驗證和確認，過程中準確度極為重要。硬件資源的使用效率低，或者是軟件沒有針對那些硬件資源進行最佳化，都可能對性能帶來嚴重的影響。 CEVA-X系列采用的創(chuàng)新架構(gòu)，充分利用可能的設(shè)計變數(shù)來控制整體性能。CEVA-X1620是CEVA-X核心系列的第一款產(chǎn)品，具有先進的平行架構(gòu)（Parallel
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多DSP局部總線與VME總線的接口設(shè)計

  • 本文基于雷達實時信號處理的需要，用FPGA實現(xiàn)了多DSP信號處理模板局部總線和基于標準VME總線的計算機進行通信的接口設(shè)計。
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賽靈思推出新型低成本SPARTAN-DSP系列

  • 　　賽靈思公司日前宣布推出首個低成本 Spartan™-DSP 系列產(chǎn)品以及相應(yīng)的開發(fā)板和增強設(shè)計軟件，極大地擴展了其XtremeDSP™解決方案的產(chǎn)品線，并且在價格、性能和功耗三合一組合方面為數(shù)字信號處理樹立了新的標桿。Spartan-DSP以業(yè)界最低的成本價格提供了高達20GMACS（每秒十億次乘法累計）的DSP功能，而價格不到30美元。與同類的其它高性能可配置DSP器件相比，該系列產(chǎn)品的動態(tài)功耗降低多達50%。 　　新推出Spartan-DSP系列之后，XtremeDSP產(chǎn)
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基于DSP實現(xiàn)的無差拍控制逆變器

  • 隨著計算機以及各種精密自動化設(shè)備、電子設(shè)備被廣泛應(yīng)用于通信、工業(yè)自動化控制、辦公自動化等領(lǐng)域, 逆變器作為 UPS的重要組成部分，近年來得到了迅速展。對逆變器的控制成為研究重點，即要求其輸出波形穩(wěn)態(tài)精度高、總諧波畸變率低和動態(tài)響應(yīng)快。目前，瞬時 PID控制、重復(fù)控制等技術(shù)都在應(yīng)用中占有重要地位。但這兩種技術(shù)都有難以克服的缺點，如瞬時PID控制難以實現(xiàn)數(shù)字化；重復(fù)控制的動態(tài)響應(yīng)慢。美國著名控制理論專家卡爾曼于60年代初提出了數(shù)字控制的無差拍控制思想。隨著電力電子技術(shù)的發(fā)展，80年代中期，無差拍控制被應(yīng)用于逆
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基于DSP和CPLD的低功耗多路數(shù)據(jù)處理系統(tǒng)設(shè)計

  • 引言 隨著電子技術(shù)的應(yīng)用和發(fā)展，數(shù)字信號處理內(nèi)容日益復(fù)雜，同時，很多情況下要求整個系統(tǒng)具有低功耗的特點。為滿足這種要求，DSP芯片設(shè)計技術(shù)也在向低功耗、高性能的方向發(fā)展。從處理速度來看，TMS320VC5502的運算能力已經(jīng)達到了600MMACS，即每秒鐘可以完成6億次乘加運算。從功耗來看，TMS320VC5502內(nèi)核電壓只有1.26V，整個芯片的功耗也大大降低了。本文介紹了基于TMS320VC5502和CPLD XC95144的低功耗多路數(shù)據(jù)處理系統(tǒng)。 模擬信號的輸入經(jīng)過50Hz陷波電路(濾除工頻
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微機保護中DSP與時鐘DS12CR887的接口設(shè)計

  • 系統(tǒng)中其他外圍電路的控制方法和原理與時鐘芯片完全類似，以此方法可以搭建一個通用性強、性能穩(wěn)定的硬件平臺，再通過各種具體的保護應(yīng)用軟件，從而實現(xiàn)各種具體功能的微機保護裝置。
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Altera FPGA在Fairlight新媒體處理引擎中替代64片DSP

  • 2007年4月10號，北京——澳大利亞悉尼的音頻產(chǎn)品系統(tǒng)專業(yè)公司Fairlight利用Altera® FPGA的靈活性以及數(shù)字信號處理(DSP)優(yōu)勢，將采用了8塊電路板和64片DSP的設(shè)計精簡為一塊Stratix® FPGA PCI卡。 Fairlight首席技術(shù)官Tino Fibaek說：“我們的水晶內(nèi)核(CC-1)體系結(jié)構(gòu)表明，Altera FPGA在DSP功能上的性價比非常優(yōu)異。采用了Altera的開發(fā)工具后，該項目成為我見過的進展最為順利的項目。我們完成開發(fā)所花費的時間僅是DSP
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Altera FPGA在Fairlight新媒體處理引擎中替代64片DSP

  • 　　澳大利亞悉尼的音頻產(chǎn)品系統(tǒng)專業(yè)公司Fairlight利用Altera® FPGA的靈活性以及數(shù)字信號處理(DSP)優(yōu)勢，將采用了8塊電路板和64片DSP的設(shè)計精簡為一塊Stratix® FPGA PCI卡。 　　Fairlight首席技術(shù)官Tino Fibaek說：“我們的水晶內(nèi)核(CC-1)體系結(jié)構(gòu)表明，Altera FPGA在DSP功能上的性價比非常優(yōu)異。采用了Altera的開發(fā)工具后，該項目成為我見過的進展最為順利的項目。我們完成開發(fā)所花費的時間僅是DSP器件體系結(jié)構(gòu)設(shè)計的三分
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基于DSP的PCI總線數(shù)據(jù)采集系統(tǒng)的研究

  • 1 引言 隨著數(shù)字信號處理器性能的不斷提高及其成本與售價的大幅下降，數(shù)字信號處理應(yīng)用領(lǐng)域飛速擴展，信號處理進入了一個新的發(fā)展時期。同時隨著計算機技術(shù)以及互聯(lián)網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，越來越多的數(shù)據(jù)需要經(jīng)過計算機來進行處理、存儲、傳輸籌操作。計算機的應(yīng)用已經(jīng)遍及我們生活的每一個角落。由于計算機本身的特點，通用計算機通常僅負責(zé)沒有實時性要求的工作，而不適于進行實時性要求很高的數(shù)字信號處理。將計算機和 DSP有機地結(jié)合起來，充分利用各自的優(yōu)點，它們將會相得益彰，滿足現(xiàn)實應(yīng)用中對數(shù)據(jù)實時處理能力、數(shù)據(jù)傳輸能力以及數(shù)
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基于DSP芯片的MELP聲碼器的算法實現(xiàn)

  • 論文對MELP編解碼算法的原理進行了簡要分析，討論了如何在定點DSP芯片TMS320VC5416上實現(xiàn)該算法，并研究了其關(guān)鍵技術(shù)，最后對測試結(jié)果進行了分析。
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ADI DSP FAQ

  • 1.什么是ADI DSP，有什么特點，有些什么型號？  ADI DSP是美國模擬器件公司推出的dsp的統(tǒng)稱，相對與ti公司的dsp系列，具有內(nèi)部mem較大，多片協(xié)同工作能力強等優(yōu)點，具體可查閱ADI公司主頁http://www.analog.com  主要有以下幾個系列的DSP:  a)21xx系列：16位定點dsp，主要以218x系列為代表，性能優(yōu)異，內(nèi)部REM大，外圍接口多，適合作為控制類芯片使用，另有219x系列性能更高
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TI DSP FAQ

  •  1、TI DSP的選型        主要考慮處理速度、功耗、程序存儲器和數(shù)據(jù)存儲器的容量、片內(nèi)的資源，        如定時器的數(shù)量、I/O口數(shù)量、中斷數(shù)量、DMA通道數(shù)等。        DSP的主要供應(yīng)商有TI，ADI，Motorola,Lu
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2007年TI DSP技術(shù)開發(fā)講座（TI&SEED)

  • 2007年TI DSP技術(shù)開發(fā)講座（TI&SEED) [講座簡介] 為滿足廣大客戶的需求，不斷普及與推廣DSP最新技術(shù)，更好地解決客戶在DSP設(shè)計、開發(fā)中碰到的問題，北京合眾達電子技術(shù)有限公司與美國德州儀器（TI）公司聯(lián)合將于2007年5月份在成都、南昌、杭州、桂林、石家莊5個城市舉辦大型巡回免費DSP設(shè)計與開發(fā)技術(shù)講座，歡迎廣大愛好者積極報名參加。 合眾達電子（SEED）作為美國德州儀器（TI）在國內(nèi)唯一一家同時具有Third Party和product 
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賽靈思為DSP優(yōu)化65nm FPGA

  • 賽靈思公司(Xilinx, Inc.)宣布開始向市場交付針對高性能數(shù)字信號處理(DSP)而優(yōu)化的65nm Virtex-5 SXT現(xiàn)場可編程門陣列(FPGA)器件的首批產(chǎn)品。SXT平臺的DSP在550MHz下性能達352 GMAC，而且動態(tài)功率較上一代90nm器件相比降低35%。Virtex-5 SXT平臺為無線WIMAX以及監(jiān)控和廣播等高分辨率視頻等領(lǐng)域中的高性能數(shù)字信號處理應(yīng)用提供了最高的DSP模塊和邏輯資源比。增強的DSP邏輯片(DSP48E)包括一個25 x 18位乘法器、一個48位第二級累加和算
  • 關(guān)鍵字： 0703_A  65nm  DSP  FPGA  單片機  嵌入式系統(tǒng)  雜志_業(yè)界風(fēng)云  

采用可高效再配置DSP系統(tǒng)的動態(tài)加載技術(shù)

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