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FPGA：數(shù)字示波器 2 - 雙端口 RAM

  • FIFO使我們能夠非?？焖俚孬@得工作設計。但對于我們簡單的示波器來說，這有點矯枉過正。我們需要一種機制來存儲來自一個時鐘域（100MHz）的數(shù)據(jù)，并在另一個時鐘域（25MHz）中讀取數(shù)據(jù)。 一個簡單的雙端口RAM就可以做到這一點。 缺點是兩個時鐘域之間的所有同步（FIFO為我們所做的）現(xiàn)在必須“手動”完成。觸發(fā)“基于 FIFO”的示波器設計沒有明確的觸發(fā)機制。讓我們改變一下。 現(xiàn)在，每次從串行端口接收到字符時，示波器都會被觸發(fā)。 當然，這仍然不是一個非常有用的設計，但我們稍后會對其進行改進。我們使用“as
  • 關鍵字： FPGA  數(shù)字示波器  

FPGA：數(shù)字示波器 1 - 首款設計

  • 以下是此處構建的內(nèi)容：FPGA 接收兩個時鐘：一個緩慢的“系統(tǒng)”時鐘，固定在25MHz。ADC采樣時鐘（更快，假設100MHz），連接到ADC和FPGA。擁有這兩個時鐘為設計提供了靈活性。 但這也意味著我們需要一種方法將信息從一個時鐘域傳輸?shù)搅硪粋€時鐘域。 為了驗證硬件是否正常工作，讓我們走一條簡單的路線，使用FIFO。 從ADC采集的樣本以全ADC速度（100MHz）存儲在FPGA FIFO中。然后，F(xiàn)IFO內(nèi)容被讀回、序列化，并以更慢的速度（115200波特）在串行端口上發(fā)送。 最后，我們將串行輸出連
  • 關鍵字： FPGA  數(shù)字示波器  

FPGA：數(shù)字示波器

  • 與模擬示波器相比，數(shù)字示波器具有許多優(yōu)勢，例如能夠捕獲單個事件，并顯示觸發(fā)前發(fā)生的情況。您只需將ADC和FPGA連接在一起，即可構建數(shù)字示波器。這種特殊設計使用100MHz閃存ADC，因此我們正在構建一個100MSPS（每秒兆采樣數(shù)）示波器。這種示波器設計很有意思，因為它展示了現(xiàn)代 FPGA 的強大和實用性。 但是，如果您不熟悉 FPGA 技術，請記住，這不是本網(wǎng)站上最容易理解的設計。HDL設計或者如何在FPGA內(nèi)部創(chuàng)建示波器邏輯。HDL 第 1 部分?- 基于 FIFO 的設計。HDL 第 2
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FPGA：SDRAM控制器

  • 盡管現(xiàn)代 FPGA 包含內(nèi)部存儲器，但可用存儲器量始終比專用存儲芯片低幾個數(shù)量級。 因此，許多FPGA設計人員將某種類型的存儲器附加到他們的FPGA中也就不足為奇了。 特別是，SDRAM因其高速和低成本而成為非常受歡迎的存儲器。 不幸的是，它們不像靜態(tài)存儲器那樣容易控制，因此經(jīng)常使用SDRAM控制器。對于我們的控制器，我們的目標是可能是最簡單的SDRAM：美光MT48LC1M16A1 16Mb傳統(tǒng)SDRAM。 我們的測試系統(tǒng)包括 Xylo-E、Xylo-EM 和 Xylo-LM（具有 16Mb
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FPGA：HDMI接口

  • HDMI 是一種數(shù)字視頻接口，因此很容易從現(xiàn)代 FPGA 驅(qū)動。讓我們看看它是如何工作的。連接器標準 HDMI 連接器有 19 個引腳。 在 19 個引腳中，有 8 個特別值得關注，因為它們形成 4 個 TMDS 差分對來傳輸實際的高速視頻信息。TMDS 時鐘+ 和時鐘-TMDS data0+ 和 data0-TMDS data1+ 和 data1-TMDS data2+ 和 data2-我們從FPGA到HDMI連接器的連接再簡單不過了......我們使用 8 個 FPGA 引腳，配置為 4 個差分 TM
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MCU如何在機器人電機控制設計中提高系統(tǒng)性能

  • 機器人系統(tǒng)可自動執(zhí)行重復性任務，承擔復雜而費力的作業(yè)，并在對人類有危險或有害的環(huán)境中工作。集成度更高、性能更強的微控制器 (MCU) 可實現(xiàn)更高的功率效率、更平穩(wěn)安全的運動以及更高的精度，從而提高生產(chǎn)力和自動化水平。例如，更高的精度（有時在 0.1mm 以內(nèi)）對于處理激光焊接、精密涂層或噴墨或 3D 打印的應用非常重要。 機械臂的軸數(shù)以及所需的控制架構類型（集中式或分布式）決定了適合該系統(tǒng)的 MCU 或電機控制集成電路 (IC)?，F(xiàn)代工廠組合使用具有不同軸數(shù)和運動自由度（在 x、y 或 z 平面
  • 關鍵字： MCU  機器人  電機控制  

FPGA：Ethernet接口

  • 以太網(wǎng)全雙工協(xié)議易于在FPGA中實現(xiàn)。 這里的目標是將FPGA連接到10BASE-T連接。以太網(wǎng)數(shù)據(jù)包：發(fā)送和接收10BASE-T FPGA 接口 0 - 發(fā)送以太網(wǎng)流量的方案在這里，我們演示了如何將以太網(wǎng)流量直接從FPGA發(fā)送到PC。對于此食譜，您需要：FPGA 開發(fā)板，具有 2 個空閑 IO 和一個 20MHz 時鐘。一臺帶有以太網(wǎng)卡并安裝了 TCP-IP 堆棧的 PC（如果你能瀏覽 Internet，你就很好）。（可選）網(wǎng)絡集線器或交換機。1. 將FPGA板連接到以太網(wǎng)以下是使用以太網(wǎng)集線器或交換機
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FPGA：PCI Express接口

  • 隨著 PCI Express 在高端 FPGA 中變得司空見慣，讓我們看看 FPGA 供應商如何輕松實現(xiàn)該技術。特別是，我們更仔細地研究了賽靈思的 PCI Express 解決方案。PCI Express 1 - 連接器PCI Express 通常有兩種尺寸：1 通道和 16 通道，其中 1 通道用于普通主板，16 通道用于顯卡。連接器1 通道連接器有 36 個觸點，排列成兩排，每排 18 個觸點。這是俯視圖。在 36 個觸點中，只有 6 個對數(shù)據(jù)傳輸有用，其余是電源引腳和其他輔助信號。 6 個功能觸點以
  • 關鍵字： FPGA  PCI Express接口  賽靈思  

嵌入模擬前端的RX23E-B MCU，適用于工業(yè)傳感器應用

  • 利用傳感數(shù)據(jù)進行預測性維護和自動化，如今已成為制造業(yè)和基礎設施的最新趨勢。隨著這種市場趨勢的發(fā)展，輸出傳感數(shù)據(jù)的傳感器設備也在不斷演變，以提供精確的測量結果，并通過小型化、智能化和分布式處理為系統(tǒng)增值。過去13年里，瑞薩電子RX系列產(chǎn)品的出貨量已超過13億顆。其中，RX-E MCU系列配備了針對工業(yè)傳感設備優(yōu)化的24位ΔΣA/D轉(zhuǎn)換器。首款RX23E-A MCU的性能相當于或優(yōu)于分立式ΔΣA/D轉(zhuǎn)換器的性能，因此RX23E-A在溫度控制器、計重秤、壓力表等測量模塊中得到了廣泛應用。A/D轉(zhuǎn)換器的選擇因應用
  • 關鍵字： 傳感器  轉(zhuǎn)換器  RX23E-B  MCU  

FPGA：PCI項目

  • FPGA 是功能強大的 PCI 開發(fā)平PCI 0 - 簡單的PCI接口這是 PCI 代碼的一個示例。 我們使用 PCI 寫入命令來控制 LED。 寫“0”可關閉 LED，寫“1”可打開 LED！臺，這要歸功于其可重新編程性和運行速度。// Very simple PCI target// Just 3 flip-flops for the PCI logic, plus one to hold the state of an LEDmodule PCI(CLK, RSTn, FRAMEn, AD, CBE
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臺積電熊本新廠建筑工程上個月末已完成

  • 1月8日消息，據(jù)報道，日本熊本放送消息，臺積電日本熊本新廠建筑工程在上個月末已完成，預定年內(nèi)投產(chǎn)，目前處于設備移入進機階段。另外，該廠開幕式預計在2月24日舉行。公開資料顯示，臺積電日本子公司主要股東包括持股71%的臺積電、持股近20%的索尼，以及持股約10%的日本電裝（DENSO），熊本第一工廠計劃生產(chǎn)12/16nm和22/28nm這類成熟制程的半導體，初期多數(shù)產(chǎn)能為索尼代工 CMOS 圖像傳感器中采用的數(shù)字圖像處理器（ISP），其余則為電裝代工車用電子微控制器 MCU，電裝可取得約每月1萬片產(chǎn)能。臺積
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FPGA：SD卡

  • SD 卡可輕松與 FPGA 連接。我們的SD卡項目分為兩部分：SD 卡 1 - FPGA 連接SD 卡可輕松與 FPGA 連接。 它們有不同的尺寸（標準、迷你和微型），但在電氣上它們的工作方式相同。 讓我們關注 micro-SD 卡，因為它們非常小且現(xiàn)在很受歡迎。Micro-SD 卡有 8 個針腳。首先，電源連接在引腳 4 和 6 上。然后，您需要 3 到 6 個 FPGA 引腳連接，具體取決于您決定使用的操作模式。SPI模式在SPI模式下，DI/DO線是單向的。這意味著：無需在 DI/DO 上上拉命令（
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FPGA：JTAG接口

  • 大多數(shù)FPGA都支持JTAG。JTAG 1 - 什么是JTAG？JTAG 是 1149 年代開發(fā)的 IEEE 標準 （1.1980），用于解決電子板制造問題。 如今，它更多地用作編程、調(diào)試和探測端口。但首先，讓我們看看JTAG的原始用途，邊界測試。邊界測試這是一個簡單的電子板（也稱為“PCB”，意為“印刷電路板”），帶有兩個 IC（“集成電路”）、一個 CPU 和一個 FPGA。典型的電路板可能有更多的IC。IC可以有很多引腳。 因此，當然，IC通過許多連接（PCB走線）連接在一起。我們在這里只展示四個。
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FPGA約束、時序分析的概念介紹

  • 時序約束的概念和基本策略時序約束主要包括周期約束（FFS到FFS，即觸發(fā)器到觸發(fā)器）和偏移約束（IPAD到FFS、FFS到OPAD）以及靜態(tài)路徑約束（IPAD到OPAD）等3種。通過附加約束條件可以使綜合布線工具調(diào)整映射和布局布線過程，使設計達到時序要求。例如用OFFSET_IN_BEFORE約束可以告訴綜合布線工具輸入信號在時鐘之前什么時候準備好，綜合布線工具就可以根據(jù)這個約束調(diào)整與IPAD相連的Logic Circuitry的綜合實現(xiàn)過程，使結果滿足FFS的建立時間要求。附加時序約束的一般策略是先附加
  • 關鍵字： FPGA  約束  時序  

FPGA：EPP（增強型并行端口）

  • EPP 使與 PC 的通信變得快速而簡單。在這里，我們使用Pluto-P FPGA板與支持EPP的PC進行通信。EPP 1 - 什么是 EPP？EPP 是 IEEE 1284（并行端口標準）的一部分。IEEE 1284 還定義了 SPP 和 ECP，但 EPP 提供了兩者的優(yōu)點，即速度和簡單性。EPP的主要特點是：通過并行端口提供雙向通信，即對連接到 PC 并行端口的外圍設備進行讀寫的方式。事務是 8 位寬的，并且是原子的。主機 （PC） 始終是事務的發(fā)起者，讀取或?qū)懭搿]有爆發(fā)的概念。您可以發(fā)
  • 關鍵字： FPGA  EPP  增強型并行端口  
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