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基于DSPBuilder的FIR濾波器的系統(tǒng)設(shè)計(jì)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于Linux平臺(tái)下的FPGA的ARM驅(qū)動(dòng)開(kāi)發(fā)方法

基于Linux平臺(tái)下的FPGA的ARM驅(qū)動(dòng)開(kāi)發(fā)方法,Linux操作系統(tǒng)的全稱(chēng)是GNU／Linux，它是由GNU工程和Linux內(nèi)核兩個(gè)部分共同組成的一個(gè)操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的，可以有效保護(hù)學(xué)習(xí)成果，因而在嵌入式領(lǐng)域得到了廣泛的應(yīng)用。

FPGA是英文Field
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HDLC的FPGA實(shí)現(xiàn)方法

　1 引言　　HDLC（High-level Data Link Control Procedures, 高級(jí)數(shù)據(jù)鏈路控制規(guī)程）廣泛應(yīng)用于數(shù)據(jù)通信領(lǐng)域，是確保數(shù)據(jù)信息可靠互通的重要技術(shù)。實(shí)施HDLC的一般方法通常是采用ASIC（Application Specific Integr
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FPGA平臺(tái)架構(gòu)用于復(fù)雜嵌入式系統(tǒng)

設(shè)計(jì)嵌入系統(tǒng)的主要挑戰(zhàn)來(lái)自于需要同時(shí)優(yōu)化眾多設(shè)計(jì)因素。這些需要優(yōu)化的設(shè)計(jì)因素包括單位成本、NRE（不可回收工程）成本、功率、尺寸、性能、靈活性、原型制造時(shí)間、產(chǎn)品上市時(shí)間、產(chǎn)品在市場(chǎng)生存時(shí)間、可維護(hù)性、可
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醫(yī)療電子平臺(tái)選擇：FPGA、ARM、DSP還是GPU？

醫(yī)療電子平臺(tái)選擇：FPGA、ARM、DSP還是GPU？,“邁瑞對(duì)于處理器平臺(tái)的選擇有兩個(gè)看似矛盾的原則：lsquo;多rsquo;和lsquo;少rsquo;。其中l(wèi)squo;多rsquo;是指多樣性，我們知道無(wú)論是DSP、ARM、X86還是FPGA、GPU，每個(gè)平臺(tái)都有各自的優(yōu)點(diǎn)和缺陷，因此在設(shè)
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Synopsys新版Synplify FPGA綜合軟件提高基于FPGA原型驗(yàn)證的效能

全球領(lǐng)先的電子器件和系統(tǒng)設(shè)計(jì)、驗(yàn)證和制造軟件及知識(shí)產(chǎn)權(quán)（IP）供應(yīng)商新思科技公司日前宣布：推出其最新版的Synplify Pro? 和Synplify? Premier 現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）綜合工具。Synplify 2012.03產(chǎn)品包括改進(jìn)的綜合算法，它將運(yùn)行時(shí)間提速最高達(dá)30%。此外，Synplify Premier軟件通過(guò)一種新的容錯(cuò)并繼續(xù)功能而得到增強(qiáng)，以滿(mǎn)足FPGA設(shè)計(jì)師對(duì)快速周轉(zhuǎn)時(shí)間的需求；該軟件能使設(shè)計(jì)師在最后的硬件描述語(yǔ)言（HDL）編譯環(huán)節(jié)生成一份報(bào)告，并修正所有源自丟失或不正
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Altera發(fā)布了基于FPGA的視頻分析解決方案

進(jìn)一步延續(xù)其在基于FPGA的視頻監(jiān)控解決方案上的領(lǐng)先優(yōu)勢(shì)，Altera公司 (NASDAQ: ALTR)日前發(fā)布了面向監(jiān)控系統(tǒng)數(shù)字視頻錄像機(jī)(DVR)和網(wǎng)絡(luò)視頻錄像機(jī)(NVR)的四通道標(biāo)準(zhǔn)清晰度(SD)視頻分析解決方案。與Eutecus公司聯(lián)合開(kāi)發(fā)，Altera最新的視頻分析解決方案支持用戶(hù)使用一片F(xiàn)PGA同時(shí)分析四路D1 480p/30fps (每秒幀數(shù))視頻通道。用戶(hù)可以在現(xiàn)有SD監(jiān)控投入上迅速高效的增加功能，不需要購(gòu)買(mǎi)集成了分析功能的新攝像機(jī)。
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Altera的FPGA OpenCL計(jì)劃大幅度縮短客戶(hù)開(kāi)發(fā)時(shí)間

Altera公司(Nasdaq: ALTR)日前宣布，goHDR作為FPGA OpenCL計(jì)劃的早期試用客戶(hù)，通過(guò)Altera的FPGA OpenCL計(jì)劃，大幅度縮短了開(kāi)發(fā)時(shí)間，顯著提高了性能。與Altera密切合作，goHDR將其專(zhuān)用C代碼導(dǎo)入到OpenCL標(biāo)準(zhǔn)中，不到一星期的時(shí)間便在FPGA中實(shí)現(xiàn)了這些代碼——使用傳統(tǒng)的HDL流程，這一過(guò)程一般需要3到6個(gè)月的時(shí)間。
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用FPGA實(shí)現(xiàn)WCDMA下行擾碼

1 概述在WCDMA中，加擾就是用一個(gè)偽隨機(jī)碼序列對(duì)擴(kuò)頻碼進(jìn)行相乘，對(duì)信號(hào)進(jìn)行加密。上行鏈路物理信道加擾的作用是區(qū)分用戶(hù)，下行鏈路加擾可以區(qū)分小區(qū)和信道。WCDMA采用Gold碼作為擴(kuò)頻序列的擾碼。Gold由兩個(gè)M序列相
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基于FPGA的數(shù)字選頻器設(shè)計(jì)

摘要：提出了一種基于FPGA的數(shù)字選頻器設(shè)計(jì)方案，該數(shù)字選頻器應(yīng)用于八通道的GSM系統(tǒng)直放站，采用低成本的FPGA芯片Xilink Spartan-3A DSP XC3SD3400A進(jìn)行數(shù)字信號(hào)處理。給出了較詳細(xì)的硬件設(shè)計(jì)方案，并通過(guò)Agilent T
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基于FPGA和ARM的彩色圖像處理系統(tǒng)

引言圖像處理技術(shù)的快速發(fā)展，使得圖像采集處理系統(tǒng)在提高農(nóng)業(yè)生產(chǎn)自動(dòng)化程度中的應(yīng)用越來(lái)越廣泛。目前的圖像采集系統(tǒng)有的基于CCD攝像機(jī)、圖像采集卡和計(jì)算機(jī)，有的基于CCD攝像機(jī)、解碼器、FPGA和DSP，而有的基于CMO
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基于FPGA實(shí)現(xiàn)千兆以太網(wǎng)業(yè)務(wù)在SDH上的傳輸

摘要：為了實(shí)現(xiàn)千兆以太網(wǎng)業(yè)務(wù)在SDH網(wǎng)絡(luò)上的傳輸(EOS)，可以利用FPGA將以太網(wǎng)MAC數(shù)據(jù)幀在SDH數(shù)據(jù)幀中進(jìn)行封裝和映射處理。介紹了GFP封裝協(xié)議以及虛級(jí)聯(lián)技術(shù)，給出了FPGA內(nèi)部的模塊化設(shè)計(jì)方法。利用FPGA的強(qiáng)大功能和內(nèi)
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FPGA測(cè)試方案隨需而變

大容量、高速率和低功耗已成為FPGA的發(fā)展重點(diǎn)。嵌入式邏輯分析工具無(wú)法滿(mǎn)足通用性要求，外部測(cè)試工具可以把FPGA內(nèi)部信號(hào)與實(shí)際電路聯(lián)合起來(lái)觀察系統(tǒng)真實(shí)運(yùn)行情況。隨著FPGA技術(shù)的發(fā)展，大容量、高速率和低功耗已經(jīng)成
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PCI總線協(xié)議的FPGA實(shí)現(xiàn)及驅(qū)動(dòng)設(shè)計(jì)

摘要：采用FPGA技術(shù)，在ALTERA公司的FLEX6000系列芯片上實(shí)現(xiàn)了從設(shè)備模式PCI總線的簡(jiǎn)化協(xié)議，并給出了Windows9x系...
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直接擴(kuò)頻通信同步系統(tǒng)的FPGA設(shè)計(jì)與實(shí)現(xiàn)

摘要：對(duì)直接擴(kuò)頻通信同步系統(tǒng)進(jìn)行了研究，使用PN碼作為擴(kuò)頻序列，利用其良好的自相關(guān)性，提出一種新式的滑動(dòng)相關(guān)法使收發(fā)端同步，并給出該系統(tǒng)的FPGA實(shí)現(xiàn)方法。利用ISE 10．1開(kāi)發(fā)軟件仿真驗(yàn)證，證明此方法可以提高運(yùn)
關(guān)鍵字： FPGA 通信擴(kuò)頻滑動(dòng) 相關(guān) 實(shí)現(xiàn) 系統(tǒng) 同步直接設(shè)計(jì)