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SoC系統(tǒng)設(shè)計(jì)--具有X86到ARM二進(jìn)制翻譯和執(zhí)行功能

作者: 時(shí)間:2012-07-02 來(lái)源:網(wǎng)絡(luò) 收藏

是一種直接程序的技術(shù),能夠把一種處理器上的程序到另外一種處理器上。它使得不同處理器之間的二進(jìn)制程序可以很容易的相互移植,擴(kuò)大了硬件/軟件的適用范圍,有助于打破處理器和支持軟件之間的相互扼制的局面。二進(jìn)制翻譯技術(shù)的優(yōu)點(diǎn)為:不需要重編譯源碼就可以實(shí)現(xiàn)軟件從舊平臺(tái)到新平臺(tái)的移植;快速為新機(jī)器提供軟件,包括移植操作和編譯器;充分利用新機(jī)器的特性優(yōu)化代碼;減少培訓(xùn)費(fèi)用,因?yàn)槭褂玫氖窍嗤能浖?,所以不必在新平臺(tái)上重新培訓(xùn)員工;降低了多平臺(tái)軟件的費(fèi)用。

本文引用地址:http://m.butianyuan.cn/article/148816.htm

  1 SOC架構(gòu)

  1.1 處理器的確定

  通用處理器與硬件邏輯是的主流架構(gòu)。在一些需要大量數(shù)據(jù)處理的應(yīng)用中,這樣的架構(gòu)并不能滿足要求。實(shí)際上,由于不同的任務(wù)在很大程度上互相獨(dú)立運(yùn)行,可以將內(nèi)在并行性的任務(wù)分解為緊密聯(lián)系的子任務(wù),不同的內(nèi)核可以執(zhí)行不同的子任務(wù),多核架構(gòu)在1個(gè)周期內(nèi)可以執(zhí)行多個(gè)指令。這種并行處理使得整個(gè)的性能與使用單核處理器串行處理相同任務(wù)相比,有了很大改進(jìn)。另外,多核架構(gòu)可以復(fù)用現(xiàn)有的單核處理器作為處理器核心,從而可以縮短設(shè)計(jì)和驗(yàn)證周期,節(jié)省開發(fā)成本,符合設(shè)計(jì)的基本思路。多核架構(gòu)是未來(lái)發(fā)展的一個(gè)趨勢(shì)。

  該設(shè)計(jì)采用雙核架構(gòu),采用當(dāng)代流行的處理能力較好的處理器7TDMI-S和926EJ-S,ARM內(nèi)核最大的優(yōu)勢(shì)在于高速度、低功耗。

  ARM7TDMl-s3級(jí)流水線結(jié)構(gòu),支持Win-dows CE,Linux等操作。ARM926EJ-S是ARM公司在2000年推出的最強(qiáng)大的ARM9處理器,實(shí)現(xiàn)5級(jí)流水,它與外部通信接口為雙AHB總線結(jié)構(gòu),即指令A(yù)HB總線和數(shù)據(jù)AHB總線。該設(shè)計(jì)中ARMTDMI-S主要負(fù)責(zé)控制、操作系統(tǒng)平臺(tái)和任務(wù)的調(diào)度。ARM926EJ-S則主要負(fù)責(zé)各種任務(wù)的執(zhí)行。

  1.2 使用的總線標(biāo)準(zhǔn)

  由于SoC中集成了大量的IP核,設(shè)計(jì)的關(guān)鍵在于如何實(shí)現(xiàn)各IP模塊之間的互連。目前,SoC中IP核的互連一般采用總線結(jié)構(gòu),通過(guò)消息通信。

  采用ARM公司的AHB與APB為片上總線。AMBA總線體系結(jié)構(gòu)是當(dāng)前SoC體系設(shè)計(jì)結(jié)構(gòu)設(shè)計(jì)的開放標(biāo)準(zhǔn),由于AMBA被越來(lái)越多的公司采用,已迅速成為SoC結(jié)構(gòu)和IP庫(kù)開發(fā)的標(biāo)準(zhǔn)。

  在具體實(shí)現(xiàn)時(shí),采用AHB加APB的兩級(jí)總線結(jié)構(gòu)。AHB用來(lái)支持高速設(shè)備,支持多主從設(shè)備。多個(gè)主設(shè)備之間通過(guò)仲裁機(jī)制保證優(yōu)先級(jí),從設(shè)備通過(guò)地址譯碼機(jī)制被選中,并響應(yīng)主設(shè)備發(fā)起的總線事務(wù)。APB用支持基于寄存器訪問(wèn)的低速設(shè)備。AHB與APB兩條總線通過(guò)總線橋連接在一起,實(shí)現(xiàn)兩條總線之間的協(xié)議轉(zhuǎn)換。圖1為SoC的系統(tǒng)結(jié)構(gòu)框圖。

  


  1.3 各IP在系統(tǒng)中的

  除了兩個(gè)處理器外,SoC中各IP核如下:翻譯模塊:實(shí)現(xiàn)將指令翻譯成為ARM指令的功能。

  SMI:外部存儲(chǔ)與微處理器之間的橋梁,支持RoM作為系統(tǒng)的非易失性存儲(chǔ)介質(zhì),支持片外SRAM作為系統(tǒng)的外圍高速存儲(chǔ)。

  中斷控制器:用來(lái)支持系統(tǒng)內(nèi)部與外部的中斷控制,如中斷電平/邊沿觸發(fā)、中斷電平極性與中斷使能等。

  Internal Memory:片內(nèi)SRAM,大小為1 KB,但可以通過(guò)修改Verilog的描述來(lái)改變其大小。

  Default Slave:用于當(dāng)master訪問(wèn)未定義的地址空間時(shí),給出一個(gè)應(yīng)答信號(hào)。

  Retry Slave:是一個(gè)可以產(chǎn)生重試回應(yīng)及等待命令的slave范例,若需要類似的模組,可以利用它來(lái)完成。

  Watchdog:保證系統(tǒng)安全的監(jiān)控模塊,軟件需在預(yù)定的時(shí)間內(nèi)訪問(wèn)相應(yīng)的寄存器,否則硬件將產(chǎn)生內(nèi)部信號(hào)自動(dòng)復(fù)位。

  GPIO控制器:用來(lái)支持?jǐn)U展外設(shè),拓寬SoC的使用范圍。

  RemapPause:主要分成兩個(gè)處理單元,前者負(fù)責(zé)控管地址是否重新對(duì)應(yīng)的機(jī)制,后者負(fù)責(zé)管理系統(tǒng)的省電模式。

  TImer:定時(shí)器,支持捕獲、Matchout輸出、外部時(shí)鐘驅(qū)動(dòng)。

  2 到ARM二進(jìn)制翻譯模塊

  該設(shè)計(jì)使用的翻譯模塊通過(guò)編寫Verilog HDL實(shí)現(xiàn),能將部分指令翻譯成ARM指令,實(shí)現(xiàn)了某些X86應(yīng)用程序到ARM架構(gòu)的移植。圖2為解碼器內(nèi)部結(jié)構(gòu)圖。

  

  該翻譯模塊首先從ROM中取出X86指令,翻譯成ARM指令后存人RAM中,所有指令翻譯完成后,翻譯模塊產(chǎn)生一個(gè)終端,使處理器執(zhí)行RAM中的指令。即所有指令先翻譯完成,處理器才執(zhí)行,該翻譯過(guò)程屬于靜態(tài)二進(jìn)制翻譯。其中Decoder是整個(gè)解碼模塊的核心,負(fù)責(zé)翻譯指令。Decoder模塊采用有限狀態(tài)機(jī)控制數(shù)據(jù)通路的方式實(shí)現(xiàn).根據(jù)指令的功能和尋址方式進(jìn)行狀態(tài)分類,然后輸出ARM指令。例如,把寄存器尋址的算術(shù)指令可分為一類:


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