基于CPCI接口DSP板的雷達(dá)目標(biāo)模擬器

提出一種基于CPCI接口DSP板的C波段雷達(dá)目標(biāo)模擬器。探測回波模擬，采用軟硬件相結(jié)合的方法。由主控計(jì)算機(jī)根據(jù)雷達(dá)工作參數(shù)預(yù)先設(shè)定并計(jì)算目標(biāo)數(shù)據(jù)，然后將數(shù)據(jù)加載到硬件電路中。硬件電路實(shí)時(shí)合成雷達(dá)回波信號(hào)并輸出。利用DSP/FPGA的高速計(jì)算性能、直接數(shù)字合成(DDS)技術(shù)和數(shù)字射頻存儲(chǔ)(DRFM)技術(shù)，可以實(shí)現(xiàn)相位編碼、線性調(diào)頻、非線性調(diào)頻等多種復(fù)雜方式下的目標(biāo)回波信號(hào)的實(shí)時(shí)模擬，檢測雷達(dá)的跟蹤精度、角精度等指標(biāo)。

　　1 功能及系統(tǒng)組成

　　所設(shè)計(jì)的多目標(biāo)雷達(dá)模擬器為配合某型寬帶雷達(dá)系統(tǒng)進(jìn)行設(shè)備調(diào)試和功能檢查。模擬器將雷達(dá)發(fā)射波形經(jīng)延遲、幅度相位調(diào)制和多普勒頻移等形成模擬目標(biāo)回波，通過天線發(fā)送或直接注入給試驗(yàn)雷達(dá)系統(tǒng)。目標(biāo)回波信號(hào)包括目標(biāo)的距離、角度、速度、雷達(dá)散射截面積(RCS)、一維距離像等信息。

　　系統(tǒng)總體指標(biāo)要求如下：雙通道輸出;頻率范圍為5.2～5.8 GHz;窄帶瞬時(shí)帶寬為10 MHz;寬帶瞬時(shí)帶寬為500 MHz;目標(biāo)數(shù)目1～22個(gè);幅度控制范圍為0～127 dB，量化單位不大于0.5 dB;RCS幅度控制速率為1μs，距離變化幅度控制1 ms;目標(biāo)延遲時(shí)間：2～4 000μs;多普勒頻移范圍±400 kHz;相位噪聲不大于-90dBc/Hz@1 kHz;窄帶時(shí)雜散電平不大于-55 dBc;寬帶時(shí)雜散電平不大于-45 dBc;距離模擬精度≤1.5 m;多普勒模擬精度1 Hz;輸入功率為-45～+30 dBm;輸出最大功率20 dBm。

　　C波段雷達(dá)目標(biāo)模擬器由微波分系統(tǒng)、基帶分系統(tǒng)、寬帶分系統(tǒng)、電源控制分配組件和軟件等組成，如圖1所示。微波分系統(tǒng)包括接收組件、發(fā)射組件、頻率源組件和電源等。基帶分系統(tǒng)主要由主控計(jì)算機(jī)、數(shù)字管理單元(DMU)、接口控制單元、雙通道可編程數(shù)字延遲線(PD-DL)、時(shí)鐘產(chǎn)生和分配電路、中頻調(diào)制解調(diào)組件和電源等部分組成。窄帶目標(biāo)模擬主要由基帶分系統(tǒng)和微波分系統(tǒng)實(shí)現(xiàn)。

　　寬帶目標(biāo)模擬主要由基帶分系統(tǒng)控制寬帶分系統(tǒng)實(shí)現(xiàn)，如圖2所示。輸出通過微波分系統(tǒng)與窄帶目標(biāo)信號(hào)一起輸出。電源控制分配組件完成系統(tǒng)主電源的控制、分配、保護(hù)和指示等功能。

2 目標(biāo)回波模擬

　　2.1 窄帶目標(biāo)回波產(chǎn)生

　　本寬頻帶射頻模擬器接收雷達(dá)系統(tǒng)的發(fā)射信號(hào)、控制信號(hào)和參考信號(hào)。系統(tǒng)輸出模擬窄帶目標(biāo)回波信號(hào)前，在主控計(jì)算機(jī)上加載所有目標(biāo)、誘餌的運(yùn)動(dòng)軌跡參數(shù)，如延遲參數(shù)和徑向運(yùn)動(dòng)速度，以及每個(gè)目標(biāo)、誘餌的幅度/相位目標(biāo)特性文件。

　　仿真開始后，DMU按照雷達(dá)系統(tǒng)發(fā)出的模式、參數(shù)和觸發(fā)信號(hào)，分別控制窄帶系統(tǒng)中的雙通道PDDL和中頻調(diào)制組件產(chǎn)生基帶延時(shí)目標(biāo)信號(hào)，通過發(fā)射組件實(shí)現(xiàn)上變頻和雷達(dá)目標(biāo)的距離、幅度調(diào)制控制，濾波后形成窄帶目標(biāo)回波信號(hào)輸出，如圖3所示。

　　2.2 寬帶目標(biāo)回波產(chǎn)生

　　寬帶目標(biāo)回波的產(chǎn)生通過對(duì)預(yù)先存儲(chǔ)在存儲(chǔ)器中的雷達(dá)寬帶LFM的基帶分量和目標(biāo)特征參數(shù)直接計(jì)算，實(shí)時(shí)生成多散射點(diǎn)合成目標(biāo)的波形數(shù)據(jù)實(shí)現(xiàn)。如圖4所示，寬帶分系統(tǒng)中的所有信號(hào)都與試驗(yàn)雷達(dá)系統(tǒng)的參考信號(hào)同步，保證回波信號(hào)與雷達(dá)系統(tǒng)相參，實(shí)現(xiàn)正確的模擬。

　　輸出寬帶目標(biāo)回波信號(hào)前，在計(jì)算機(jī)上加載輸出目標(biāo)散射點(diǎn)的運(yùn)動(dòng)軌跡參數(shù)和目標(biāo)特性文件。當(dāng)雷達(dá)系統(tǒng)發(fā)射寬帶LFM信號(hào)時(shí)，寬帶目標(biāo)回波的基帶數(shù)據(jù)由DSP計(jì)算并加載到任意波形發(fā)生器(AWG)的存儲(chǔ)器中。DMU產(chǎn)生寬帶分系統(tǒng)的延時(shí)觸發(fā)脈沖和波形選擇信號(hào)，控制AwG輸出模擬基帶回波信號(hào)，將該基帶信號(hào)進(jìn)行正交調(diào)制后，通過上變頻就得到寬帶信號(hào)的目標(biāo)回波。目標(biāo)特征數(shù)據(jù)通過CompactPCI總線加載到DSP中參與波形計(jì)算。

　　寬帶回波信號(hào)的更新率決定于AWG的數(shù)據(jù)更新率。這種數(shù)字方法原理簡單，模擬目標(biāo)靈活，精度非常高，信號(hào)質(zhì)量較高。缺點(diǎn)是成本較高，實(shí)時(shí)性受硬件速度、波形復(fù)雜度等限制，不容易提高。

　　如圖5所示，DSP模塊中有兩個(gè)TMS320C6455高性能DSP、存儲(chǔ)器和大規(guī)模FPGA，完成特征數(shù)據(jù)接收、波形計(jì)算更新和數(shù)據(jù)傳輸?shù)裙δ埽茿WG的核心控制部分。AWG模塊的FPGA采用Xilinx公司的XC4VLX25-FF668。IQ信號(hào)通路的DAC選用兩片Atmel公司的1GHz 10位TS86101G2B，且兩路DAC相互獨(dú)立且保持信號(hào)的同步。其單路瞬時(shí)帶寬可達(dá)400 MHz，與正交調(diào)制器配合可輸出復(fù)雜的調(diào)制信號(hào)。

　　3 系統(tǒng)工作流程

　　系統(tǒng)初始化完成后，設(shè)備進(jìn)行加電自檢。自檢通過后由系統(tǒng)操作員進(jìn)行仿真場景文件加載，包括系統(tǒng)參數(shù)、目標(biāo)數(shù)量、軌跡、目標(biāo)特性等。啟動(dòng)仿真后，模擬系統(tǒng)中的寬帶和窄帶分系統(tǒng)是同時(shí)工作的，受基帶分系統(tǒng)中的DMU的控制，如圖6所示。

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