基于ISL5416的GPS／BD-2接收機(jī)DDC設(shè)計(jì)與實(shí)現(xiàn)

3 性能測(cè)試
本系統(tǒng)采用AD6645高速ADC采集數(shù)據(jù)，并將數(shù)據(jù)輸入ISL5416。通過(guò)XILINX公司的XC5VLX110，百萬(wàn)門級(jí)的FPGA接收DDC下變頻后數(shù)據(jù)。調(diào)試時(shí)，通過(guò)FPGA調(diào)試工具軟件ChipScope抓取FPGA內(nèi)ADC數(shù)據(jù)及ISL5416輸出的I、Q兩路數(shù)據(jù)。FPGA內(nèi)的DDC輸出I、Q數(shù)據(jù)如圖7所示。由圖可見，ISL5416正確地輸出了正交的I、Q兩路信號(hào)。

采用安捷倫信號(hào)發(fā)生器33250A產(chǎn)生67．52 MHz單頻正弦信號(hào)，在ADC采樣率為80 MHz時(shí)，采樣得到信號(hào)頻譜如圖8所示。信號(hào)經(jīng)ISL5416下變頻之后得到I、Q兩路數(shù)據(jù)，I、Q兩路數(shù)據(jù)合成的復(fù)信號(hào)頻譜如圖9所示。

從以上兩圖可以看出，67．52 MHz單頻正弦經(jīng)80 MHz采樣，ISL5416按上文所述的配置工作，頻譜搬移67．42 MHz，輸出正交的I、Q兩路信號(hào)，I、Q兩路信號(hào)的頻率為100 kHz，實(shí)現(xiàn)了頻譜的搬移，阻帶抑制符合要求，ISL5416正常工作，實(shí)現(xiàn)數(shù)字下變頻。

4 結(jié) 論
本文根據(jù)工程項(xiàng)目需求，結(jié)合4通道專用DDC芯片可靈活配置的特性，合理設(shè)計(jì)，將接收機(jī)中ADC采樣后的多載波中頻信號(hào)，通過(guò)DDC通道下變頻得到GPS和BD-2的I、Q數(shù)字基帶數(shù)據(jù)，以便后續(xù)的陣列信號(hào)處理及抗干擾算法研究。最終，使用8片DDC芯片ISL5416，實(shí)現(xiàn)了16陣元GP-S／BD-2接收機(jī)的DDC設(shè)計(jì)。由于此類接收機(jī)陣元數(shù)多，各通道結(jié)構(gòu)一致，采用專用DDC芯片節(jié)約成本，也避免了采用FPGA設(shè)計(jì)DDC時(shí)的重復(fù)設(shè)計(jì)。為軟件無(wú)線電在16陣元GPS／BD-2接收機(jī)的實(shí)現(xiàn)提供了解決方案，并具有較強(qiáng)的商用價(jià)值。