FPGA與單片機實現(xiàn)數(shù)據(jù)RS232串口通信的設計

圖2 FPGA數(shù)據(jù)發(fā)送時序仿真圖
圖中Din寫入值為3355H，波特率為2400Hz，Start信號始終置邏輯1，即隨時都能發(fā)送數(shù)據(jù)。Reset信號邏輯1時復位，邏輯0時電路開始工作。THR是數(shù)據(jù)寄存器，文件頭、數(shù)據(jù)長度以及數(shù)據(jù)位都先寄存到THR中，Len是數(shù)據(jù)長度，TSR是低8位數(shù)據(jù)幀寄存器，TSR1是高8位數(shù)據(jù)幀寄存器。數(shù)據(jù)長度Len定為02H，發(fā)送時先發(fā)送低8位55H，后發(fā)送高8位33H，一共發(fā)送兩遍。發(fā)送的數(shù)據(jù)格式說明：當發(fā)送55H時，其二進制為01010101，則發(fā)送的數(shù)據(jù)的二進制數(shù)為00101010111（1位開始位 8位數(shù)據(jù)位 1位奇校驗位 1位停止位）。
單片機部分先對FPGA發(fā)送過來的文件頭進行確認，正確就接收文件，否則放棄接收的數(shù)據(jù)。根據(jù)FPGA發(fā)送模塊的協(xié)議，對串口控制寄存器SCON和波特率控制寄存器PCON的設置即可實現(xiàn)。
3 總結
目前電子產(chǎn)品的開發(fā)中經(jīng)常要綜合運用EDA技術、計算機控制技術、數(shù)字信號處理技術，那么電路各部分經(jīng)常需要數(shù)據(jù)交換。本文也是基于此給出這方面應用的實例，供開發(fā)者交流。