基于CPCI總線的智能A／D，D／A模塊設(shè)計(jì)
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在工業(yè)控制領(lǐng)域，為了實(shí)現(xiàn)采集和控制功能，經(jīng)常會(huì)使用到A／D，D／A模塊。在實(shí)際使用中A／D，D／A模塊和主機(jī)之間通信方式可以有很多選擇。比如RS 232，RS 422，網(wǎng)絡(luò)等接口方式。在該設(shè)計(jì)中A／D，D／A模塊通過(guò)CPCI總線與主機(jī)通信，通過(guò)A／D接口采集數(shù)據(jù)，經(jīng)過(guò)伺服控制軟件處理，輸出模擬量驅(qū)動(dòng)執(zhí)行機(jī)構(gòu)。
從而實(shí)現(xiàn)一個(gè)閉環(huán)的控制。另外通過(guò)對(duì)DSP軟件的修改，該模塊還可以單獨(dú)實(shí)現(xiàn)A／D或者D／A功能。
該設(shè)計(jì)中A／D，D／A模塊具備以下功能：
(1)提供2路16位A／D，輸入信號(hào)范圍±5 V，精度要求小于士16 LSB；
(2)提供2路16位D／A，輸出信號(hào)范圍±5 V，精度要求小于土8 LSB，受系統(tǒng)復(fù)位控制；
(3)使用TI公司DSP(TMS320VC33)作為板載處理器，該DSP主要實(shí)現(xiàn)管理A／D和D／A、運(yùn)行控制算法、與主機(jī)通信功能，并受系統(tǒng)復(fù)位控制；
(4)DSP與主機(jī)采用雙口RAM(IDT7133)實(shí)現(xiàn)數(shù)據(jù)交換功能。
1 設(shè)計(jì)原理
如圖1硬件結(jié)構(gòu)框圖所示，該模塊采用TI公司高性能CPU器件TMS320VC33為核心。模塊通過(guò)PCI9052芯片與CPCI總線連接，PCI9052的本地總線的信號(hào)連接到雙口RAM的一端。雙口RAM的另一端通過(guò)電平緩沖器連接DSP。
DSP核心電路包括DSP芯片TMS320VC33、數(shù)據(jù)RAM CY7C1041VC33、程序FLASH芯片SST39VF800A組成；DSP的地址、數(shù)據(jù)、控制總線通過(guò)電平緩沖器件連接雙口RAM、A／D芯片、D／A芯片、CPLD。DSP通過(guò)雙口RAM芯片與主控計(jì)算機(jī)進(jìn)行數(shù)據(jù)交換；A／D芯片的初始化以及讀寫操作也由DSP負(fù)責(zé)完成；DSP控制D／A芯片輸出模擬信號(hào)；CPLD內(nèi)部主要實(shí)現(xiàn)組合邏輯功能，將DSP輸入的控制信號(hào)譯碼，然后輸出給雙口RAM以及A／D，D／A等功能芯片使用。
雙口RAM芯片是實(shí)現(xiàn)智能板的重要組成，由于DSP與主控計(jì)算機(jī)的地址空間資源是分別進(jìn)行獨(dú)立分配的，無(wú)法直接進(jìn)行互相訪問(wèn)，在兩者之間需要一個(gè)數(shù)據(jù)緩沖，雙口RAM的特點(diǎn)使其可以滿足這個(gè)要求。
2 實(shí)現(xiàn)方法
2．1 主要原器件選擇
在該設(shè)計(jì)中采用成熟技術(shù)，選用常用、可靠的控制芯片，結(jié)合一些常用的外圍電路和專用電路實(shí)現(xiàn)全部的功能。即選擇PC19052作為接口芯片，利用該芯片實(shí)現(xiàn)PCI總線從接口邏輯。
選擇TMS320VC33作為板載處理芯片，該芯片是TI公司推出的專門用于實(shí)現(xiàn)浮點(diǎn)運(yùn)算的高性能DSP，數(shù)據(jù)處理能力強(qiáng)，并且包含豐富的外圍電路擴(kuò)展接口。
為了實(shí)現(xiàn)模塊上的電平轉(zhuǎn)換功能，選擇應(yīng)用比較廣泛SN74ALVC164245DL作為電平轉(zhuǎn)換緩沖芯片。
2．2 PCI9052與雙口RAM硬件接口實(shí)現(xiàn)
如圖3所示PCI9052與雙口RAM連接的本地總線信號(hào)包括地址、數(shù)據(jù)、控制信號(hào)3個(gè)部分。地址總線寬度為12位，數(shù)據(jù)總線寬度為16位，因此尋址空間為2 KB的16 b地址空間?？刂菩盘?hào)包括讀寫控制信號(hào)和外設(shè)準(zhǔn)備完成信號(hào)，當(dāng)雙口RAM將外設(shè)準(zhǔn)備完成信號(hào)拉低后，主機(jī)就可以通過(guò)輸出讀寫控制信號(hào)對(duì)雙口RAM進(jìn)行讀寫的操作。
2．3 DSP設(shè)計(jì)核心電路設(shè)計(jì)
DSP是整個(gè)設(shè)計(jì)核心，DSP核心電路由DSP芯片、FLASH和RAM三個(gè)部分組成。DSP通過(guò)雙口RAM與處理計(jì)算機(jī)交換數(shù)據(jù)。
如圖3所示，DSP核心電路設(shè)計(jì)如下所述。DSP的電源包括核心工作電壓1．8 V與I／O電壓3．3 V兩種，分別由板上電源模塊提供。時(shí)鐘信號(hào)由外接晶振提供。復(fù)位信號(hào)由CPLD提供，由于DSP的I／O電壓為3．3 V，在與I／O電平標(biāo)準(zhǔn)為+5 V的信號(hào)連接時(shí)需要進(jìn)行3．3～5 V之間的電平轉(zhuǎn)換。中斷信號(hào)同樣通過(guò)電平轉(zhuǎn)換器件連接到CPLD。地址和數(shù)據(jù)總線根據(jù)實(shí)際設(shè)計(jì)的需要連接功能器件。JTAG接口連接到模塊的一個(gè)標(biāo)準(zhǔn)的雙列14腳直插連接器上。Page0～3信號(hào)通過(guò)電平轉(zhuǎn)換器件連接到CPLD。
評(píng)論