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基于EDMA的FPGA與DSP圖像傳輸?shù)脑O(shè)計(jì)與實(shí)現(xiàn)

作者: 時(shí)間:2012-02-24 來(lái)源:網(wǎng)絡(luò) 收藏

4 實(shí)驗(yàn)結(jié)果
提供給的時(shí)鐘為100 MHz,傳輸一幅320×256的圖像需要約為0.8 ms。傳輸速度較快,可以滿足圖像快速傳輸以及實(shí)時(shí)處理的要求。TI的開發(fā)平臺(tái)CCS可以觀察存儲(chǔ)器中的數(shù)據(jù),并把收到的存在存儲(chǔ)器中的數(shù)據(jù)顯示成圖像,從而可以驗(yàn)證傳輸?shù)恼_性以及穩(wěn)定性。數(shù)據(jù)源為模擬圖像時(shí),相機(jī)拍攝的原始圖像和收到的圖像如圖5和圖6所示。

本文引用地址:http://m.butianyuan.cn/article/190722.htm

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數(shù)據(jù)源為數(shù)字信號(hào)時(shí),原始圖像為14位數(shù)據(jù),TI的仿真平臺(tái)只能顯示8位圖像,所以中收到的圖像數(shù)據(jù)只能以高8位進(jìn)行顯示,但會(huì)丟掉圖像的一些細(xì)節(jié),圖像整體偏暗。由于系統(tǒng)采用的數(shù)字圖像由中波紅外熱像儀采集,由于視場(chǎng)差別,原始圖像無(wú)法采集。圖7為提取高8位圖像數(shù)據(jù)顯示的圖像。

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圖5~圖7中的圖像經(jīng)過(guò)多次傳輸驗(yàn)證,沒(méi)有出現(xiàn)錯(cuò)誤的圖像。說(shuō)明該系統(tǒng)實(shí)現(xiàn)的圖像數(shù)據(jù)傳輸滿足圖像實(shí)時(shí)處理的速度要求以及可靠性要求。

5 結(jié)束語(yǔ)
介紹了一種向DSP的數(shù)據(jù)傳輸方法,描述了的特點(diǎn)以及由其控制的數(shù)據(jù)傳輸?shù)膶?shí)現(xiàn)過(guò)程。所介紹的方法在開發(fā)的實(shí)驗(yàn)平臺(tái)上,進(jìn)行了驗(yàn)證。文中介紹了向DSP的傳輸,更改的源地址與目的地址及相關(guān)參數(shù)可以實(shí)現(xiàn)DSP向FPGA的數(shù)據(jù)傳輸。


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