基于FPGA的2M誤碼測試儀系統(tǒng)的設(shè)計(jì)方案

　　0 引言

　　無論是何種通信新業(yè)務(wù)的推出和運(yùn)營，都離不開強(qiáng)力有效且高可靠的傳輸系統(tǒng)。隨之而帶來的問題就是如何對系統(tǒng)的傳輸質(zhì)量進(jìn)行測量和保證。

　　誤碼測試儀是一種能夠測量和保證傳輸質(zhì)量的智能化儀器，該儀器可通過檢測來反映數(shù)據(jù)傳輸設(shè)備及其信道工作的誤碼損傷性能質(zhì)量指標(biāo)，并對其進(jìn)行傳輸質(zhì)量分析的有效工具。在電信運(yùn)營、工程驗(yàn)收、科研、設(shè)備生產(chǎn)、教學(xué)實(shí)驗(yàn)等各方面，誤碼儀都是必不可少的通信測量和線路維護(hù)的最佳輔助工具。目前在陜西省業(yè)務(wù)設(shè)備的接口應(yīng)用中，百分之九十以上的接口是2M的接口，比如：交換網(wǎng)絡(luò)上應(yīng)用、信令網(wǎng)上的應(yīng)用、數(shù)據(jù)網(wǎng)上的應(yīng)用、網(wǎng)管網(wǎng)上的應(yīng)用等，都使用了2M的數(shù)據(jù)。針對傳統(tǒng)誤碼儀的不足，本文給出了基于Altera公司的cyclone系列FPGA芯片EP1C12-240PQFP的2M誤碼測試儀的設(shè)計(jì)方案。基于FP- GA的誤碼測試儀相對于傳統(tǒng)的誤碼測試儀的優(yōu)點(diǎn)在于其FPGA的內(nèi)部邏輯功能是通過向內(nèi)部靜態(tài)存儲器單元加載配置數(shù)據(jù)來實(shí)現(xiàn)的。其配置文件決定了邏輯單元的邏輯功能以及模塊間或與I／O間的連接，并最終決定了FPGA所實(shí)現(xiàn)的功能。FPGA的這種結(jié)構(gòu)允許多次編程，并享有快速有效地對新設(shè)計(jì)進(jìn)行優(yōu)化的靈活性，故現(xiàn)今的通信系統(tǒng)大量采用FPGA作為系統(tǒng)的核心控制器件。本文重點(diǎn)介紹了FPGA內(nèi)核中序列發(fā)生模塊和序列接收模塊中核心內(nèi)容的設(shè)計(jì)。其中FPGA 內(nèi)核中m序列發(fā)生器的設(shè)計(jì)思想采用移位寄存器理論，并根據(jù)本原多項(xiàng)式來獲得m序列移位寄存器的反饋邏輯式：

其中cn-1-i∈GF(2)是反饋系數(shù)，xi∈GF(2)是每位寄存器的狀態(tài)。這樣，結(jié)合cyclone系列FPGA芯片EP1C12-240PQFP的結(jié)構(gòu)特點(diǎn)，就很容易實(shí)現(xiàn)反饋移位寄存器的邏輯功能。

　　1 誤碼測試系統(tǒng)的總體方案

　　誤碼一般是由通信系統(tǒng)中接收端抽樣判決器的錯誤判斷造成的，而造成錯誤判斷的原因主要有兩個：一是碼間串?dāng)_，另一個是信道加性噪聲的影響。誤碼測試儀存在兩種設(shè)計(jì)方案，一種是誤碼儀的發(fā)射端模塊和接收模塊兩部分獨(dú)立，可用于單工的通信系統(tǒng)性能測試。但是由于該系統(tǒng)的測試序列需要動態(tài)生成，所以，其能夠測試的系統(tǒng)碼速只能和FPGA控制模塊所能達(dá)到的速度相同。另一種方案是將發(fā)射端模塊和接收模塊結(jié)合在一個系統(tǒng)內(nèi)部，這樣能測試具有回環(huán)的通信系統(tǒng)，如雙工通信的收發(fā)設(shè)備等。本文設(shè)計(jì)屬于第二種方案，其誤碼測試系統(tǒng)框圖如圖1所示。圖中，發(fā)送端模塊產(chǎn)生的偽隨機(jī)序列作為通信系統(tǒng)的信源數(shù)據(jù)流流經(jīng)信道，接收端模塊則接收來自信道輸出的比特流，并將其與接收端模塊產(chǎn)生的與發(fā)送端模塊輸出類型相同的偽隨機(jī)序列進(jìn)行比較，從而完成誤碼測試。誤碼儀由發(fā)送端的序列發(fā)生器 1?？臁⒔邮斩说奈煌叫盘柼崛∧K、幀同步碼檢測模塊、序列發(fā)生器2模塊、誤碼分析模塊及外設(shè)接口構(gòu)成。其中位同步信號提取模塊的作用是獲得位定時同步脈沖。幀同步碼檢測模塊的作用是獲取幀同步信號，以使兩個序列能以同相位比較計(jì)算誤碼率。因?yàn)槿绻邮盏臏y試序列與序列發(fā)生器2模塊產(chǎn)生的序列兩者相位不同，則誤碼的測試結(jié)果將毫無意義。

　　2 系統(tǒng)硬件設(shè)計(jì)

　　2．1 系統(tǒng)硬件組成

　　根據(jù)誤碼測試儀器的功能要求，在本系統(tǒng)的硬件總體架構(gòu)中，將FPGA作為總控制器，并外擴(kuò)E1接口模塊，以用于實(shí)現(xiàn)碼型和波形的轉(zhuǎn)換，同時將FPGA輸出的NRZ碼型轉(zhuǎn)換成適合于在E1信道中傳輸?shù)腍DB3碼型，并將來自E1信道的HDB3碼轉(zhuǎn)換為NRZ碼送入FPGA中；E2PROM存儲模塊則可將誤碼分析模塊的誤碼測試結(jié)果進(jìn)行存儲，且掉電不丟失數(shù)據(jù)，并可隨時讀取，以便于在無人值守的情況下進(jìn)行誤碼測試；LCM顯示模塊是為了使用戶了解誤碼測試結(jié)果；RS232串口模塊則用于和PC機(jī)通訊，上傳誤碼檢測結(jié)果，以便于從PC機(jī)上看到一段時間內(nèi)誤碼率曲線圖及其它誤碼信息，使用戶了解通信系統(tǒng)的誤碼發(fā)生情況；此外，系統(tǒng)還外擴(kuò)有鍵盤、電源管理模塊、時鐘電路、JTAG下載口和AS下載口。