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堆疊硅片互聯(lián)技術(shù)的可行性

  • 1. 概要 　　為盡早推出 28nm 高容量 FPGA 產(chǎn)品，賽靈思 (Xilinx) 通過(guò)以下工作滿(mǎn)足了關(guān)鍵需求：
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FAQ-堆疊硅片互聯(lián)技術(shù)問(wèn)題解答

  • 1. 賽靈思今天宣布推出什么產(chǎn)品? 　　賽靈思采用了稱(chēng)之為“堆疊硅片互聯(lián)技術(shù)”的 3D 封裝方法，該技術(shù)采用無(wú)源芯片中介層、微凸塊和硅通孔 (TSV)技術(shù)，實(shí)現(xiàn)了多芯片可編程平臺(tái)。對(duì)于那些需要高密度晶體管和邏輯、以及需要極大的處理能力和帶寬性能的市場(chǎng)應(yīng)用而言，這些28nm平臺(tái)和單芯片方法相比，將提供更大的容量，更豐富的資源，并顯著降低功耗。
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Virtex-7 2000T與SSI技術(shù)常見(jiàn)問(wèn)題解答

  • 賽靈思推出世界最大容量 FPGA，將業(yè)界晶體管數(shù)量紀(jì)錄翻了一番
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FAQ-賽靈思7系列FPGA常見(jiàn)問(wèn)題解答

  • 賽靈思 (Xilinx) 宣布推出的是其 7 系列 FPGA，這一全新的產(chǎn)品系列建立在業(yè)界最低功耗和業(yè)界唯一一款可滿(mǎn)足從低成本到超高端不同產(chǎn)品系列擴(kuò)展的統(tǒng)一 FPGA 架構(gòu)之上。全新的 28nm Artix?-7、Kintex?-7 和 Virtex?-7 系列將功耗效率、性能/容量以及性?xún)r(jià)比等方面的突破性創(chuàng)新技術(shù)與無(wú)與倫比的可擴(kuò)展性和生產(chǎn)率完美結(jié)合在一起，大大加強(qiáng)了賽靈思目標(biāo)設(shè)計(jì)平臺(tái)的戰(zhàn)略?xún)?yōu)勢(shì)，從而使更廣泛的用戶(hù)社群、市場(chǎng)和應(yīng)用都能更方便地利用可編程邏輯。
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基于FPGA的AMLCD控制器的設(shè)計(jì)

  • 飛機(jī)座艙圖形顯示系統(tǒng)已發(fā)展到第六代，即采用有源矩陣彩色液晶顯示器AMLCD（ActiveMatrixLiquidCrystalDisplay）。當(dāng)前高分辨率的軍用AMLCD顯示模塊還只能依靠進(jìn)口，且控制電路板須安裝在該顯示模塊提供的機(jī)箱內(nèi)。這
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FAQ-賽靈思28nm FPGA常見(jiàn)問(wèn)題解答

  • 1、什么是賽靈思7系列產(chǎn)品? 　　賽靈思7系列三款FPGA基于高性能，低功耗HPL28nm工藝，且建立在行業(yè)最低功耗和唯一統(tǒng)一架構(gòu)之上，可以提供突破性的功耗，性能及設(shè)計(jì)可移植性。這種創(chuàng)新的架構(gòu)使得設(shè)計(jì)方案可以在7系列的三大產(chǎn)品Artix-7, Kintex-7以及 Virtex-7方便的進(jìn)行移植。系統(tǒng)制造商可以非常容易的成功實(shí)現(xiàn)規(guī)模設(shè)計(jì)以滿(mǎn)足市場(chǎng)需求，同時(shí)降低成本和功耗，增加系統(tǒng)性能和容量。采用AMBA4 AXI4 作為互聯(lián)支持即插即用FPGA設(shè)計(jì)，IP復(fù)用進(jìn)一步提高了生產(chǎn)率，可移植性以及精確性。
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FAQ-Virtex-7HT常見(jiàn)問(wèn)題解答

  • 1. 賽靈思將發(fā)布內(nèi)容是什么? 　　賽靈思將發(fā)布 Virtex-7 HT FPGA，該產(chǎn)品在單片 FPGA 中集成了業(yè)界最多數(shù)量的串行收發(fā)器—16個(gè) 28Gbps 和72個(gè) 13.1Gbps 串行收發(fā)器，能夠滿(mǎn)足 100Gbps 和 400Gbps 帶寬應(yīng)用的需要。如欲觀看賽靈思 28Gbps 收發(fā)器的演示視頻，請(qǐng)?jiān)L問(wèn)：http://www.xilinx.com/cn/28gbps。 在該視頻中，信號(hào)完整性專(zhuān)家 Howard Johnson 博士對(duì) Virtex-7 HT FPGA 的 28Gbps
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基于FPGA實(shí)現(xiàn)VLIW微處理器

  • 超長(zhǎng)指令字VLIW微處理器架構(gòu)采用了先進(jìn)的清晰并行指令設(shè)計(jì)。VLIW微處理器的最大優(yōu)點(diǎn)是簡(jiǎn)化了處理器的結(jié)構(gòu)，刪除了處理器內(nèi)部許多復(fù)雜的控制電路，它能從應(yīng)用程序中提取高度并行的指令數(shù)據(jù)，并把這些機(jī)器指令均勻地分
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基于FPGA的并行掃頻DDS的實(shí)現(xiàn)

  • DDS同 DSP（數(shù)字信號(hào)處理）一樣，是一項(xiàng)關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器（Direct Digital Synthesizer）的英文縮寫(xiě)。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時(shí)間等優(yōu)點(diǎn)，廣
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一種浮點(diǎn)反正切函數(shù)的FPGA設(shè)計(jì)和實(shí)現(xiàn)

  • 快速精確的反正弦函數(shù)運(yùn)算在現(xiàn)代工程中應(yīng)用廣泛。為了提高反正弦函數(shù)的精度和計(jì)算能力， 研究了基于CORD IC算法的反正弦函數(shù)運(yùn)算器的FPGA 實(shí)現(xiàn)， 并通過(guò)改進(jìn)算法減小了誤差， 使誤差精度達(dá)到10--4 數(shù)量級(jí)。并在X ili
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MELP混合線(xiàn)性碼激勵(lì)的FPGA實(shí)現(xiàn)的系統(tǒng)框架介紹

  • 利用語(yǔ)音編碼技術(shù)可有效降低信息存儲(chǔ)量、提高信道利用率。混合激勵(lì)線(xiàn)性預(yù)測(cè)(MELP)語(yǔ)音編碼算法能在較低碼率下提供較高的語(yǔ)音質(zhì)量、自然度和清晰度，已成為美國(guó)國(guó)防部新的2.4 Kb/s的語(yǔ)音編碼標(biāo)準(zhǔn)。語(yǔ)音編碼技術(shù)在當(dāng)今
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詳解單片機(jī)系統(tǒng)的動(dòng)態(tài)加密技術(shù)

基于單片機(jī)實(shí)現(xiàn)SRAM工藝FPGA的加密應(yīng)用

  • 摘要：首先對(duì)采用SRAM工藝的FPGA的保密性和加密方法進(jìn)行原理分析，然后提出一種實(shí)用的采用單片機(jī)產(chǎn)生長(zhǎng)偽隨機(jī)碼 ...
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FPGA與DSP：競(jìng)合中縮小差距

  • DSP和FPGA由于各有優(yōu)缺點(diǎn)，因而各有擅長(zhǎng)的應(yīng)用領(lǐng)域。近年來(lái)，F(xiàn)PGA在與DSP的競(jìng)合中，在降低開(kāi)發(fā)難度、提高設(shè)計(jì)流程的生產(chǎn)效率方面做了大量工作，逐步縮小了與DSP的差距。
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以FPGA為核心的多功能輸液系統(tǒng)的設(shè)計(jì)

  • 今朝，病院輸液現(xiàn)場(chǎng)一般是人工節(jié)制和看管，但輸液速度和輸液量是一個(gè)很難切確把握的值，護(hù)士經(jīng)由過(guò)程動(dòng)彈輸液器上...
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