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低成本人機(jī)交互設(shè)計(jì)：基于FPGA的體感游戲

  • 體感游戲是視覺(jué)與本體感覺(jué)和動(dòng)作控制的集合，伴隨著虛擬現(xiàn)實(shí)技術(shù)的迅猛發(fā)展，正逐步走入市場(chǎng)。為了達(dá)到視覺(jué)、運(yùn)動(dòng)相結(jié)合的目的，采用加速度傳感器與VGA顯示器相結(jié)合的方法，通過(guò)戴有速度手套的手的運(yùn)動(dòng)來(lái)完成對(duì)游戲
  • 關(guān)鍵字： 加速度傳感器    FPGA    VGA    體感游戲  

PID算法的FPGA實(shí)現(xiàn)

  • 1.引言在許多現(xiàn)代化的工業(yè)生產(chǎn)如冶金、電力等，實(shí)現(xiàn)對(duì)溫度的精度控制至關(guān)重要的，不僅直接影響著產(chǎn)品的質(zhì)量，而且還關(guān)系到生產(chǎn)安全、能源節(jié)約等一系列重大經(jīng)濟(jì)指標(biāo)。PID控制由于其魯棒性好，可靠性高，在常規(guī)的溫度
  • 關(guān)鍵字： FPGA    PID算法  

基于指紋識(shí)別的大學(xué)生體育鍛煉管理系統(tǒng)

  • 一、項(xiàng)目概述1.1 引言人的指紋是生物特征之一。指紋識(shí)別是生物識(shí)別技術(shù)中最為成熟的, 其唯一性、穩(wěn)定性, 一直都被視為身份鑒別的可靠手段之一。在當(dāng)今大學(xué)生活中，大學(xué)生的身體素質(zhì)逐漸達(dá)不到標(biāo)準(zhǔn)，需要學(xué)校引導(dǎo)學(xué)
  • 關(guān)鍵字： 指紋識(shí)別  FPGA  傳感器  特征點(diǎn)提取  

使用FPGA實(shí)現(xiàn)高效并行實(shí)時(shí)上采樣

  • 采樣就是采集模擬信號(hào)的樣本。通常采樣指的是下采樣，也就是對(duì)信號(hào)的抽取。其實(shí)，上采樣和下采樣都是對(duì)數(shù)字信號(hào)進(jìn)行重采，重采的采樣率與原來(lái)獲得該數(shù)字信號(hào)的采樣率比較，大于原信號(hào)的稱為上采樣，小于的則稱為下采
  • 關(guān)鍵字： FPGA    上采樣    FIR濾波器  

基于AGC算法的音頻信號(hào)處理方法及FPGA實(shí)現(xiàn)

  • 隨著現(xiàn)代通信技術(shù)的廣泛使用，通信企業(yè)問(wèn)的競(jìng)爭(zhēng)不斷加劇，為提升自身的競(jìng)爭(zhēng)優(yōu)勢(shì)，通信企業(yè)需要將其通信信號(hào)的質(zhì)量提升，并提高通信系統(tǒng)各項(xiàng)指標(biāo)的穩(wěn)定性、安全性、高效性。在音頻信號(hào)處理方法及FPGA實(shí)現(xiàn)中，采用AGC
  • 關(guān)鍵字： AGC  FPGA  音頻信號(hào)處理  

等效時(shí)間采樣原理及基于FPGA的實(shí)現(xiàn)

  • 在現(xiàn)代電子測(cè)量、通訊系統(tǒng)以及生物醫(yī)學(xué)等領(lǐng)域，經(jīng)常涉及對(duì)寬帶模擬信號(hào)進(jìn)行數(shù)據(jù)采集和存儲(chǔ)，以便計(jì)算機(jī)進(jìn)一步進(jìn)行數(shù)據(jù)處理。為了對(duì)高速模擬信號(hào)進(jìn)行不失真采集，根據(jù)奈奎斯特定理，采樣頻率必須為信號(hào)頻率的2倍以上，
  • 關(guān)鍵字： 數(shù)據(jù)采集  變頻   FPGA  等效時(shí)間采樣  寬帶模擬信號(hào)  

基于FPGA的振動(dòng)信號(hào)采集系統(tǒng)設(shè)計(jì)及實(shí)現(xiàn)

  • 針對(duì)機(jī)械設(shè)備運(yùn)行中的振動(dòng)監(jiān)控，設(shè)計(jì)振動(dòng)信號(hào)采集系統(tǒng)，提出了一種基于FPGA的振動(dòng)信號(hào)采集系統(tǒng)的設(shè)計(jì)方案。重點(diǎn)闡述了系統(tǒng)硬件結(jié)構(gòu)組成、信號(hào)調(diào)理電路和數(shù)據(jù)采集模塊的設(shè)計(jì)，同時(shí)對(duì)A/D采樣的控制邏輯進(jìn)行了討論。經(jīng)試驗(yàn)驗(yàn)證表明，該系統(tǒng)可達(dá)到采樣率10 K每秒、采集精度16位，能夠滿足實(shí)時(shí)性和精度要求。
  • 關(guān)鍵字： 加速度傳感器  振動(dòng)信號(hào)  信號(hào)采集  FPGA  

基于DSP Builder的CIC梳狀濾波器的設(shè)計(jì)

  • 摘要：CIC梳狀濾波器具有結(jié)構(gòu)簡(jiǎn)單、規(guī)整，占用存儲(chǔ)量小，不需要乘法器，實(shí)現(xiàn)簡(jiǎn)單且速度高等特點(diǎn)，在高速抽取或插值系統(tǒng)應(yīng)用廣泛。采用DSP Builder軟件工具，在Simulink平臺(tái)上構(gòu)建了一級(jí)4階CIC梳狀濾波器仿真模型，通
  • 關(guān)鍵字： DSP Builder  FPGA  CIC梳狀濾波器  仿真模型  

便攜式邏輯分析儀的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要 介紹一種16通道便攜式邏輯分析儀，通過(guò)FPGA將高速數(shù)據(jù)采樣并緩存，采用USB控制芯片和FPCA協(xié)同控制將數(shù)據(jù)通過(guò)USB接口發(fā)送到電腦的上位機(jī)上顯示，簡(jiǎn)化了以往邏輯分析儀硬件電路部分，降低了邏輯分析儀的成本且便
  • 關(guān)鍵字： 邏輯分析儀  USB接口  FPGA  FIFO傳輸  

基于VHDL的洗衣機(jī)控制器的設(shè)計(jì)

  • 摘要：為降低設(shè)計(jì)成本，縮短設(shè)計(jì)周期，提出一種基于VHDL的洗衣機(jī)控制器的設(shè)計(jì)方案。該方案采用模塊化的設(shè)計(jì)思想，并使用狀態(tài)機(jī)完成控制模塊的設(shè)計(jì)。整個(gè)系統(tǒng)在QuartusⅡ開(kāi)發(fā)平臺(tái)上完成設(shè)計(jì)、編譯和仿真，并在FPGA硬件
  • 關(guān)鍵字： 洗衣機(jī)控制器  狀態(tài)機(jī)  FPGA  VHDL  QuartusⅡ  

基于FPGA的水聲信號(hào)采集與存儲(chǔ)系統(tǒng)設(shè)計(jì)

  • 摘要：為實(shí)現(xiàn)對(duì)水聲信號(hào)的多通道同步采集并存儲(chǔ)，提出了一種基于FPGA的多通道信號(hào)同步采集、高速大容量實(shí)時(shí)存儲(chǔ)的系統(tǒng)設(shè)計(jì)方案，并完成系統(tǒng)的軟硬件設(shè)計(jì)。該系統(tǒng)的硬件部分采用模塊化設(shè)計(jì)，通過(guò)FPGA豐富的外圍接口實(shí)
  • 關(guān)鍵字： FPGA  水聲信號(hào)  同步采集  高速存儲(chǔ)  

使用新型 Virtex FPGA 開(kāi)發(fā)小型軟件無(wú)線電平臺(tái)：SFF SDR

  • SFF SDR(小型軟件定義無(wú)線電)開(kāi)發(fā)平臺(tái)是一種模塊化的 RF/IF/基帶平臺(tái)(圖 1 和圖 2)。該平臺(tái)展示了 Xilinx 和德州儀器 (Texas Instruments, TI) 的最新芯片產(chǎn)品以及最新高級(jí)設(shè)計(jì)流程和軟件架構(gòu)。 這個(gè)平臺(tái)還為手持設(shè)備
  • 關(guān)鍵字： Virtex  FPGA  SFF  SDR    

能實(shí)現(xiàn)360度無(wú)死角的最牛安全駕駛汽車環(huán)視系統(tǒng)設(shè)計(jì)

  • 一. 項(xiàng)目概述隨著當(dāng)前國(guó)民經(jīng)濟(jì)的快速發(fā)展和人民生活水平的提高，越來(lái)越多的家庭擁有汽車作為代步工具，如何安全便捷地泊好車成為了眾多駕駛者共
  • 關(guān)鍵字： Xilinx  FPGA  安全駕駛  汽車環(huán)視  

通過(guò)FPGA設(shè)計(jì)安全的高級(jí)輔助駕駛系統(tǒng)

  • 隨著道路上汽車數(shù)量的增加，我們需要更多的技術(shù)來(lái)進(jìn)一步減少交通事故。過(guò)去幾年，基于雷達(dá)和攝像機(jī)的新系統(tǒng)功能的出現(xiàn)使駕駛更加安全。很多高級(jí)輔助駕駛系統(tǒng)(ADAS)應(yīng)用，如自動(dòng)巡航控制、道路偏離報(bào)警、交通信號(hào)標(biāo)志
  • 關(guān)鍵字： FPGA  駕駛系統(tǒng)  汽車電子  

基于MSP430與FPGA的多功能數(shù)字頻率儀設(shè)計(jì)*

  • 本文采用以FPGA為主，MSP430為輔的框架系統(tǒng)處理方式設(shè)計(jì)了多功能數(shù)字頻率儀。該裝置采用低頻直接測(cè)周期，高頻等精度多周期同步測(cè)量的方法，通過(guò)進(jìn)一步優(yōu)化標(biāo)準(zhǔn)時(shí)鐘頻率的設(shè)置，克服了傳統(tǒng)測(cè)頻方法在高精度要求方面的缺陷。將MSP430作為控制處理核心、FPGA作為信號(hào)處理單元，將高效控制與快速運(yùn)算能力相結(jié)合，實(shí)現(xiàn)正弦波頻率、兩路方波信號(hào)時(shí)間間隔以及矩形脈沖占空比的測(cè)量。測(cè)試表明，該裝置具有高精度、高穩(wěn)定性、裝配簡(jiǎn)易和操作便利的特點(diǎn)。
  • 關(guān)鍵字： 多周期同步測(cè)量  標(biāo)準(zhǔn)時(shí)鐘頻率  占空比  FPGA  MSP430  201611  
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