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基于VHDL的洗衣機(jī)控制器的設(shè)計(jì)

  • 摘要:為降低設(shè)計(jì)成本,縮短設(shè)計(jì)周期,提出一種基于VHDL的洗衣機(jī)控制器的設(shè)計(jì)方案。該方案采用模塊化的設(shè)計(jì)思想,并使用狀態(tài)機(jī)完成控制模塊的設(shè)計(jì)。整個(gè)系統(tǒng)在QuartusⅡ開發(fā)平臺(tái)上完成設(shè)計(jì)、編譯和仿真,并在FPGA硬件
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基于FPGA的數(shù)字電子鐘設(shè)計(jì)

  • 摘要:采用FPGA進(jìn)行的數(shù)字電路設(shè)計(jì)具有更大的靈活性和通用性,已成為目前數(shù)字電路設(shè)計(jì)的主流方法之一。本文給出一種基于FPGA的數(shù)字鐘設(shè)計(jì)方案。該方案采用VHDL設(shè)計(jì)底層模塊,采用電路原理圖設(shè)計(jì)頂層系統(tǒng)。整個(gè)系統(tǒng)在
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基于CMOS或CCD圖像傳感器的經(jīng)典設(shè)計(jì)及技術(shù)文獻(xiàn)匯總

  •   圖像傳感器,或稱感光元件,是一種將光學(xué)圖像轉(zhuǎn)換成電子信號(hào)的設(shè)備,它被廣泛地應(yīng)用在數(shù)碼相機(jī)和其他電子光學(xué)設(shè)備中。早期的圖像傳感器采用模擬信號(hào),如攝像管(video camera tube)。如今,圖像傳感器主要分為感光耦合元件(charge-coupled device, CCD)和互補(bǔ)式金屬氧化物半導(dǎo)體有源像素傳感器(CMOS Active pixel sensor)兩種。本文介紹基于CMOS或CCD兩種圖像傳感器的應(yīng)用及技術(shù)文獻(xiàn),供大家參考。   基于USB傳輸及CMOS圖像傳感器的指紋識(shí)別儀的實(shí)
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基于FPGA的數(shù)字日歷設(shè)計(jì)

  •   基于FPGA設(shè)計(jì)數(shù)字日歷可以實(shí)現(xiàn)以軟件方式設(shè)計(jì)硬件的目的,無需購(gòu)買專用數(shù)字芯片,從而克服了傳統(tǒng)利用多片數(shù)字集成電路設(shè)計(jì)數(shù)字日歷存在焊接麻煩、調(diào)試繁瑣、成本較高等問題。而且,基于FPGA的數(shù)字日歷與傳統(tǒng)系統(tǒng)相比,在設(shè)計(jì)靈活、開發(fā)速度、降低成本、計(jì)時(shí)精度、功能實(shí)現(xiàn)上都得到大幅度提升,能夠更好地滿足人們?nèi)粘I畹男枰?   本文介紹如何利用VHDL硬件描述語言設(shè)計(jì)一個(gè)具有年、月、日、星期、時(shí)、分、秒計(jì)時(shí)顯示功能,時(shí)間調(diào)整功能和整點(diǎn)報(bào)時(shí)功能的數(shù)字日歷。在QuartusⅡ開發(fā)環(huán)境下,采用自頂向下的設(shè)計(jì)方法,建
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基于VHDL和QuartusⅡ的數(shù)字電子鐘設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要:采用FPGA進(jìn)行的數(shù)字電路設(shè)計(jì)具有更大的靈活性和通用性,已成為目前數(shù)字電路設(shè)計(jì)的主流方法之一。本文給出一種基于FPGA的數(shù)字鐘設(shè)計(jì)方案。該方案采用VHDL設(shè)計(jì)底層模塊,采用電路原理圖設(shè)計(jì)頂層系統(tǒng)。整個(gè)系統(tǒng)在QuartusⅡ開發(fā)平臺(tái)上完成設(shè)計(jì)、編譯和仿真,并在FPGA硬件實(shí)驗(yàn)箱上進(jìn)行測(cè)試。測(cè)試結(jié)果表明該設(shè)計(jì)方案切實(shí)可行。 EDA(Electronic Design Automation)又名電子設(shè)計(jì)自動(dòng)化,其基本特征是:以超大規(guī)??删幊踢壿嬈骷鏔PGA,為設(shè)計(jì)載體,以硬件描述語言,如VHDL,為
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基于FPGA的模糊PID控制器設(shè)計(jì)

  • 針對(duì)實(shí)現(xiàn)傳統(tǒng)模糊PID控制器時(shí),需要建立比例、積分和微分三個(gè)模糊控制器,存在模糊規(guī)則較繁雜、運(yùn)算量大、速度慢等問題,提出了以PD模糊控制器代替P1模糊控制器,采用兩個(gè)PD模糊控制器,并引入FPGA技術(shù),實(shí)現(xiàn)模糊PID控制器。通過QuartusⅡ和Matlab聯(lián)合仿真,比較了基于FBC和SBC實(shí)現(xiàn)的模糊PID控制器的控制效果,驗(yàn)證了設(shè)計(jì)方案的正確性和可行性。
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FPGA技術(shù)在雷達(dá)信號(hào)模擬器中的應(yīng)用

  • 摘要:基于FPGA的各種雷達(dá)信號(hào)產(chǎn)生方法,介紹了在FPGA中實(shí)現(xiàn)直接數(shù)字頻率合成器(DDS)以及提高輸出信號(hào)...
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FPGA系統(tǒng)內(nèi)部邏輯在線測(cè)試技術(shù)研究

  •   1 引言   隨著FPGA向低成本、低功耗、高性能方向發(fā)展,其I/O引腳大多采用微間距TOFP或BGA封裝工藝,因而使引出多種內(nèi)部信號(hào)的I/O引腳以及FPGA的驗(yàn)證工作變得非常困難,同時(shí)FPGA的驗(yàn)證和調(diào)試耗時(shí)占總開發(fā)時(shí)間的50%以上。   在驗(yàn)證和調(diào)試系統(tǒng)時(shí),傳統(tǒng)上是把信號(hào)線引到I/O引腳,然后采用示波器、邏輯分析儀或總線分析儀進(jìn)行測(cè)量和分析。由于這些設(shè)備相當(dāng)昂貴,而且調(diào)試時(shí)又需要許多連線夾,因此一不小心就會(huì)燒壞器件或電路板。   伴隨著EDA 工具的快速發(fā)展,Altera公司在Quartus
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基于DSP Builder的FIR濾波器的設(shè)計(jì)與實(shí)現(xiàn)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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quartusⅡ介紹

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