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EEPW首頁(yè) >> 主題列表 >> 串并轉(zhuǎn)換

FPGA系統(tǒng)設(shè)計(jì)原則和技巧之：FPGA系統(tǒng)設(shè)計(jì)的3種常用技巧

  • 輸入的數(shù)據(jù)經(jīng)過(guò)選擇開(kāi)關(guān)后，分別進(jìn)入緩沖模塊1和緩沖模塊2。當(dāng)數(shù)據(jù)寫入緩沖模塊1的時(shí)候，數(shù)據(jù)處理單元從緩沖模塊2讀取數(shù)據(jù)進(jìn)行處理；當(dāng)數(shù)據(jù)寫入緩沖模塊2的時(shí)候，數(shù)據(jù)處理單元從緩沖區(qū)模塊1讀取數(shù)據(jù)進(jìn)行處理。
  • 關(guān)鍵字： FPGA系統(tǒng)設(shè)計(jì)  緩沖模塊  乒乓操作  串并轉(zhuǎn)換  流水線處理  

D／A轉(zhuǎn)換在System View環(huán)境下的仿真及硬件實(shí)現(xiàn)

  • 摘要 針對(duì)模擬信號(hào)在傳輸介質(zhì)中優(yōu)于數(shù)字信號(hào)，而設(shè)計(jì)數(shù)模轉(zhuǎn)換模塊。首先用System View對(duì)DAC模塊進(jìn)了仿真。然后設(shè)計(jì)的D/A轉(zhuǎn)換的硬件電路。通過(guò)設(shè)計(jì)了一個(gè)前置的串并轉(zhuǎn)換電路，不僅可以實(shí)現(xiàn)8位并行數(shù)字信號(hào)的D/A轉(zhuǎn)換，
  • 關(guān)鍵字： 權(quán)電流  串并轉(zhuǎn)換  低通濾波  

基于FPGA的雙通道汽車渦輪增壓葉片溫度采集卡研制

  • 摘要：一種應(yīng)用于汽車渦輪增壓器葉片溫度檢測(cè)的雙通道數(shù)據(jù)采集卡，該卡由峰值檢測(cè)、串行A/D構(gòu)成模擬電路和由FPGA構(gòu)成整個(gè)數(shù)字電路而組成。重點(diǎn)設(shè)計(jì)了FPGA內(nèi)部串并轉(zhuǎn)換電路和FIFO，經(jīng)仿真和實(shí)驗(yàn)驗(yàn)證，串并轉(zhuǎn)換和FIFO的
  • 關(guān)鍵字： FPGA  串并轉(zhuǎn)換  FIFO  仿真  

基于CPLD的串并轉(zhuǎn)換和高速USB通信設(shè)計(jì)

  • 濾波和抗干擾是任何智能儀器系統(tǒng)都必須考慮的問(wèn)題。在傳統(tǒng)的應(yīng)用系統(tǒng)中，濾波部分往往要占用較多的軟件資源和硬件資源。復(fù)雜可編程邏輯器件(CPLD)的出現(xiàn)，為解決這一問(wèn)題開(kāi)辟了新的途徑，采用CPLD實(shí)現(xiàn)濾波是一種高效
  • 關(guān)鍵字： CPLD  USB  串并轉(zhuǎn)換  通信設(shè)計(jì)    

四種常用FPGA/CPLD設(shè)計(jì)思想與技巧

STM-1并行幀同步系統(tǒng)的設(shè)計(jì)與FPGA實(shí)現(xiàn)

四種常用FPGA/CPLD設(shè)計(jì)思想與技巧之流水線操作

四種常用FPGA/CPLD設(shè)計(jì)思想與技巧之串并轉(zhuǎn)換

AT24系列存儲(chǔ)器數(shù)據(jù)串并轉(zhuǎn)換接口的IP核設(shè)計(jì)

  • 介紹用VHDL語(yǔ)言設(shè)計(jì)該存儲(chǔ)器數(shù)據(jù)串并轉(zhuǎn)換接口的IP核，從而通過(guò)硬件（FPGA或其他可編程芯片）實(shí)現(xiàn)AT24系列存儲(chǔ)器與8位微處理器之間的并行通信。
  • 關(guān)鍵字： AT  24  存儲(chǔ)器數(shù)據(jù)  串并轉(zhuǎn)換    
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串并轉(zhuǎn)換介紹

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