半實(shí)物仿真文章進(jìn)入半實(shí)物仿真技術(shù)社區(qū)

基于VeriStand的制導(dǎo)系統(tǒng)半實(shí)物仿真平臺(tái)的研究

為保證制導(dǎo)系統(tǒng)半實(shí)物仿真的實(shí)時(shí)性和準(zhǔn)確性，縮短開(kāi)發(fā)周期，本文基于VeriStand、Simulink和PharLap組合方式構(gòu)建實(shí)時(shí)仿真平臺(tái)。該平臺(tái)通過(guò)VeriStand實(shí)現(xiàn)對(duì)仿真模型的在線管理和仿真試驗(yàn)的控制，以及對(duì)模型參數(shù)的在線顯示和修改;采用PharLap實(shí)時(shí)操作系統(tǒng)保證仿真模型執(zhí)行的實(shí)時(shí)性，通過(guò)Simulink對(duì)系統(tǒng)進(jìn)行建模，達(dá)到快速仿真設(shè)計(jì)、降低開(kāi)發(fā)周期、弱化人為影響的目的。制導(dǎo)半實(shí)物仿真試驗(yàn)表明：仿真平臺(tái)工作可靠，實(shí)時(shí)性能好，能夠提高半實(shí)物仿真試驗(yàn)的開(kāi)發(fā)效率和可靠性。
關(guān)鍵字： VeriStand 制導(dǎo)系統(tǒng) 半實(shí)物仿真 Simulink建模 201709

提出了一種基于FPGA的雷達(dá)回波實(shí)時(shí)模擬器的實(shí)現(xiàn)方法。該模擬器采用cPCI標(biāo)準(zhǔn)總線，以FPGA為核心計(jì)算單元，配有高速數(shù)模、模數(shù)轉(zhuǎn)換模塊，可實(shí)現(xiàn)雷達(dá)回波信號(hào)實(shí)時(shí)在線注入模擬。該模擬器可實(shí)現(xiàn)多種體制下復(fù)雜回波的模擬，具有很好的工程應(yīng)用價(jià)值。
關(guān)鍵字：雷達(dá)回波實(shí)時(shí)模擬器半實(shí)物仿真 FPGA

半實(shí)物仿真作為仿真技術(shù)的一個(gè)分支，是工程領(lǐng)域內(nèi)一種應(yīng)用較為廣泛的仿真技術(shù)，是計(jì)算機(jī)仿真回路中接入一些實(shí)物進(jìn)行的試驗(yàn)。半實(shí)物仿真是一種通俗的稱(chēng)謂，其準(zhǔn)確的意義是實(shí)物在回路中的仿真，國(guó)際上通稱(chēng)為“Ha
關(guān)鍵字：半實(shí)物仿真 PXI總線多用戶終端模擬器碼分多址

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