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Altera宣布其Cyclone III FPGA提供對(duì)EtherCAT IP支持

　　Altera公司日前宣布為EtherCAT技術(shù)協(xié)會(huì)的EtherCAT協(xié)議提供知識(shí)產(chǎn)權(quán)(IP)支持。此前IP是針對(duì)Cyclone® II器件，現(xiàn)在將針對(duì)Altera新的低成本、低功耗Cyclone III FPGA。　　EtherCAT技術(shù)協(xié)會(huì)執(zhí)行總監(jiān)Martin Rostan說：“在競爭非常激烈的工廠自動(dòng)化設(shè)備市場上，企業(yè)正在尋找能夠迅速突出產(chǎn)品優(yōu)勢的新功能和特性。Cyclone III FPGA實(shí)現(xiàn)對(duì)EtherCAT的支持，使設(shè)計(jì)人員能夠以高性價(jià)比方式，輕松加入實(shí)時(shí)以太網(wǎng)功能?！? 　　
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利用FPGA實(shí)現(xiàn)UART的設(shè)計(jì)

引言　　隨著計(jì)算機(jī)技術(shù)的發(fā)展和廣泛應(yīng)用，尤其是在工業(yè)控制領(lǐng)域的應(yīng)用越來越廣泛，計(jì)算機(jī)通信顯的尤為重要。串行通信雖然使設(shè)備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計(jì)數(shù)等問題，這使串行通信技術(shù)比并行通信技術(shù)更為復(fù)雜。串／并轉(zhuǎn)換可用軟件實(shí)現(xiàn)，也可用硬件實(shí)現(xiàn)。用軟件實(shí)現(xiàn)串行傳送大多采用循環(huán)移位指令將一個(gè)字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時(shí)間，影響系統(tǒng)的性能。更為方便的實(shí)現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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基于雙嵌入式處理器的高清數(shù)字電視設(shè)計(jì)

　　1 引言　　隨著數(shù)字傳輸技術(shù)和圖像處理技術(shù)的提高，電視技術(shù)正逐步從SDTV（Standard Definition TV，標(biāo)準(zhǔn)清晰度電視）過渡到HDTV（High Definition TV，高清晰度電視）。高清數(shù)字電視符合人們對(duì)高品質(zhì)的數(shù)字多媒體播放和高性能的網(wǎng)絡(luò)信息終端的需要，具備廣闊的市場前景，其基于嵌入式系統(tǒng)技術(shù)的實(shí)現(xiàn)也成為嵌入式領(lǐng)域的新熱點(diǎn)[1-2]。　　高清電視是指播放畫質(zhì)超過720p或者1080i的高清晰度電視系統(tǒng)（i表示隔行掃描，p表示逐行掃描）。目前標(biāo)清的播放畫質(zhì)為480i，
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降低FPGA功耗的設(shè)計(jì)

　　使用這些設(shè)計(jì)技巧和ISE功能分析工具來控制功耗　　新一代 FPGA的速度變得越來越快，密度變得越來越高，邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢？很多設(shè)計(jì)抉擇可以影響系統(tǒng)的功耗，這些抉擇包括從顯見的器件選擇到細(xì)小的基于使用頻率的狀態(tài)機(jī)值的選擇等。　　為了更好地理解本文將要討論的設(shè)計(jì)技巧為什么能夠節(jié)省功耗，我們先對(duì)功耗做一個(gè)簡單介紹。　　功耗包含兩個(gè)因素：動(dòng)態(tài)功耗和靜態(tài)功耗。動(dòng)態(tài)功耗是指對(duì)器件內(nèi)的容性負(fù)載充放電所需的功耗。它很大程度上取決于頻率、電壓和負(fù)載
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基于OS20的機(jī)頂盒軟件體系及其應(yīng)用設(shè)計(jì)

介紹了ST半導(dǎo)體公司的OS20實(shí)時(shí)嵌入式操作系統(tǒng)的基本特性。通過DVB-T數(shù)字電視機(jī)頂盒研發(fā)項(xiàng)目的應(yīng)用設(shè)計(jì)，分析了機(jī)頂盒軟件研發(fā)的主要問題和軟件架構(gòu)的實(shí)現(xiàn)
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具有硬件互斥的控制電路設(shè)計(jì)方法

　　在控制系統(tǒng)設(shè)計(jì)時(shí)，硬件互斥現(xiàn)象是很常見的，互斥電路功能可用硬件實(shí)現(xiàn)，也可以用系統(tǒng)加軟件實(shí)現(xiàn)。用硬件電路來實(shí)現(xiàn)指定的控制功能比用軟件來實(shí)現(xiàn)穩(wěn)定性好，處理速度更快得多。隨著大規(guī)模集成電路技術(shù)發(fā)展，用硬件來處理特定的功能的發(fā)展趨勢日趨明顯，隨著SOPC技術(shù)的發(fā)展，軟體的硬化已日益成為人們研究的熱點(diǎn)，專用功能的ASIC芯片越來越多。在進(jìn)行計(jì)算機(jī)操作系統(tǒng)設(shè)計(jì)時(shí)，互斥理論用來處理并發(fā)過程對(duì)臨界資源的共享；在進(jìn)行控制系統(tǒng)設(shè)計(jì)時(shí)，電路的不同邏輯狀態(tài)也常有互斥現(xiàn)象。如多個(gè)輸入信號(hào)共享一個(gè)處理電路而輸入信號(hào)同時(shí)作用于電路
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利用 Virtex-5 SXT 的高性能 DSP 解決方案

　　二十多年來，F(xiàn)PGA 為世人提供了最靈活、適應(yīng)性極強(qiáng)、快速的設(shè)計(jì)環(huán)境。早期的 DSP 設(shè)計(jì)人員發(fā)現(xiàn)，可將一種可再編程的門海用于數(shù)字信號(hào)處理。如果把內(nèi)置到 FPGA 架構(gòu)中的乘法器、加法器和累加單元結(jié)合起來，就可以利用大規(guī)模并行計(jì)算實(shí)現(xiàn)有效的濾波器算法。　　在未加工頻率性能方面的損失，通過并行計(jì)算得到了彌補(bǔ)，而且得遠(yuǎn)大于失，可謂“失之東隅，收之桑榆”；由此獲得的 DSP 帶寬完全可與替代方案媲美。隨著時(shí)間的推移，乘法器和加法器的實(shí)施越來越高效。1998 年，Xilinx 順理成章推出了第一個(gè)集成于
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如何成功地完成ASIC原型驗(yàn)證

　　原型驗(yàn)證---用軟件的方法來發(fā)現(xiàn)硬件的問題　　在芯片tap-out之前，通常都會(huì)計(jì)算一下風(fēng)險(xiǎn)，例如存在一些的嚴(yán)重錯(cuò)誤可能性。通常要某個(gè)人簽字來確認(rèn)是否去生產(chǎn)。這是一個(gè)艱難的決定。ASIC的產(chǎn)品NRE的費(fèi)用持續(xù)上升。一次失敗的ASIC流片將會(huì)推遲數(shù)個(gè)月的上市時(shí)間。誰愿意承擔(dān)簽字的責(zé)任呢? 一些BUG通過仿真和Emulation是抓不到的。傳統(tǒng)的驗(yàn)證方法認(rèn)為設(shè)計(jì)的功能符合功能定義就是對(duì)的。但功能定義到底對(duì)不對(duì)呢？唯一的辦法就是建立一個(gè)真實(shí)的硬件：原型。　　基于FPGA的原型 --- 一個(gè)虛擬
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基于ARM智能家居控制器設(shè)計(jì)與實(shí)現(xiàn)

　　如何將家庭里相對(duì)獨(dú)立的設(shè)備連接成一個(gè)系統(tǒng)，從而方便進(jìn)行本地和遠(yuǎn)程控制？本文通過采用ARM構(gòu)成智能家居控制器來實(shí)現(xiàn)這個(gè)目標(biāo)。智能家居控制器使用S3C2410、SIM100-E等元件來組成硬件平臺(tái)，再將Linux系統(tǒng)移植到硬件平臺(tái)上，然后設(shè)計(jì)好相應(yīng)的驅(qū)動(dòng)程序和應(yīng)用程序，最后將軟件下載到硬件平臺(tái)來對(duì)家電進(jìn)行本地和遠(yuǎn)程控制。　　隨著數(shù)字化家用電器的飛速發(fā)展，如何對(duì)家庭中相對(duì)獨(dú)立的家用電器進(jìn)行智能化管理和操作？這是人們非常關(guān)心的一個(gè)問題。智能家居控制器能夠?qū)⒃S多相對(duì)獨(dú)立的家用電器構(gòu)成一個(gè)統(tǒng)一的系統(tǒng)，從而方
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Aerospace采用風(fēng)河Linux開發(fā)太空項(xiàng)目

　　風(fēng)河系統(tǒng)公司（Wind River）日前宣布，Honeywell Aerospace公司將風(fēng)河Linux產(chǎn)品用于開發(fā)美國國家航空和宇宙航行局（NASA）New Millennium Program Space Technology 8（ST8）可靠多處理器（Dependable Multiprocessor）項(xiàng)目。Honeywell Aerospace是NASA ST8 Dependable Multiprocessor項(xiàng)目的主要外包商，這是該公司首次購買采用Linux平臺(tái)用于太空任務(wù)項(xiàng)目開發(fā)。Win
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新型圖形人機(jī)接口硬件系統(tǒng)和軟件架構(gòu)設(shè)計(jì)

本文介紹的人機(jī)接口與傳統(tǒng)的人機(jī)接口相比有以下幾個(gè)優(yōu)點(diǎn)：首先采用菜單顯示，簡化用戶操作流程；其次采用了合理的軟件架構(gòu)，功能模塊劃分明確，提高了程序的可讀性與可維護(hù)性。
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快速實(shí)現(xiàn)基于FPGA的脈動(dòng)FIR濾波器

引言　　目前，用FPGA(現(xiàn)場可編程門陣列)實(shí)現(xiàn)FIR(有限沖擊響應(yīng))濾波器的方法大多利用FPGA中LUT(查找表)的特點(diǎn)采用DA(分布式算法)或CSD碼等方法，將乘加運(yùn)算操作轉(zhuǎn)化為位與、加減和移位操作。這些結(jié)構(gòu)需要占用器件較多的LE(邏輯元件)資源，設(shè)計(jì)周期長，工作頻率低，實(shí)時(shí)性差。本文提出一種基于Stratix系列FPGA器件的新的實(shí)時(shí)高速脈動(dòng)FIR濾波器的快速實(shí)現(xiàn)方法。利用FGPA集成的DSP(數(shù)字信號(hào)處理器)乘加模塊定制卷積運(yùn)算單元，利用VHDL(甚高速集成電路硬件描述語言)元件例化語句快
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采用FPGA的圖像采集卡的設(shè)計(jì)

　　現(xiàn)代化生產(chǎn)和科學(xué)研究對(duì)視頻圖像采集系統(tǒng)的要求日益提高。傳統(tǒng)的圖像采集卡速度慢、處理功能簡單、采用分立元件、電路非常復(fù)雜；而且可靠性差、不易調(diào)試、不能很好地滿足特殊要求。FPGA(現(xiàn)場可編程門陣列)是專用集成電路中集成度最高的一種，用戶可對(duì)FPGA內(nèi)部的邏輯模塊和I／O模塊重新配置，以實(shí)現(xiàn)用戶所需邏輯功能。用戶對(duì)FPGA的編程數(shù)據(jù)放入芯片，通過上電加載到FPGA中，對(duì)其進(jìn)行初始化；也可在線對(duì)其編程，實(shí)現(xiàn)系統(tǒng)在線重構(gòu)?；贔PGA技術(shù)的圖像采集主要是通過集成的FPGA開發(fā)板，使用軟件編程把圖像的采集控制程
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嵌入式系統(tǒng)便攜式數(shù)據(jù)采集裝置設(shè)計(jì)

　　隨著計(jì)算機(jī)科學(xué)技術(shù)的飛速發(fā)展和普及，數(shù)據(jù)采集技術(shù)已經(jīng)滲透到雷達(dá)、通信、水聲、遙感、地質(zhì)勘探、振動(dòng)工程、語音處理、智能儀器、工業(yè)自動(dòng)控制以及生物醫(yī)學(xué)工程等眾多領(lǐng)域。本設(shè)計(jì)借助于嵌入式系統(tǒng)設(shè)計(jì)技術(shù)和微處理器技術(shù)來實(shí)現(xiàn)的低功耗、大容量存儲(chǔ)的便攜式數(shù)據(jù)采集裝置。該裝置具有如下特點(diǎn)：多通道數(shù)據(jù)采集(包括8路模擬量采集通道)、16路開關(guān)量采集通道、海量數(shù)據(jù)實(shí)時(shí)顯示存儲(chǔ)、集成度高、攜帶方便。　　嵌入式平臺(tái)的構(gòu)建　　20世紀(jì)90年代后，嵌入式實(shí)時(shí)操作系統(tǒng)在嵌入式系統(tǒng)中確立了主導(dǎo)地位。典型產(chǎn)品如VxWorks、
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TI推出業(yè)界最靈活的時(shí)鐘發(fā)生器系列

　　日前，德州儀器 (TI) 宣布推出一系列高度可編程的 1:4 鎖相環(huán) (PLL) 時(shí)鐘發(fā)生器，該系列產(chǎn)品能夠以統(tǒng)一的輸入頻率生成多達(dá)九個(gè)輸出時(shí)鐘源，每個(gè)輸出都能在系統(tǒng)內(nèi)編程，以支持高達(dá) 230 MHz 的任意時(shí)鐘頻率。上述特性提供了許多系統(tǒng)優(yōu)勢，其中包括降低功耗，縮短引導(dǎo)時(shí)間，而且無需重新進(jìn)行系統(tǒng)設(shè)計(jì)就能方便靈活地更新時(shí)鐘。這些優(yōu)勢最終有助于降低各種消費(fèi)類應(yīng)用的成本，如 IP 機(jī)頂盒或 IP 電話、數(shù)字電視等數(shù)字媒體系統(tǒng)、流媒體與打印機(jī)、導(dǎo)航系統(tǒng)以及便攜式設(shè)備等。　　新型 CDCE9xx 與 CD
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