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基于XC2V1000型FPGA的FIR抽取濾波器的設(shè)計(jì)

  • 　　1 引言 　　抽取濾波器廣泛應(yīng)用在數(shù)字接收領(lǐng)域,是數(shù)字下變頻器的核心部分。目前,抽取濾波器的實(shí)現(xiàn)方法有3種：單片通用數(shù)字濾波器集成電路、DSP和可編程邏輯器件。使用單片通用數(shù)字濾波器很方便,但字長和階數(shù)的規(guī)格較少,不能完全滿足實(shí)際需要。使用DSP雖然簡單,但程序要順序執(zhí)行,執(zhí)行速度必然慢?，F(xiàn)場可編程門陣列(FPGA)有著規(guī)整的內(nèi)部邏輯陣列和豐富的連線資源,特別適用于數(shù)字信號處理,但長期以來,用FPGA實(shí)現(xiàn)抽取濾波器比較復(fù)雜,其原因主要是FPGA中缺乏實(shí)現(xiàn)乘法運(yùn)算的有效結(jié)構(gòu)?，F(xiàn)在,FPGA集成了乘法器
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基于FPGA的高階FIR抽取濾波器有效實(shí)現(xiàn)結(jié)構(gòu)

  • 摘要 針對高階FIR抽取濾波器直接型結(jié)構(gòu)和多相濾波結(jié)構(gòu)中存在乘法器資源使用較多，導(dǎo)致實(shí)際系統(tǒng)實(shí)現(xiàn)困難的問題，提出了一種適合FPGA實(shí)現(xiàn)的高效多相結(jié)構(gòu)。該結(jié)構(gòu)采用分時復(fù)用技術(shù)，通過提高FPGA工作時鐘頻率，對降采樣
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改進(jìn)型CIC抽取濾波器設(shè)計(jì)與FPGA實(shí)現(xiàn)

  • 摘 要：為了改善級聯(lián)積分梳狀(CIC)濾波器通帶不平和阻帶衰減不足的缺點(diǎn)，給出一種改進(jìn)型CIC濾波器。該濾波器在采用 COSINE濾波器提高阻帶特性的基礎(chǔ)上，級聯(lián)了一個SINE濾波器，補(bǔ)償了其通帶衰減。硬件實(shí)現(xiàn)時，采用新
  • 關(guān)鍵字： FPGA  CIC  改進(jìn)型  抽取濾波器    

FPGA實(shí)現(xiàn)FIR抽取濾波器的設(shè)計(jì)

  • 摘要：采用基于分布式算法思想的方法來設(shè)計(jì)FIR濾波器，利用FDAt001設(shè)計(jì)系統(tǒng)參數(shù)，計(jì)算濾波器系數(shù)，同時為了要滿足系統(tǒng)要求考慮系數(shù)的位數(shù)。根據(jù)FIR數(shù)字濾波器結(jié)構(gòu)，對FIR數(shù)字濾波器的FPGA實(shí)現(xiàn)方法進(jìn)行分析。
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抽取濾波器介紹

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