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EEPW首頁 >> 主題列表 >> 數(shù)字信號處理器（dsp）

數(shù)字信號處理器（dsp） 文章 進入數(shù)字信號處理器（dsp）技術(shù)社區(qū)

用FPGA實現(xiàn)低成本實時深度感知

  • 引言 　　對于自主機器人導(dǎo)航和其它機器視覺應(yīng)用來說，實時深度感知是很關(guān)鍵的。目前通過立體圖像來計算深度的算法計算量很大，例如差異測繪，要占用CPU大量的時間，或者需要用昂貴的器件進行實時操作。 　　針對立體攝像的深度感知，F(xiàn)PGA解決方案能使處理器的時間得到緩解，減少或除去器件的成本，例如MPU、DSP、激光器和昂貴的鏡頭。通過提供給機器人其環(huán)境中 的差異測繪，F(xiàn)PGA使機器人中的CPU專注于重要的高層任務(wù)，例如建圖和定位。 差異測繪 　　加深度感知到機器人的常用技術(shù)是用兩個水平放置的
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基于CMOS圖像傳感器的嵌入式圖像采集與格式轉(zhuǎn)化

  • 開發(fā)了一種基于CMOS圖像傳感器的嵌入式圖像采集系統(tǒng)。該系統(tǒng)實現(xiàn)了圖像有效采集傳輸?shù)墓δ?，將采集到的Bayer格式數(shù)據(jù)轉(zhuǎn)化為RGB格式，采用嵌入式系統(tǒng)有利集成化、小型化設(shè)計。
  • 關(guān)鍵字： CMOS  圖像傳感器  DSP  Bayer格式  圖像采集  200806  

基于USB接口和DSP的飛機防滑剎車測試系統(tǒng)設(shè)計

  • 提出了以DSP為控制核心，采用USB通信設(shè)計的飛機防滑剎車測試系統(tǒng)。分析了飛機防滑剎車測試系統(tǒng)的組成，并介紹了測試系統(tǒng)主要硬件電路設(shè)計和系統(tǒng)上下位機軟件設(shè)計。
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異步DSP核心設(shè)計:更低功耗,更高性能

  • 目前，處理器性能的主要衡量指標(biāo)是時鐘頻率。絕大多數(shù)的集成電路 (IC) 設(shè)計都基于同步架構(gòu)，而同步架構(gòu)都采用全球一致的時鐘。這種架構(gòu)非常普及，許多人認(rèn)為它也是數(shù)字電路設(shè)計的唯一途徑。然而，有一種截然不同的設(shè)計技術(shù)即將走上前臺：異步設(shè)計。
    這一新技術(shù)的主要推動力來自硅技術(shù)的發(fā)展?fàn)顩r。隨著硅產(chǎn)品的結(jié)構(gòu)縮小到 90 納米以內(nèi)，降低功耗就已成為首要事務(wù)。異步設(shè)計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。

    異步技術(shù)由于諸多原因曾經(jīng)備受冷落，其中最重要的是缺乏標(biāo)準(zhǔn)化的
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基于DSP和模糊控制的尋線行走機器人設(shè)計與實現(xiàn)

  • 　　在最近的機器人比賽和電子設(shè)計競賽中，較多參賽題目要求機器人沿場地內(nèi)白色或黑色指引線行進。一些研究人員提出了基于尋線的機器人設(shè)計策略，主要是關(guān)注指引線的檢測，但對于機器人的整體設(shè)計未做說明。本文在總結(jié)此類賽事的基礎(chǔ)上，提出了一種將DSP(Digital Signal Processor)和CPLD(Complex Programmable Logic Device)作為核心處理器，采用模糊控制策略處理來自檢測指引線傳感器信號的機器人行走機構(gòu)的通用性設(shè)計方法。 　　1 車體機械設(shè)計 　　由于機器人比賽
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FPGA+DSP實時三維圖像信息處理系統(tǒng)

  • 　　三維圖像信息處理一直是圖像視頻處理領(lǐng)域的熱點和難點，目前國內(nèi)外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預(yù)處理、重建、構(gòu)型等囊括底層和高層的處理工作。三維圖像處理數(shù)據(jù)量特別大、運算復(fù)雜，單純依靠通用PC很難達到實時性要求，不能滿足現(xiàn)行高速三維圖像處理應(yīng)用。 　　本系統(tǒng)中，采用FPGA實現(xiàn)底層的信號預(yù)處理算法，其處理數(shù)據(jù)量很大，處理速度高，但算法結(jié)構(gòu)相對比較簡單，可同時兼顧速度和靈活性。高層處理算法數(shù)據(jù)量較少、算法結(jié)構(gòu)復(fù)雜，可采用運算速度快、尋址方式靈活、通信機制強大的
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基于DSP Builder的14階FIR濾波器的設(shè)計

  • 數(shù)字濾波器在數(shù)字信號處理的各種應(yīng)用中發(fā)揮著十分重要的作用，他是通過對采樣數(shù)據(jù)信號進行數(shù)學(xué)運算處理來達到頻域濾波的目的。數(shù)字濾波器既可以是有限長單脈沖響應(yīng)(FIR)濾波器也可以是無限長單脈沖響應(yīng)(IIR)濾波器。在維納濾波器理論發(fā)明的早期，人們使用IIR濾波器，但現(xiàn)在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設(shè)計一個FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發(fā)軟件的DSP開發(fā)工具。在DSP
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異步 DSP 核心設(shè)計: 更低功耗，更高性能

  • 這一新技術(shù)的主要推動力來自硅技術(shù)的發(fā)展?fàn)顩r。隨著硅產(chǎn)品的結(jié)構(gòu)縮小到 90 納米以內(nèi)，降低功耗就已成為首要事務(wù)。異步設(shè)計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。
  • 關(guān)鍵字： 功耗  高性能  設(shè)計  核心  DSP  異步  

EDGE手機基帶處理設(shè)計的幾種實現(xiàn)方法評估

用8位微處理器實現(xiàn)數(shù)字低通濾波器設(shè)計

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： 8位微處理器  DSP  數(shù)字  低通濾波器  

什么是DSP及DSP技術(shù)詳解

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于DSP多處理器實時開發(fā)環(huán)境的設(shè)計

  • 本文通過研究提出了一種多處理器實時開發(fā)環(huán)境的設(shè)計思想，它可以支持多種型號處理器的同時開發(fā)，使系統(tǒng)級開發(fā)變得簡單易行。
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DSP應(yīng)用系統(tǒng)中的硬件接口電路設(shè)計

  • 介紹了DSP應(yīng)用系統(tǒng)的硬件接口電路：包括電平變換電路、仿真器JTAG接口電路、以及可擴展的硬件接口（如A/D、D/A、SRAM）等的設(shè)計方法，并給出了接口電路在設(shè)計時須注意的幾個問題。
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一種基于DSP平臺的快速H.264編碼算法的設(shè)計

  • 　　視頻壓縮編碼標(biāo)準(zhǔn)H.264／AVC是由ISO／IEC和ITU-T組成的聯(lián)合視頻專家組(JVT)制定的，他引進了一系列先進的視頻編碼技術(shù)，如4×4整數(shù)變換、空域內(nèi)的幀內(nèi)預(yù)測，多參考幀與多種大小塊的幀間預(yù)測技術(shù)等，標(biāo)準(zhǔn)一經(jīng)推出，就以其高效的壓縮性能和友好的網(wǎng)絡(luò)特性受到業(yè)界的廣泛推崇。特別是在2004年7月JVT組織做了重要的保真度范圍擴展的補充后，更加擴大了標(biāo)準(zhǔn)的應(yīng)用范圍，但同時巨大的運算量卻成為其廣泛應(yīng)用的瓶頸?？紤]到H.264協(xié)議實現(xiàn)的復(fù)雜度，本文的思路是：一方面提高硬件處理速度和能力，采
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在采用FPGA設(shè)計DSP系統(tǒng)中仿真的重要性

  • 仿真是所有系統(tǒng)成功開發(fā)的基礎(chǔ)。通過在不同條件、參數(shù)值和輸入情況下對系統(tǒng)進行高級行為仿真，工程師可以迅速找到、分離并糾正系統(tǒng)的設(shè)計問題。因為在這一階段，比較容易區(qū)分設(shè)計問題和編程問題。通過在系統(tǒng)級工作，設(shè)計人員可以確定這一階段的問題是來自設(shè)計缺陷，而不是編程問題。此外，在信號處理系統(tǒng)設(shè)計中使用基于模型的方法大大縮短了“錯誤診斷延遲”時間――從設(shè)計中出現(xiàn)錯誤到發(fā)現(xiàn)錯誤并分離錯誤的時間。
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數(shù)字信號處理器（dsp）介紹

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