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EEPW首頁 >> 主題列表 >> 數(shù)字信號處理器（dsp）

數(shù)字信號處理器（dsp） 文章 進入數(shù)字信號處理器（dsp）技術(shù)社區(qū)

基于DSP的變頻調(diào)速系統(tǒng)電磁干擾問題研究

  •  1 電磁干擾(EMI)分析       1．1 電磁干擾的概念及途徑      電磁干擾產(chǎn)生于干擾源，他是一種來自外部和內(nèi)部的并有損于有用信號的電磁現(xiàn)象。干擾經(jīng)過敏感元件、傳輸線、電感器、電容器、空間場等形式的途徑并以某種形式作用，其干擾效應(yīng)、現(xiàn)象普遍存在，形式各異，稱之為傳導干擾，他按帶不帶信息可以分為信息傳導干擾源和電磁噪聲傳導干擾源兩類。信息傳導干擾源是指帶有的無用信息對模擬通道的干擾
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基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計

  • 介紹了一種基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計方案，以高性能數(shù)字信號處理器ADSP—BF535作為核心，結(jié)合現(xiàn)場可編程門陣列FPGA，實現(xiàn)了實時數(shù)字圖像處理。    　　 小波分析是近年迅速發(fā)展起來的新興學科，與Fourier分析和Gabor變換相比，小波變換是時間(空間)頻率的局部化分析，它通過伸縮平移運算對信號逐步進行多尺度細化，最終達到高頻處時間細分和低頻處頻率細分，能自動適應(yīng)時頻信號分析的要求，從而可聚焦到信號的任意細節(jié)．解決了Fourier分
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嵌入式目標模塊在DSP系統(tǒng)開發(fā)中的應(yīng)用

  • 引言隨著電子技術(shù)的不斷進步，特別是3C(計算機、通信、消費電子)的飛速發(fā)展，電子設(shè)備日趨數(shù)字化、小型化和集成化，嵌入式芯片逐漸成為設(shè)計開發(fā)人員的首選。DSP作為嵌入式芯片的典型代表之一，在信息產(chǎn)業(yè)領(lǐng)域得到了廣泛應(yīng)用。DSP雖然為3C產(chǎn)品的開發(fā)提供了很好的硬件支撐平臺，但設(shè)計者仍得花費一定的時間去掌握DSP內(nèi)部各種寄存器的正確設(shè)置、軟件編程方法以及控制算法設(shè)計，這必然會增大產(chǎn)品開發(fā)難度，延長產(chǎn)品開發(fā)周期，從而影響開發(fā)效率。Matlab公司最新推出的針對DSP應(yīng)用控制系統(tǒng)而開發(fā)的嵌入式目標模塊Embedded
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DSP有了更多的含義

  • 　　近日，F(xiàn)PGA廠商熱衷推出DSP功能產(chǎn)品。FPGA-DSP大約在5年前推出此概念，當時還是非常高端的功能，其優(yōu)勢是可以并行處理，因此比傳統(tǒng)DSP的速率高很多。這也是后起之秀—Xilinx和DSP老大—TI能夠坐在一起，談在基站等領(lǐng)域進行合作的原因。但是，4月16日，Xilinx推出了其低端Spartan-DSP 系列，表明了FPGA想向低端走，擴大其DSP市場版圖的野心。 　　Xilinx列舉了其FPGA-DSP與通用DSP的性能差距（見下圖）。并說DSP是數(shù)字信號處理，并不一定采用信號處理器，各種
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嵌入式DSP上的視頻編解碼

  • 隨著數(shù)字多媒體的應(yīng)用日漸廣泛，視頻解碼 在嵌入式系統(tǒng)設(shè)計中變成一個基本要素。視頻標準有多種，依賴于產(chǎn)品可實施其中的一個或者多個標準。當然這不是全部，視頻僅僅是多媒體碼流的一部分，另外還 有音頻或者語音需要并行處理。因此，一個精確的處理存儲或數(shù)據(jù)流的同步層是必需的。此外，視頻解碼本身對性能要求較高，需要不同于先前基于語音和信息應(yīng)用 的系統(tǒng)架構(gòu)；這就對便攜系統(tǒng)提出了特殊挑戰(zhàn)，而桌面應(yīng)用同樣面臨這些問題。 通用視頻標準和編解碼器 聯(lián)合視頻組(Joint Video Team, JVT)由 ITU的視頻編
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透過DSP系統(tǒng)模型建立和設(shè)定實現(xiàn)最佳模擬

  • 嵌入式軟件發(fā)展需要對目標架構(gòu)及其使用有著廣泛而透徹的認識和瞭解。把嵌入式系統(tǒng)從概念轉(zhuǎn)化成能夠有效地在硬件環(huán)境中部署的高效能解決方案，需要若干個步驟。整個過程包括：分析、架構(gòu)搭建、評估、硬件支援、設(shè)計、編碼、除錯、整合、驗證和確認，過程中準確度極為重要。硬件資源的使用效率低，或者是軟件沒有針對那些硬件資源進行最佳化，都可能對性能帶來嚴重的影響。 CEVA-X系列采用的創(chuàng)新架構(gòu)，充分利用可能的設(shè)計變數(shù)來控制整體性能。CEVA-X1620是CEVA-X核心系列的第一款產(chǎn)品，具有先進的平行架構(gòu)（Parallel
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多DSP局部總線與VME總線的接口設(shè)計

  • 本文基于雷達實時信號處理的需要，用FPGA實現(xiàn)了多DSP信號處理模板局部總線和基于標準VME總線的計算機進行通信的接口設(shè)計。
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賽靈思推出新型低成本SPARTAN-DSP系列

  • 　　賽靈思公司日前宣布推出首個低成本 Spartan™-DSP 系列產(chǎn)品以及相應(yīng)的開發(fā)板和增強設(shè)計軟件，極大地擴展了其XtremeDSP™解決方案的產(chǎn)品線，并且在價格、性能和功耗三合一組合方面為數(shù)字信號處理樹立了新的標桿。Spartan-DSP以業(yè)界最低的成本價格提供了高達20GMACS（每秒十億次乘法累計）的DSP功能，而價格不到30美元。與同類的其它高性能可配置DSP器件相比，該系列產(chǎn)品的動態(tài)功耗降低多達50%。 　　新推出Spartan-DSP系列之后，XtremeDSP產(chǎn)
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基于DSP實現(xiàn)的無差拍控制逆變器

  • 隨著計算機以及各種精密自動化設(shè)備、電子設(shè)備被廣泛應(yīng)用于通信、工業(yè)自動化控制、辦公自動化等領(lǐng)域, 逆變器作為 UPS的重要組成部分，近年來得到了迅速展。對逆變器的控制成為研究重點，即要求其輸出波形穩(wěn)態(tài)精度高、總諧波畸變率低和動態(tài)響應(yīng)快。目前，瞬時 PID控制、重復控制等技術(shù)都在應(yīng)用中占有重要地位。但這兩種技術(shù)都有難以克服的缺點，如瞬時PID控制難以實現(xiàn)數(shù)字化；重復控制的動態(tài)響應(yīng)慢。美國著名控制理論專家卡爾曼于60年代初提出了數(shù)字控制的無差拍控制思想。隨著電力電子技術(shù)的發(fā)展，80年代中期，無差拍控制被應(yīng)用于逆
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基于DSP和CPLD的低功耗多路數(shù)據(jù)處理系統(tǒng)設(shè)計

  • 引言 隨著電子技術(shù)的應(yīng)用和發(fā)展，數(shù)字信號處理內(nèi)容日益復雜，同時，很多情況下要求整個系統(tǒng)具有低功耗的特點。為滿足這種要求，DSP芯片設(shè)計技術(shù)也在向低功耗、高性能的方向發(fā)展。從處理速度來看，TMS320VC5502的運算能力已經(jīng)達到了600MMACS，即每秒鐘可以完成6億次乘加運算。從功耗來看，TMS320VC5502內(nèi)核電壓只有1.26V，整個芯片的功耗也大大降低了。本文介紹了基于TMS320VC5502和CPLD XC95144的低功耗多路數(shù)據(jù)處理系統(tǒng)。 模擬信號的輸入經(jīng)過50Hz陷波電路(濾除工頻
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微機保護中DSP與時鐘DS12CR887的接口設(shè)計

  • 系統(tǒng)中其他外圍電路的控制方法和原理與時鐘芯片完全類似，以此方法可以搭建一個通用性強、性能穩(wěn)定的硬件平臺，再通過各種具體的保護應(yīng)用軟件，從而實現(xiàn)各種具體功能的微機保護裝置。
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Altera FPGA在Fairlight新媒體處理引擎中替代64片DSP

  • 2007年4月10號，北京——澳大利亞悉尼的音頻產(chǎn)品系統(tǒng)專業(yè)公司Fairlight利用Altera® FPGA的靈活性以及數(shù)字信號處理(DSP)優(yōu)勢，將采用了8塊電路板和64片DSP的設(shè)計精簡為一塊Stratix® FPGA PCI卡。 Fairlight首席技術(shù)官Tino Fibaek說：“我們的水晶內(nèi)核(CC-1)體系結(jié)構(gòu)表明，Altera FPGA在DSP功能上的性價比非常優(yōu)異。采用了Altera的開發(fā)工具后，該項目成為我見過的進展最為順利的項目。我們完成開發(fā)所花費的時間僅是DSP
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Altera FPGA在Fairlight新媒體處理引擎中替代64片DSP

  • 　　澳大利亞悉尼的音頻產(chǎn)品系統(tǒng)專業(yè)公司Fairlight利用Altera® FPGA的靈活性以及數(shù)字信號處理(DSP)優(yōu)勢，將采用了8塊電路板和64片DSP的設(shè)計精簡為一塊Stratix® FPGA PCI卡。 　　Fairlight首席技術(shù)官Tino Fibaek說：“我們的水晶內(nèi)核(CC-1)體系結(jié)構(gòu)表明，Altera FPGA在DSP功能上的性價比非常優(yōu)異。采用了Altera的開發(fā)工具后，該項目成為我見過的進展最為順利的項目。我們完成開發(fā)所花費的時間僅是DSP器件體系結(jié)構(gòu)設(shè)計的三分
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基于DSP的PCI總線數(shù)據(jù)采集系統(tǒng)的研究

  • 1 引言 隨著數(shù)字信號處理器性能的不斷提高及其成本與售價的大幅下降，數(shù)字信號處理應(yīng)用領(lǐng)域飛速擴展，信號處理進入了一個新的發(fā)展時期。同時隨著計算機技術(shù)以及互聯(lián)網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，越來越多的數(shù)據(jù)需要經(jīng)過計算機來進行處理、存儲、傳輸籌操作。計算機的應(yīng)用已經(jīng)遍及我們生活的每一個角落。由于計算機本身的特點，通用計算機通常僅負責沒有實時性要求的工作，而不適于進行實時性要求很高的數(shù)字信號處理。將計算機和 DSP有機地結(jié)合起來，充分利用各自的優(yōu)點，它們將會相得益彰，滿足現(xiàn)實應(yīng)用中對數(shù)據(jù)實時處理能力、數(shù)據(jù)傳輸能力以及數(shù)
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基于DSP芯片的MELP聲碼器的算法實現(xiàn)

  • 論文對MELP編解碼算法的原理進行了簡要分析，討論了如何在定點DSP芯片TMS320VC5416上實現(xiàn)該算法，并研究了其關(guān)鍵技術(shù)，最后對測試結(jié)果進行了分析。
  • 關(guān)鍵字： 算法  實現(xiàn)  MELP  芯片  DSP  基于  
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數(shù)字信號處理器（dsp）介紹

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