現(xiàn)場(chǎng)可編程門(mén)陣列(fpga) 文章進(jìn)入現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)技術(shù)社區(qū)

基于FPGA的中高頻感應(yīng)電爐控制電路設(shè)計(jì)方案

　　1 引言　　中高頻感應(yīng)爐是利用電磁感應(yīng)原理加熱和溶化金屬的，這種方式是一種較理想的加熱工藝，已經(jīng)廣泛應(yīng)用于金屬熔煉、焊接、表面淬火等加工和熱處理過(guò)程。中高頻電爐的負(fù)載是由感應(yīng)圈和被加熱的金屬工件組成，為了降低無(wú)功功率，需要用串聯(lián)或并聯(lián)電容的方式來(lái)補(bǔ)償無(wú)功功率，使整個(gè)電路中形成中高頻的LC振蕩。維持這樣較恒定的頻率振蕩，金屬內(nèi)部將形成渦流而發(fā)熱，從而達(dá)到加熱和熔化金屬的目的。傳統(tǒng)的控制電路主要采用分離元件的模數(shù)混合電路，控制精度低，容易產(chǎn)生噪聲問(wèn)題。　　本文將提出一種基于FPGA片上可編程技術(shù)
關(guān)鍵字： FPGA 電爐控制電路電磁感應(yīng)

DSP和FPGA在大尺寸激光數(shù)控加工系統(tǒng)中的運(yùn)用

　　激光切割和雕刻以其精度高、視覺(jué)效果好等特性，被廣泛運(yùn)用于廣告業(yè)和航模制造業(yè)。在大尺寸激光加工系統(tǒng)的開(kāi)發(fā)過(guò)程中，加工速度與加工精度是首先要解決的問(wèn)題。解決速度問(wèn)題的一般方法是在電機(jī)每次運(yùn)動(dòng)前、后設(shè)置加、減速區(qū)，但這會(huì)使加工數(shù)據(jù)總量成倍增加。除此之外，龐大的數(shù)據(jù)計(jì)算量也需要一個(gè)專門(mén)的高性能處理器來(lái)實(shí)現(xiàn)。　　FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)在并行信號(hào)處理方面具有極大的優(yōu)勢(shì)。本系統(tǒng)采用FPGA作為加工數(shù)據(jù)的執(zhí)行器件。這種解決方案突出的特點(diǎn)是讓運(yùn)動(dòng)控制的處理部分以獨(dú)立的、硬件性方式展開(kāi)，增加系統(tǒng)的性能和可靠性，
關(guān)鍵字： DSP FPGA 數(shù)控加工激光加工

基于FPGA的迭代層析重建中的小數(shù)處理方法

基于FPGA的迭代層析重建中的小數(shù)處理方法,發(fā)射光譜層析(EST)技術(shù)是一種不干擾原待測(cè)場(chǎng)分布的測(cè)量診斷技術(shù)，他在熱物理量測(cè)試、等離子體診斷等方面顯示出了極大的優(yōu)越性，尤其是在場(chǎng)分布測(cè)量方面，幾乎是其他方法不可替代的，是測(cè)量三維流場(chǎng)內(nèi)部物理量分布的一種常用方法。

傳統(tǒng)的層析重建技術(shù)，通常是利用軟件編程在計(jì)算機(jī)上直接完成，這要花費(fèi)很長(zhǎng)的時(shí)間，無(wú)法滿足實(shí)時(shí)重建時(shí)對(duì)速度的要求，現(xiàn)在已有研究者開(kāi)始著手研究在硬件(例如FPGA和DSP)上來(lái)實(shí)現(xiàn)層析重建技術(shù)，例如：在FPGA上實(shí)現(xiàn)ART算法。但
關(guān)鍵字：處理方法小數(shù) 重建 FPGA 基于

基于FPGA的數(shù)字電視信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的數(shù)字電視信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn),電視信號(hào)的數(shù)字化使得數(shù)字電視設(shè)備越來(lái)越受到廣大電子消費(fèi)者的青睞，如何選擇自己理想的數(shù)字電視產(chǎn)品，也成了消費(fèi)者關(guān)心的問(wèn)題，評(píng)價(jià)、測(cè)試電視系統(tǒng)與設(shè)備運(yùn)行的質(zhì)量狀況成為廣播電視行業(yè)所關(guān)注的熱點(diǎn)。而數(shù)字電視信號(hào)發(fā)生器能提供可視的測(cè)試圖像信號(hào)，直觀、快捷的測(cè)試方法，因此，數(shù)字電視信號(hào)發(fā)生器成為目前電子設(shè)計(jì)的熱門(mén)研究課題，他在數(shù)字電視節(jié)目制作播出、科研、生產(chǎn)以及售后服務(wù)過(guò)程中起著不可或缺的作用。本文設(shè)計(jì)了一種基于FPGA的數(shù)字電視信號(hào)友生器，該信號(hào)發(fā)生器以一種單芯片多配置
關(guān)鍵字：設(shè)計(jì) 實(shí)現(xiàn) 信號(hào)發(fā)生器數(shù)字電視 FPGA 基于

基于FPGA設(shè)計(jì)航空電子系統(tǒng)

　　基于現(xiàn)場(chǎng)可編程門(mén)陣列 (FPGA) 核心的實(shí)施體現(xiàn)了先進(jìn)的現(xiàn)代航空電子設(shè)計(jì)方法。　　這項(xiàng)技術(shù)具有多種優(yōu)勢(shì),如廢棄組件管理、降低設(shè)計(jì)風(fēng)險(xiǎn)、提高集成度、減小體積、降低功耗和提高故障平均間隔時(shí)間(MTBF)等,吸引著用戶將原來(lái)的系統(tǒng)轉(zhuǎn)移到此項(xiàng)技術(shù)。MIL-STD-1553 的市場(chǎng)可能隨著這種趨勢(shì)而繁榮起來(lái) ;事實(shí)上,某些客戶已經(jīng)覺(jué)得這項(xiàng)技術(shù)的實(shí)施有點(diǎn)姍姍來(lái)遲。　　MIL-STD-1553 核心帶來(lái)了多種好處,它代表著徹底告別了 ASIC 傳統(tǒng)。FPGA 中加入一項(xiàng)知識(shí)產(chǎn)權(quán)核心,就獲得了一種與眾不同
關(guān)鍵字： FPGA 航空電子 ASIC MIL-STD-1553

用PLD實(shí)現(xiàn)高可用性系統(tǒng)的熱插拔和加電順序保護(hù)

　　互聯(lián)網(wǎng)的繁榮和無(wú)線通訊及存儲(chǔ)行業(yè)的發(fā)展使得實(shí)時(shí)數(shù)據(jù)通訊量成指數(shù)級(jí)增長(zhǎng)。數(shù)據(jù)通訊量的急劇增加使系統(tǒng)可用性顯得更加關(guān)鍵，因?yàn)橄到y(tǒng)即使停一秒鐘也意味著將產(chǎn)生巨大的影響，并將減少運(yùn)營(yíng)商的收入。為了使系統(tǒng)的宕機(jī)時(shí)間為零，可以將系統(tǒng)設(shè)計(jì)成可熱插拔的形式。熱插拔是指系統(tǒng)在正常運(yùn)行時(shí)可以從背板上插入或取出電路板，而不會(huì)對(duì)主系統(tǒng)的正常工作產(chǎn)生影響。熱插拔也稱為熱切換(hot swap)或熱插入。　　快速發(fā)展的半導(dǎo)體工藝技術(shù)使支持熱插拔的設(shè)計(jì)更趨復(fù)雜，因?yàn)楣に嚦叽缭絹?lái)越小，IC的工作電壓也越來(lái)越低，而且不同的I/O標(biāo)
關(guān)鍵字： PLD 熱插拔加電順序保護(hù) FPGA

XtremeData發(fā)售基于Altera Stratix III FPGA的Intel FSB模塊

　　Altera公司宣布，開(kāi)始提供基于FPGA/Intel? Xeon?處理器的前端總線(FSB)模塊。采用了多片Altera? Stratix? III FPGA，并且使用Intel QuickAssist技術(shù)，XtremeData XD2000i In-Socket加速器(ISA)展示了1066 MHz協(xié)處理解決方案。 ? 　　XD2000i系列在目前市場(chǎng)上最小封裝中提供密度最大的Stratix III FPGA。模塊使用三片F(xiàn)PGA，一片用于基于Inte
關(guān)鍵字： FPGA XtremeData Intel FSB

基于FPGA的USB2.0虛擬邏輯分析儀的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的USB2.0高速、低成本的虛擬邏輯分析儀的設(shè)計(jì)原理與實(shí)現(xiàn)方法。重點(diǎn)介紹了邏輯分析儀的觸發(fā)方式設(shè)計(jì)以及利用CP2102芯片構(gòu)建USB接口、實(shí)現(xiàn)系統(tǒng)與PC通信的方法。關(guān)鍵詞：虛擬邏輯分析儀；FPGA；觸發(fā)設(shè)計(jì)；USB2.0；CP2102 引言傳統(tǒng)的邏輯分析儀體積龐大、價(jià)格昂貴、通道數(shù)目有限，并且在數(shù)據(jù)采集、傳輸、存儲(chǔ)、顯示等方面
關(guān)鍵字： FPGA USB2.0 虛擬邏輯分析儀數(shù)據(jù)采集 Altera

基于短時(shí)能量和短時(shí)過(guò)零率的VAD算法及其FPGA實(shí)現(xiàn)

　　語(yǔ)音激活檢測(cè)VAD（Voice Activity Detection）是一種通過(guò)特定的判決準(zhǔn)則判斷語(yǔ)音中出現(xiàn)的停頓和靜默間隔，檢測(cè)出有效語(yǔ)音部分的技術(shù)。運(yùn)用這種技術(shù)可以在確保語(yǔ)音質(zhì)量的前提下，對(duì)不同類別的語(yǔ)音段采用不同的比特?cái)?shù)進(jìn)行編碼，從而降低語(yǔ)音的編碼速率。由于在雙工移動(dòng)通信系統(tǒng)中，一方只有35％的時(shí)間處于激活狀態(tài)[1]，如何降低靜音期的編碼速率對(duì)于減少傳輸帶寬、功率以及容量具有積極的作用，因此VAD技術(shù)在語(yǔ)音通信領(lǐng)域具有重要的使用價(jià)值。隨著適合于變比特率語(yǔ)音編碼的CDMA和PRMA等多址技術(shù)的出現(xiàn)
關(guān)鍵字： FPGA VAD 短時(shí)能量短時(shí)過(guò)零率 FIFO 濾波器

Xilinx為低功耗Intel車載信息娛樂(lè)參考設(shè)計(jì)增加靈活的連接功能

　　賽靈思公司（Xilinx, Inc.）宣布推出一款集成了賽靈思汽車（XA）現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）和知識(shí)產(chǎn)權(quán)（IP）的解決方案。這一集成解決方案包括在針對(duì)汽車音響本體（head unit）應(yīng)用的低功耗Intel車載信息娛樂(lè)（IVI）參考設(shè)計(jì)中。該參考設(shè)計(jì)結(jié)合了XA解決方案與Intel® Atom™ 處理器，為系統(tǒng)開(kāi)發(fā)人員在開(kāi)發(fā)開(kāi)放式汽車信息娛樂(lè)平臺(tái)時(shí)提供了更高級(jí)別的性能、可擴(kuò)展能力和靈活性。　　與消費(fèi)者在家庭和辦公室中的需求一樣，車載數(shù)字信息訪問(wèn)和娛樂(lè)應(yīng)用的需求也在不斷增長(zhǎng)
關(guān)鍵字： Xilinx 低功耗 Intel 車載信息娛樂(lè) FPGA

FPGA系統(tǒng)的供電要求和最新DC/DC穩(wěn)壓器解決方案

FPGA系統(tǒng)的供電要求和最新DC/DC穩(wěn)壓器解決方案,隨著FPGA制造工藝尺寸持續(xù)縮小、設(shè)計(jì)配置更加靈活，以及采用FPGA的系統(tǒng)的不斷發(fā)展，原來(lái)只采用微處理器和ASIC的應(yīng)用現(xiàn)在也可以用FPGA來(lái)實(shí)現(xiàn)了。最近FPGA供應(yīng)商推出的新型可編程器件進(jìn)一步縮小了FPGA和ASIC之間的性能差別。盡管這類器件的可配置性對(duì)設(shè)計(jì)工程師很有吸引力，但使用這些器件所涉及的復(fù)雜設(shè)計(jì)規(guī)則和接口協(xié)議，要求設(shè)計(jì)工程師經(jīng)過(guò)全面的培訓(xùn)，并需要進(jìn)行參考設(shè)計(jì)評(píng)估、設(shè)計(jì)仿真和驗(yàn)證工作。另一方面，F(xiàn)PGA應(yīng)用中非常復(fù)雜的模擬設(shè)計(jì)，例如用于內(nèi)核
關(guān)鍵字： DC/DC 穩(wěn)壓器解決方案最新要求系統(tǒng) 供電 FPGA

高效FPGA乘法器在無(wú)線基站中的使用

　　基于WiMax及其派生標(biāo)準(zhǔn)的新興寬帶無(wú)線協(xié)議需要越來(lái)越高的吞吐量和數(shù)據(jù)速率。這些協(xié)議提出的快速芯片速率和數(shù)字射頻處理可以在使用FPGA方案的硬件上得到最佳的實(shí)現(xiàn)。　　FPGA非常適合作為高性能、高性價(jià)比的解決方案來(lái)實(shí)現(xiàn)這些物理層協(xié)議中的數(shù)字功能，因?yàn)樗鼈儼ㄒ韵仑S富的資源：　　1.DSP模塊，可以用來(lái)實(shí)現(xiàn)各種FIR濾波和FFT/IFFT操作所要求的乘法器和加法器/累加器功能；　　2. SERDES收發(fā)器，可以支持無(wú)線前端與基帶數(shù)字板之間的CPRI和OBSAI接口；　　3. 重要的FPG
關(guān)鍵字： FPGA 乘法器無(wú)線基站 WiMax DSP IP核

基于Modelsim FLI接口的FPGA仿真技術(shù)

　　1、Modelsim 及 FLI接口介紹　　Modelsim是 Model Technology（Mentor Graphics的子公司）的 HDL 硬件描述語(yǔ)言仿真軟件，可以實(shí)現(xiàn) VHDL, Verilog，以及 VHDL-Verilog 混合設(shè)計(jì)的仿真。除此之外，Modelsim還能夠與 C 語(yǔ)言一起實(shí)現(xiàn)對(duì) HDL 設(shè)計(jì)文件的協(xié)同仿真。同時(shí)，相對(duì)于大多數(shù)的 HDL 仿真軟件來(lái)說(shuō)，Modelsim 在仿真速度上也有明顯優(yōu)勢(shì)。這些特點(diǎn)使 Modelsim 越來(lái)越受到 EDA設(shè)計(jì)者、尤其是 FPGA
關(guān)鍵字： FPGA 仿真 Modelsim FLI VHDL

設(shè)計(jì)技術(shù)問(wèn)答：FPGA設(shè)計(jì)的安全性考量

設(shè)計(jì)技術(shù)問(wèn)答：FPGA設(shè)計(jì)的安全性考量,本文以提問(wèn)的形式講述了FPGA設(shè)計(jì)安全性考量
關(guān)鍵字：設(shè)計(jì) 考量安全性問(wèn)答技術(shù) FPGA

用FPGA實(shí)現(xiàn)低成本實(shí)時(shí)深度感知

引言　　對(duì)于自主機(jī)器人導(dǎo)航和其它機(jī)器視覺(jué)應(yīng)用來(lái)說(shuō)，實(shí)時(shí)深度感知是很關(guān)鍵的。目前通過(guò)立體圖像來(lái)計(jì)算深度的算法計(jì)算量很大，例如差異測(cè)繪，要占用CPU大量的時(shí)間，或者需要用昂貴的器件進(jìn)行實(shí)時(shí)操作。　　針對(duì)立體攝像的深度感知，F(xiàn)PGA解決方案能使處理器的時(shí)間得到緩解，減少或除去器件的成本，例如MPU、DSP、激光器和昂貴的鏡頭。通過(guò)提供給機(jī)器人其環(huán)境中的差異測(cè)繪，F(xiàn)PGA使機(jī)器人中的CPU專注于重要的高層任務(wù)，例如建圖和定位。差異測(cè)繪　　加深度感知到機(jī)器人的常用技術(shù)是用兩個(gè)水平放置的
關(guān)鍵字：機(jī)器視覺(jué) FPGA 深度感知嵌入式 DSP 200806

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現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)介紹

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